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计时程序技术资料
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基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL
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一个很好的VHDL实现的功能模块程序
一个很好的VHDL实现的功能模块程序,希望你可以用的上!...
dsp下载器cpld程序
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采用MaxPlusII写的一个小时钟程序，也是供初学参考。呵呵。注///版主，开发环境里面没有MaxPlusII....
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VHDL写的LMS算法程序。利用本地正弦信号，根据LMS算法对输入信号进行跟踪。用以产生和输入信号同频同相的本地信号。...
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CPLD7256的例子程序，已经调试通过，是学习的好资料。...
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lua脚本语言调用allegro游戏程序库的接口-跨平台
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