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有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的. 练习三利用条件语句实现计数分频时序电路实验目的： 1. 掌握条件语句在简单时序模块设计中的使用； 2. 学习在Ver...

📅 2016-11-19

四位十进制频率计设计包含测频控制器（TESTCTL），4位锁存器(REG4B)，十进制计数器（CNT10）的原程序(vhd)，波形文件(wmf ),包装后的元件(bsf)。顶层原理图文件（Bloc...

📅 2016-11-21

本文十一个计数器的实验报告，阐述了设计的思路，设计的具体方案，以及上机操作的步骤，描述非常详细！...

📅 2016-11-25

利用QuartusII的"MegaWizard Plug-In Manager", 设计输入数据宽度是4bit的ADD、SUB、MULT、DIVIDE、COMPARE 把它们作为一个proje...

📅 2016-12-26

完成一个加速器设计，全加器，具 8位计数器...

📅 2017-01-25

关于xilinx环境下的电路设计，验证计数器电路的正确性...

📅 2014-01-07

数控分频器的输出信号频率为输入数据的函数。用传统的方法设计,其设计过程和电路都比较复杂,且设计成果的可修改性和可移植性都较差。基于VHDL 的数控分频器设计,整个过程简单、快捷,极易修改,可移植性...

📅 2014-11-29

数字频率计的设计可以分为测量计数和显示。其测量的基本原理是计算一定时间内待测信号的脉冲个数，这就要求由分频器产生标准闸门时间信号，计数器记录脉冲个数，由控制器对闸门信号进行选择，并对计数器使能断进行同...

📅 2014-01-19

555定时计数器的使用和脉冲波形的变换与产生原理，有助于大家设计信号发生器...

📅 2013-12-19

这是一个8分频的VHDL语言设计程序，也可以看成是8进制计数器...

📅 2013-12-22

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