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解空间

  • 由DSP芯片生成电压空间矢量脉宽调制波

    由DSP芯片生成电压空间矢量脉宽调制波。

    标签: DSP 芯片 电压 空间矢量脉宽调制

    上传时间: 2013-11-13

    上传用户:xiaowei314

  • 数字信号处理学习指导与习题精解

    数字信号处理学习指导与习题精解

    标签: 数字信号处理

    上传时间: 2014-12-28

    上传用户:225588

  • 收音机工作原理、安装、焊接图片详解

    收音机工作原理、安装、焊接图片详解

    标签: 收音机 工作原理 焊接

    上传时间: 2013-11-18

    上传用户:jdm439922924

  • 基于DSP_BIOS大空间网络型火灾探测系统设计

    提出了以TMS320DM642为平台开发基于DSP/BIOS的大空间网络型火灾探测系统。该系统在DSP/BIOS与RF5参考框架的基础上,利用TCP/IP协议栈设计了多任务线程的应用程序,实现了火灾检测算法的移植与网络开发环境的构建。最终将视频处理结果由以太网传至控制中心,同时控制中心可以利用串口通信线程对CCD摄像机进行参数设置。

    标签: DSP_BIOS 空间网络 火灾探测 系统设计

    上传时间: 2013-11-03

    上传用户:maricle

  • Verilog_HDL的基本语法详解(夏宇闻版)

            Verilog_HDL的基本语法详解(夏宇闻版):Verilog HDL是一种用于数字逻辑电路设计的语言。用Verilog HDL描述的电路设计就是该电路的Verilog HDL模型。Verilog HDL既是一种行为描述的语言也是一种结构描述的语言。这也就是说,既可以用电路的功能描述也可以用元器件和它们之间的连接来建立所设计电路的Verilog HDL模型。Verilog模型可以是实际电路的不同级别的抽象。这些抽象的级别和它们对应的模型类型共有以下五种:   系统级(system):用高级语言结构实现设计模块的外部性能的模型。   算法级(algorithm):用高级语言结构实现设计算法的模型。   RTL级(Register Transfer Level):描述数据在寄存器之间流动和如何处理这些数据的模型。   门级(gate-level):描述逻辑门以及逻辑门之间的连接的模型。   开关级(switch-level):描述器件中三极管和储存节点以及它们之间连接的模型。   一个复杂电路系统的完整Verilog HDL模型是由若干个Verilog HDL模块构成的,每一个模块又可以由若干个子模块构成。其中有些模块需要综合成具体电路,而有些模块只是与用户所设计的模块交互的现存电路或激励信号源。利用Verilog HDL语言结构所提供的这种功能就可以构造一个模块间的清晰层次结构来描述极其复杂的大型设计,并对所作设计的逻辑电路进行严格的验证。   Verilog HDL行为描述语言作为一种结构化和过程性的语言,其语法结构非常适合于算法级和RTL级的模型设计。这种行为描述语言具有以下功能:   · 可描述顺序执行或并行执行的程序结构。   · 用延迟表达式或事件表达式来明确地控制过程的启动时间。   · 通过命名的事件来触发其它过程里的激活行为或停止行为。   · 提供了条件、if-else、case、循环程序结构。   · 提供了可带参数且非零延续时间的任务(task)程序结构。   · 提供了可定义新的操作符的函数结构(function)。   · 提供了用于建立表达式的算术运算符、逻辑运算符、位运算符。   · Verilog HDL语言作为一种结构化的语言也非常适合于门级和开关级的模型设计。因其结构化的特点又使它具有以下功能:   - 提供了完整的一套组合型原语(primitive);   - 提供了双向通路和电阻器件的原语;   - 可建立MOS器件的电荷分享和电荷衰减动态模型。   Verilog HDL的构造性语句可以精确地建立信号的模型。这是因为在Verilog HDL中,提供了延迟和输出强度的原语来建立精确程度很高的信号模型。信号值可以有不同的的强度,可以通过设定宽范围的模糊值来降低不确定条件的影响。   Verilog HDL作为一种高级的硬件描述编程语言,有着类似C语言的风格。其中有许多语句如:if语句、case语句等和C语言中的对应语句十分相似。如果读者已经掌握C语言编程的基础,那么学习Verilog HDL并不困难,我们只要对Verilog HDL某些语句的特殊方面着重理解,并加强上机练习就能很好地掌握它,利用它的强大功能来设计复杂的数字逻辑电路。下面我们将对Verilog HDL中的基本语法逐一加以介绍。

    标签: Verilog_HDL

    上传时间: 2013-11-23

    上传用户:青春给了作业95

  • ISE新建工程及使用IP核步骤详解

    ISE新建工程及使用IP核步骤详解

    标签: ISE IP核 工程

    上传时间: 2013-11-18

    上传用户:peterli123456

  • ISE13设计流程详解

    ISE13[1].1_设计流程详解

    标签: ISE 13 设计流程

    上传时间: 2013-10-14

    上传用户:hebmuljb

  • 基于FPGA的栈空间管理器的研究和设计

    提出了一种将堆栈空间划分为任务栈和中断嵌套栈的设计结构,使堆栈空间最小化。采用VHDL硬件语言,在FPGA设备上模拟实现了具有自动检验功能的栈空间管理器。栈空间管理器由不同功能的逻辑模块组成,主要阐述了状态控制逻辑模块和地址产生逻辑模块的设计方法。

    标签: FPGA 栈空间 管理器

    上传时间: 2014-12-28

    上传用户:plsee

  • 基于FPGA的空间矢量PWM的实现

    本文详述了空间矢量SV PWM 的算法, 并提出用FPGA 实现SV PWM 的方法, 最后分析了使用FP2GA 的优点

    标签: FPGA PWM 空间矢量

    上传时间: 2013-11-14

    上传用户:asaqq

  • 空间通信协议SCPS_CCSDS研究综述

    空间通信协议SCPS_CCSDS研究综述

    标签: SCPS_CCSDS 通信协议

    上传时间: 2013-11-15

    上传用户:jesuson