组态设计

状态机设计，用VHDL进行MOORE型状态机的设计。原程序以及波形图

2016-04-18 165 组态设计

状态机设计，用VHDL进行MEALY型状态机的设计。由于两个程序本身有延时现象，本实验进行了改进。

2016-04-18 130 组态设计

难得一见的完整状态机设计解析，涵盖一段式、两段式与三段式结构的深度剖析，适合数字电路设计者掌握核心逻辑实现方式。

2026-03-20 2 组态设计

本文介绍了有限状态机的设计,探讨了VerilogHDL代码描述会对状态机的综合结果产生的影响,最后通过一个序列检测器的设计进行实例说明。

2025-12-22 1 组态设计

有限状态机\Moore型和Mealy型有限状态机的VHDL设计

2024-05-03 9 组态设计

通过Verilog HDL语言设计状态机，实现简单状态机设计。

2024-09-15 10 组态设计

2013-12-04 49 组态设计

2016-09-30 85 组态设计

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