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ARM加载FPGA.实现ARM和FPGA之间的正确通信
实现DES和RSA的加密解密,MD5还有数字签名。
可重构加速部件的测试代码和相关论文,包含该作者的论文。
用VHADL和Verilog HDL实现带进位的8位加减法器。
一个实现DES算法的加密和解密的小程序。
能够计算出整数和分数分数的加、减、乘法,但是不具备混和运算功能
支持MD5、Base64、DES的加密和解密算法的小程序
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