离散事件系统仿真程序CPU_scheduler说明： 1.仿真功能与要求： 1.1 单CPU系统，系统有10个终端输入任务，如果一个任务的执行时间大于规定的时间片，则该任务执行一个时间片之后退出CPU，并重新参加排队，直到执行完退出CPU，然后才允许相应终端重新输入一个新的作业。任务排队的原则是在CPU中执行次数越少的越排在前面，如果两个任务执行的次数相同，按照FIFO原则排队。 1.2 每个终端输入任务的时间满足均值为25秒的指数分布。每个任务需要CPU执行的时间满足均值为0.8秒的随机指数分布。CPU的时间片长度为0.1秒，任务间切换需要0.015秒任务的个数为1000时终止仿真，计算每个任务的平均相应时间和队列中的平均任务个数。
标签： CPU_scheduler 1.1 CPU 离散事件系统
上传时间： 2016-09-19
上传用户：阳光少年2016
生成具有空间相关性的图像。整幅图像被看作是一个离散的随机场，每个像素都是一个随机变量。对于空间相关性模拟和研究非常有用！
上传时间： 2014-01-03
上传用户：haohaoxuexi
离散时间信号处理 第2版
上传时间： 2013-07-13
上传用户：eeworm
专辑类-数字处理及显示技术专辑-106册-9138M 离散时间信号处理-第2版-724页-16.0M.pdf
上传时间： 2013-07-11
上传用户：himbly
电机优化设计是复杂的有约束、非线性、混合离散多变量规划问题.该文在对电机优化设计理论进行研究的基础上,从一般传统的优化方法入手,对电机的全局优化设计方法特别是遗传算法进行了详细的研究和探讨.该论文的主要工作包括:(1)对适应于电机优化设计的常用传统优化方法(HOOKE-JEEVES法、MDOD法和SUMT法)进行了较为详细的研究,给出了各种方法的计算流程和步骤;(2)对全局优化的理论和方法进行了研究,分析了全局优化方法中的随机实验法、模拟退火算法和模拟进化算法各自的特点,对遗传算法的工作原理及其诸要素进行了详细的探讨;(3)在对遗传算法的基本原理进行研究的基础上,进行了电机优化设计遗传算法的研究,分析了各要素对电机优化设计遗传算法性能的影响;(4)建立了三相异步电机多目标优化设计的数学模型,分别编制了基于HOOKE-JEEVES法、MDOD法和多轮进化遗传算法的电机优化设计程序,并对使用各种优化方法优化的结果进行了对比分析.
上传时间： 2013-04-24
上传用户：tonyshao
现代交流调速系统中，永磁同步电机(PMSM)由于其良好的性能，正得到越来越广泛地应用。永磁同步电机的控制策略有很多，不同的控制策略各有千秋。有的满足了高性能要求，但成本却很高；有的满足了硬件低成本要求，但软件算法非常复杂、或者性能不理想，等等。因此，针对实际的应用场合，开发出性能价格比优越的控制器系统是非常有价值的。 本课题就是基于此思想，兼顾硬件成本和软件可行性，运用低成本策略、较优的软件算法设计出双闭环控制器系统，在低成本传感器条件下实现了永磁同步电机正弦波驱动控制。 本文根据永磁同步电机磁场定向下的空间矢量数学模型，对其控制所需的位置、速度和电流参数展开分析。提出了基于离散位置信号进行位置预估的原理，并分析了复杂工况下位置信号的矫正问题。利用BLDC方式与SVPWM方式的转换，解决了肩动过程中永磁同步电机脉动和失步问题。分析了基于英飞凌XC164CM单片机系统直流侧电阻采样计算相电流原理。设计了基于英飞凌XC164CM单片机的控制系统，外围功率驱动电路以及过电流保护等电路。编制了基于离散位置信号的永磁同步电机电压空间矢量(SVPWM)控制策略的C语言程序，完成了软件和系统的调试。 最后，进行了一系列的实验论证，并取得了理想的效果。
上传时间： 2013-04-24
上传用户：gaorxchina
I2C(Inter Integrated Circuits)是Philips公司开发的用于芯片之间连接的串行总线，以其严格的规范、卓越的性能、简便的操作和众多带I2C接口的外围器件而得到广泛的应用并受到普遍的欢迎。 现场可编程门阵列(FPGA)设计灵活、速度快，在数字专用集成电路的设计中得到了广泛的应用。本论文主要讨论了如何利用Verilog/FPGA来实现一个随机读/写的I2C接口电路，实现与外围I2C接口器件E2PROM进行数据通信，实现读、写等功能，传输速率实现为100KBps。在Modelsim6.0仿真软件环境中进行仿真，在Xilinx公司的ISE9.li开发平台上进行了下载，搭建外围电路，用Agilem逻辑分析仪进行数据采集，分析测试结果。 首先，介绍了微电子设计的发展概况以及设计流程，重点介绍了HDL/FPGA的设计流程。其次，对I2C串行总线进行了介绍，重点说明了总线上的数据传输格式并对所使用的AT24C02 E2PROM存储器的读／写时序作了介绍。第三，基于Verilog _HDL设计了随机读/写的I2C接口电路、测试模块和显示电路；接口电路由同步有限状态机(FSM)来实现；测试模块首先将数据写入到AT24C02的指定地址，接着将写入的数据读出，并将两个数据显示在外围LED数码管和发光二极管上，从而直观地比较写入和输出的数据的正确性。FPGA下载芯片为Xilinx SPARTAN Ⅲ XC3S200。第四，用Agilent逻辑分析仪进行传输数据的采集，分析数据传输的时序，从而验证电路设计的正确性。最后，论文对所取得的研究成果进行了总结，并展望了下一步的工作。
上传时间： 2013-06-27
上传用户：liuchee
相对于JPEG中二维离散余弦变换(2DDCT)来说，在JPEG2000标准中，二维离散小波变换(2DDWT)是其图像压缩系统的核心变换。在很多需要进行实时处理图像的系统中，如数码相机、遥感遥测、卫星通信、多媒体通信、便携式摄像机、移动通信等系统，需要用芯片实现图像的编解码压缩过程。虽然有许多研究工作者对图像处理的小波变换进行了研究，但大都只偏重算法研究，对算法硬件实现时的复杂性考虑较少，对图像处理的小波变换硬件实现的研究也较少。 本文针对图像处理的小波变换算法及其硬件实现进行了研究。对文献[13]提出的“内嵌延拓提升小波变换”(Combiningthedata-extensionprocedureintothelifting-basedDWTcore)快速算法进行仔细分析，提出一种基于提升方式的5/3小波变换适合硬件实现的算法，在MATLAB中仿真验证了该算法，证明其是正确的。并设计了该算法的硬件结构，在MATLAT的Simulink中进行仿真，对该结构进行VHDL语言的寄存器传输级(RTL)描述与仿真，成功综合到Altera公司的FPGA器件中进行验证通过。本算法与传统的小波变换的边界处理方法比较：由于将其边界延拓过程内嵌于小波变换模块中，使该硬件结构无需额外的边界延拓过程，减少小波变换过程中对内存的读写量，从而达到减少内存使用量，降低功耗，提高硬件利用率和运算速度的特点。本算法与文献[13]提出的算法相比较：无需增加额外的硬件计算模块，又具有在硬件实现时不改变原来的提升小波算法的规则性结构的特点。这种小波变换硬件芯片的实现不仅适用于JPEG2000的5/3无损小波变换，当然也可用于其它各种实时图像压缩处理硬件系统。
上传时间： 2013-06-13
上传用户：jhksyghr
随着计算机软硬水平的不断提高，嵌入式领域的发展也取得了长足的进步。目前，嵌入式与Linux技术的结合正在推动着嵌入式技术的飞速发展，嵌入式系统的研究和应用产生了显著的变化。 硬件上，嵌入式平台由51系列内核的8位机系统逐步上升到以ARM内核为主流的32位系统；软件上Linux作为操作系统的发展史上一个重要的里程碑，以高安全性和稳定性、开源免费等的优势使得其在政府、国防、教育、工业等领域获得了广泛的运用。 2n伪随机多频道激电理论(简称伪随机理论)，是由何继善院士率先提出并命名的，其实质是将含有3，5，7…等多个奇数主频率的复合波同时向大地发送，接收机同时接收经大地介质传导的复合波中各主频率电流响应。在地球物理勘探领域，基于伪随机理论的数据采集系统具有抗干扰能力强、测量精度高、观测速度快、装置轻便等优点而得到广泛应用。 本文在分析伪随机理论基础上，结合当前嵌入式软硬件发展的最新成果，开展对ARM Linux嵌入式数据信息系统的研究与实现。 首先，通过需求分析，对各种采集方案比较后，设计系统总体方案。通过数据信息系统驱动总体分析，选用嵌入式板载的音频芯片实现数据A/D转换，完成Linux下采集设备驱动程序设计。 其次，在ARM9内核的S3C2410嵌入式处理器硬件平台，按照嵌入式软件开发流程，搭建嵌入式Linux交叉开发平台；裁剪并移植Linux内核，构建嵌入式文件系统。 再次，利用当前流行的嵌入式图形开发库Qtopia Core，结合Sqlite数据库与Linux多线程技术，设计数据采集应用程序，建立数据信息系统的应用软件模型，此基础上对整个系统进行测试，与理论值进行对比实验。 最后，就课题的不足做出总结，并且提出系统后期的改进建议。
上传时间： 2013-07-11
上传用户：CETM008
信息技术的不断发展,对信息的安全提出了更高的要求.在应用公钥密码体制的时候,对密钥长度要求越来越大,处理的速度要求越来越快.而基于椭圆曲线离散对数问题的椭圆曲线密码体制,因其每比特最大的安全性,受到了越来越广泛的注意.椭圆曲线密码体制(ECC:Elliptic Curve Cryptosystem)的快速实现也成为一个关注的方面.该文按照确定有限域、选取曲线参数、划分结构模块、优化模块算法、实现模块设计,验证模块功能的顺序进行书写.为了硬件实现上的方便,设计选择了含有Ⅱ型优化正规基的伽略域GF(2191),并在该域上构造了随机的椭圆曲线.根据层次化、结构化的设计思路,将椭圆曲线上的标量乘法运算划分成两个运算层次:椭圆曲线上的运算和有限域上的运算.模块划分之后,利用自底向上的设计思路,主要针对有限域上的乘法运算进行了重要的改进,并对加法群中的标量乘运算的算法进行了分析、证明,以达到面积优化和快速执行的效果.具体设计中,采用硬件描述语言Verilog HDL,在Mentor Graphics公司出品的FPGA Advantage平台上进行电路设计.完成了各个模块的设计输入和仿真.设计选用了Altera公司的APEX Ⅱ系列器件,利用第一方软件Quartus Ⅱ 2.2进行综合、布局、布线和时序仿真.文中给出了椭圆曲线上的点加、倍点和标量乘法模块的具体设计结构框图.并且根据椭圆曲线的标量乘特点,提出了合适的验证方案.该设计完成了椭圆曲线上的标量乘法运算.设计主要针对资源受限的应用环境:改进了有限域上的乘法运算、使用了没有预处理的标量乘算法.改进后的椭圆曲线标量乘法需要2,741,998个逻辑单元,在100MHz的时钟约束下,运行一次标量乘法运算需要567.69us.该次设计的结果可以直接用来构造椭圆曲线上的签名、验证、密钥交换等算法.
上传时间： 2013-05-24
上传用户：zhuo0008
