📚 硬件语言设计技术资料

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此设计采用Verilog HDL硬件语言设计,在掌宇开发板上实现. 将整个电路分为两个子模块，一个提供同步信号（H_SYNC和V_SYNC）及像素位置信息；另一个接收像素位置信息，并输出颜色信号。这样便于进行图形修改，同时也容易实现...

📅 2015-04-11 👤 myworkpost

Verilog HDL 硬件语言设计开发板

用vhdl硬件语言设计的16位cpu，上传的压缩包既包含源代码又包含详细的文档说明。...

📅 2015-10-27 👤 refent

vhdl cpu 硬件语言设计

采用Verilog HDL硬件语言设计,实现基本的公用电话计费功能,设计完整....

📅 2014-01-11 👤 tzl1975

Verilog HDL 硬件语言设计电话

·C/C++语言硬件程序设计：基于TMS320C5000系列DSP应用...

📅 2013-04-24 👤 qazwsc

C5000 320C 5000 TMS

基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序...

📅 2013-08-06 👤 taozhihua1314

FPGA VHDL 数字频率计硬件描述语言

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