硬件状态
共 63 篇文章
硬件状态 相关的电子技术资料,包括技术文档、应用笔记、电路设计、代码示例等,共 63 篇文章,持续更新中。
不同功能触发器的相互转换方法
触发器是时序逻辑电路的基本构成单元,按功能不同可分为 RS 触发器、 JK 触发器、 D 触发器及 T 触发器四种,<BR>其功能的描述可以使用功能真值表、激励表、状态图及特性方程。只要增加门电路便可以实现不同功能触发器的相互<BR>转换,例如要将 D 触发器转换为 JK 触发器,转换的关键是推导出 D 触发器的输入端 D 与 JK 触发器的输入端<BR>J 、 K 及状态输出端 Qn 的逻辑表达
AN-1064了解AD9548的输入基准监控器
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如AD9548数据手册所述,AD9548的输入端最多可支持八个独立参考时钟信号。八路输入各有一个专用参考监控器,判断输入参考信号的周期是否满足用户要求。图1是参考监控器和必要支持元件的框图。参考监控器测量输入参考信号的周期,并声明信号是过慢还是过快,即表示参考信号有误。该信息保存在参考状态寄存器内(各参考监控器具有用户可读取的专用状态寄存器)。虽然参考
CMOS绿色模式AC_DC控制器振荡器电路
采用电流模脉宽调制控制方案的电池充电芯片设计,锯齿波信号的线性度较好,当负载电路减小时,自动进入Burst Mode状态提高系统的效率。整个电路基于1.0 μm 40 V CMOS工艺设计,通过Hspice完成了整体电路前仿真验证和后仿真,仿真结果表明,振荡电路的性能较好,可广泛应用在PWM等各种电子电路中。<br />
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船载USB系统跟踪数传信号可行性研究
<span style="color: rgb(0, 0, 0); font-family: 'Trebuchet MS', Arial; line-height: 21px; ">讨论了一种船载USB系统跟踪数传信号可行性的方案,为实现船载USB系统对飞船目标跟踪功能的备份提供了一个新的思路,该方案通过切换船载USB系统中跟踪接收机软件状态的方式来实现,此方法已成功应用于跟踪过境数传信号目标的跟
〈硬件工程师手册〉(华为内参)73页%200.8M%20PDF版
硬件工程师手册
硬件设计中滤波电路与软件滤波算法
硬件设计
基于ADuC7061的高精度PLC模拟前端设计
<span id="LbZY">针对于工业PLC模拟信号的采集和输出,本文提出了一种基于ADuC7061的高精度模拟前端设计方案。该系统支持双通道的PLC模拟信号输入并提供一路PLC标准电流输出。该系统在-10~70 范围内达到0.2%的电压测量精度和0.2%的电流输出精度。硬件部分以ADuC7061作为测量和控制核心,配合外围模拟调理电路完成模拟信号的调理、检测和输出,并通过隔离的SPI进行数据
5 Gsps高速数据采集系统的设计与实现
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<span style="color: rgb(0, 0, 0); font-family: 'Trebuchet MS', Arial; line-height: 21px; ">以某高速实时频谱仪为应用背景,论述了5 Gsps采样率的高速数据采集系统的构成和设计要点,着重分析了采集系统的关键部分高速ADC(analog to digital,模数转换器)的设计、系统采样时钟设计、模数
心电信号调理电路设计
<span style="color: rgb(0, 0, 0); font-family: 'Trebuchet MS', Arial; font-size: 11.818181991577148px; line-height: 21px; ">心电(Electrocardiograph)作为人体重要的生理及病理指标之一,具有重要的医学研究价值。针对其信号微弱、频率低、阻抗高、随机性强及易受干扰
FPU加法器的设计与实现
<span style="color: rgb(0, 0, 0); font-family: 'Trebuchet MS', Arial; font-size: 11.818181991577148px; line-height: 20.909090042114258px; ">浮点运算器的核心运算部件是浮点加法器,它是实现浮点指令各种运算的基础,其设计优化对于提高浮点运算的速度和精度相当关键。文
一种面向瞬时故障的容错技术的形式化方法
<span id="LbZY">软件发生瞬时故障时,可能会导致处理器状态改变,致使程序执行出现数据错误或者控制流错误。目前已有许多软件、硬件以及混合的解决方案,主要的方法是重复计算和检查副本的一致性。但是,生成正确的容错代码十分困难,而且几乎没有关于证明这些技术的正确性的研究。类型化汇编语言(TAL)是一种标准的程序安全性证明的方式。本文概述了一种面向瞬时故障的软硬结合的容错方法,以及对该方法的形
基于遗传算法的组合逻辑电路设计的FPGA实现
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<span style="color: rgb(0, 0, 0); font-family: 'Trebuchet MS', Arial; line-height: 21px; ">基于遗传算法的组合逻辑电路的自动设计,依据给出的真值表,利用遗传算法自动生成符合要求的组合逻辑电路。由于遗传算法本身固有的并行性,采用软件实现的方法在速度上往往受到本质是串行计算的计算机制约,因此采用硬件化设
串行数模转换TLC2543硬件及c语言
数控电流源 ad转换部分
MT-011 找出那些难以琢磨、稍纵即逝的ADC闪码和亚稳状态
数字通信系统设计关注的一个主要问题是误码率(BER)。ADC噪声对系统BER的影响可以分析得出,但前提是该噪声须为高斯噪声。遗憾的是,ADC可能存在非高斯误码,简单分析根本无法预测其对BER的贡献。在数字示波器等仪表应用中,误码率也可能造成问题,尤其是当器件工作于“单发”模式时,或者当器件尝试捕获偶尔出现的瞬变脉冲时。误码可能被误解为瞬变脉冲,从而导致错误的结果。本指南介绍
一种DDS任意波形发生器的ROM优化方法
<span style="color: rgb(102, 102, 102); font-family: 宋体, Arial, Helvetica, sans-serif; line-height: 25px;">提出了一种改进的基于直接频率合成技术(DDS)的任意波形发生器在现场可编程门阵列(FPGA)上的实现方法。首先将三角波、正弦波、方波和升/降锯齿波的波形数据写入片外存储器,当调用时再将相
硬件设计知识
硬件
智能仪表中调节参数的数字化方法及其应用
本文主要介绍对智能仪表中调节参数的一种新方法。米取了通用的徽调 电位器的硬件电路和经过数字化处理的软件方法, 使参数的调节及修正既方便又能 长期保存。文中给出了有关的数学推导、硬件电路及软件程序。
基于FPGA的全新数字化PCM中频解调器设计
<span style="color: rgb(0, 0, 0); font-family: 'Trebuchet MS', Arial; line-height: 21px; ">为了对中频PCM信号进行直接解调,提出一种全新的数字化PCM中频解调器的设计方法。在实现过程中,采用大规模的FPGA芯片对位帧同步器进行了融合,便于设备的集成化和小型化。这种新型的中频解调器比传统的基带解调器具有硬件成
基于选择进位32位加法器的硬件电路实现
<span style="color: rgb(0, 0, 0); font-family: 'Trebuchet MS', Arial; font-size: 11.818181991577148px; line-height: 20.99431800842285px;">为了缩短加法电路运行时间,提高FPGA运行效率,利用选择进位算法和差额分组算法用硬件电路实现32位加法器,差额分组中的加法单
硬件工程师笔试及面试题
囊括了模拟电子技术、数字电子技术、单片机原理、MCU、DSP等专业知识,同时搜集了各大名企的面试真题。