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FPU加法器的设计与实现

  • 资源大小:580 K
  • 上传时间: 2014-01-19
  • 上传用户:wodn76
  • 资源积分:2 下载积分
  • 标      签: FPU 加法器

资 源 简 介

浮点运算器的核心运算部件是浮点加法器,它是实现浮点指令各种运算的基础,其设计优化对于提高浮点运算的速度和精度相当关键。文章从浮点加法器算法和电路实现的角度给出设计方法,通过VHDL语言在QuartusII中进行设计和验证,此加法器通过状态机控制运算,有效地降低了功耗,提高了速度,改善了性能。

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