相位差可
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差分阻抗
当你认为你已经掌握了PCB 走线的特征阻抗Z0，紧接着一份数据手册告诉你去设计一个特定的差分阻抗。令事情变得更困难的是，它说：“……因为两根走线之间的耦合可以降低有效阻抗，使用50Ω的设计规则来得到一个大约80Ω的差分阻抗！”这的确让人感到...
2013-11-10
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差分阻抗
当你认为你已经掌握了PCB 走线的特征阻抗Z0，紧接着一份数据手册告诉你去设计一个特定的差分阻抗。令事情变得更困难的是，它说：“……因为两根走线之间的耦合可以降低有效阻抗，使用50Ω的设计规则来得到一个大约80Ω的差分阻抗！”这的确让人感到...
2013-10-20
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/// ////差动输入
/// ////差动输入，定时启动，由T2定时//////////////// /////////选择6，7通道为ADC0差动转化通道,其中第6通道为P3.6,第7通道为P.7
2015-11-26
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