本文的目的就是研究如何应用FPGA这种大规模的可编程逻辑器件实现CCD（Charge Coupled Device，电荷耦合器件）数字图像的实时采集及预处理。基于对实时图像处理系统的研究与设计，本文主要研究工作及成果如下： 1.本论文详细的介绍了图像采集卡的结构和基本工作原理。同时，针对高分辨率的CCD摄像机，探讨了有关点目标与CCD像元一一对应的图像采集及其硬件和软件设计方法。 2.本文分析了星图中弱小目标、噪声以及背景的特点，给出了点目标的场景图像的数学模型及复杂背景下点目标检测的预处理方法。针对星图灰度分布的特点，采用高斯低通滤波算法和高通滤波算法对星图进行预处理，同时还对图像扫描聚类算法进行了研究与分析。 3.数字信号处理器常常因为在复杂性、运算速度等方面的限制，难以实时的实现复杂的检测算法。本文采用FPGA技术，实现了复杂背景下弱点目标的预处理算法，解决了计算、数据缓冲和存储操作协调一致的问题，同时采用并行高密度加法器和流水线的工作方式，使整个系统的数据交换和处理速度得以很大的提高，合理的解决了资源和速度之间的相互制约问题，并在实际中取得满意的结果。
上传时间： 2013-07-03
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卷积码是无线通信系统中广泛使用的一种信道编码方式。Viterbi译码算法是一种卷积码的最大似然译码算法，它具有译码效率高、速度快等特点，被认为是卷积码的最佳译码算法。本文的主要内容是在FPGA上实现约束长度为9，码率为1/2，采用软判决方式的Viterbi译码器。 本文首先介绍了卷积码的基本概念，阐述了Viterbi算法的原理，重点讨论了决定Viterbi算法复杂度和译码性能的关键因素，在此基础上设计了采用“串-并”结合运算方式的Viterbi译码器，并在Altera EP1C20 FPGA芯片上测试通过。本文的主要工作如下： 1.对输入数据采用了二比特四电平量化的软判决方式，对欧氏距离的计算方法进行了简化，以便于用硬件电路方式实现。 2.对ACS运算单元采用了“串-并”结合的运算方式，和全并行的设计相比，在满足译码速度的同时，节约了芯片资源。本文中提出了一种路径度量值存储器的组织方式，简化了控制模块的逻辑电路，优化了系统的时序。 3.在幸存路径的选择输出上采用了回溯译码方法，与传统的寄存器交换法相比，减少了寄存器的使用，大大降低了功耗和设计的复杂度。 4.本文中设计了一个仿真平台，采用Modelsim仿真器对设计进行了功能仿真，结果完全正确。同时提出了一种在被测设计内部插入监视器的调试方法，巧妙地利用了Matlab算法仿真程序的输出结果，提高了追踪错误的效率。 5.该设计在Altera EP1C20 FPGA芯片上通过测试，最大运行时钟频率110MHz，最大译码输出速率10.3Mbps。 本文对译码器的综合结果和Altera设计的Viterbi译码器IP核进行了性能比较，比较结果证明本文中设计的Viterbi译码器具有很高的工程实用价值。
上传时间： 2013-07-23
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TIL300 TIL300A应用主要问题（包括工作状态，运放的选择和阻值的计算）的考虑14
上传时间： 2013-04-24
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语音编码技术始终是语音研究的热点。语音编码作为多媒体通信中信息传输的一个重要环节，越来越受到广泛的重视。G729是由美国、法国、日本和加拿大的几家著名国际电信实体联合开发的，国际电信联盟(ITU-T)于1995年11月正式通过了G729。96年ITU-T又制定了G729的简化方案G729A，主要降低了计算的复杂度以便于实时实现。因其具有良好的合成语音质量、适中的复杂度、较低的时延等优点，G729A标准已被广泛应用在VOIP网关、IP电话中。 论文利用Altera公司的新一代可编程逻辑器件在数字信号处理领域的优势，对G729A语音编码中的线性预测(LP)滤波器系数提取的FPGA(现场可编程门阵列，Field Programmable Gate Array)实现进行了深入研究。论文首先对语音信号处理及其发展进行介绍，深入讨论了G729A语音编解码技术。第二，对Altera公司的Stratix系列可编程器件的内部结构进行了研究，分析了在QuartusII开发平台上进行FPGA设计的流程。第三，基于FPGA，对G729A编码系统的LP分析部分做了具体设计，其中包括自相关函数和杜宾(Durbin)递推两个主要功能模块，并对其工作过程进行了详细的分析。第四，针对系统所使用的除法运算都是商小于1的特点，设计并实现了一个系统专用的除法器模块。最后，在Altera FPGA目标芯片EP1S30F780C7上，对LP分析系统进行了验证，证明了方案的可行性。
上传时间： 2013-04-24
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H.264/AVC是ITU-T和ISO联合推出的新标准，采用了近几年视频编码方面的先进技术，以较高编码效率和网络友好性成为新一代国际视频编码标准。 本文以实现D1格式的H.264/AVC实时编码器为目标，作者负责系统架构设计，软硬件划分以及部分模块的硬件算法设计与实现。通过对H.264/AVC编码器中主要模块的算法复杂度的评估，算法特点的分析，同时考虑到编码器系统的可伸缩性，可扩展性，本文采用了DSP+FPGA的系统架构。DSP充当核心处理器，而FPGA作为协处理器，针对编码器中最复杂耗时的模块一运动估计模块，设计相应的硬件加速引擎，以提供编码器所需要的实时性能。 H.264/AVC仍基于以前视频编码标准的运动补偿混合编码方案，其中一个主要的不同在于帧间预测采用了可变块尺寸的运动估计，同时运动向量精度提高到1/4像素。更小和更多形状的块分割模式的采用，以及更加精确的亚像素位置的预测，可以改善运动补偿精度，提高图像质量和编码效率，但同时也大大增加了编码器的复杂度，因此需要设计专门的硬件加速引擎。 本文给出了1/4像素精度的运动估计基于FPGA的硬件算法设计与实现，包括整像素搜索，像素插值，亚像素(1/2，1/4)搜索以及多模式选择(支持全部七种块分割模式)。设计中，将多处理器技术和流水线技术相结合，提供高性能的并行计算能力，同时，采用合理的存储器组织结构以提供高数据吞吐量，满足运算的带宽要求，并使编码器具有较好的可伸缩性。最后，在Modelsim环境下建立测试平台，完成了对整个设计的RTL级的仿真验证，并针对Altera公司的FPGA芯片stratixⅡ系列的EP2S60-4器件进行优化，从而使工作频率最终达到134MHz，分析数据表明该模块能够满足编码器的实时性要求。
上传时间： 2013-07-24
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GPS全球定位系统是美国国防部为军事目的而建立的卫星导航系统，其主要目的是解决海上、陆地和空中运载工具的导航定位问题。GPS作为新一代卫星导航系统，不仅具有全球、全天候、连续、高精度导航与定位能力，而且具有优良的抗干扰性和保密性。因此，发展全球定位系统是当今导航技术现代化的一个重要标志。在GPS接收机中，为了得到导航电文并对其进行解算，要完成复杂的信号处理过程。其中，怎样捕获到卫星信号，并对C/A码进行跟踪是研制GPS接收机的重要问题之一。本文在对GPS信号的结构进行深入的分析后，结合FPGA的特点，对算法进行设计及优化后，给出了相应的仿真。内容主要包括以下几个方面： 1.对GPS信号结构的产生原理进行了深入地分析，并对GPS信号的调制机理进行详细地阐述。 2.在GPS信号的捕获方面，采用了基于FFT频域的快速捕获的方法，即将接收到的GPS信号先利用快速傅立叶变换(FFT)变换到频域，在频域完成相应的运算后，再利用傅立叶反变换(IFFT)变换到时域。从而大大减少了计算量，加快了信号捕获的速度，提高了捕获性能。 3.在C/A码跟踪部分，本文采用了非相干延迟锁定环对C/A码进行跟踪。来自载波跟踪环路的本地载波将输入的信号变成基带信号，然后分别和本地码的三个不同相位序列进行相乘，将相乘结果进行累加，经过处理将得到码相位和当前的载波频率送到载波跟踪环路。 4.载波跟踪环，本文采用的是科斯塔斯环。载波跟踪环和码跟踪环在结构上相似，故本文只对关键的载波NCO进行了仿真。 本文的创新点主要是使用FPGA对整个GPS信号的捕获及C/A码的跟踪进行设计。此外，根据FPGA的特点，在不改变外部硬件设计的前提下，改变相应的IP核或相关的VHDL程序就可对系统进行各种优化设计，以适应不同类型的GPS接收机的不同功能。
上传时间： 2013-06-27
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PCB特性阻抗计算工具：用于射频电路，高速数字电路中传输线阻抗的计算
上传时间： 2013-07-02
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安规方面 X电容与Y电容的设计与计算方法
上传时间： 2013-05-31
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主要讲述静电放电、射频辐射电磁场、电快速瞬变脉 冲群、雷击浪涌、由射频场引起的传导干扰、工频磁场、 电压跌落和衰减振荡波等八项抗扰度试验，其中前七项试 验在通用抗扰度标准中已经见到；后一项试验（衰减振荡 波抗扰度试验）则在电力系统设备的抗扰度试验中经常可 以见到。考虑到国内在引进生产家用电器的企业中经常采 用的高频噪声模拟器，本章予以补充介绍。此外，汽车工 业在我国的迅速发展，拉动了与之配套的汽车电子与电器 行业的迅速发展。对后者的质量控制与检测问题便成为业 内人士所关注的一个热点。
上传时间： 2013-05-24
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51单片机定时器时间计算工具，即是计算定时器溢出时间TH0，TL0也是研究51单片机定时器的软件模形。软件中分析了定时器的工作流程和寄存器功能。可以助你更深刻的了解51单片机定时器。
上传时间： 2013-06-13
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