现场可编程门阵列(FPGA)是一种可实现多层次逻辑器件。基于SRAM的FPGA结构由逻辑单元阵列来实现所需要的逻辑函数。FPGA中，互连线资源是预先定制的，这些资源是由各种长度的可分割金属线，缓冲器和．MOS管实现的，所以相对于ASIC中互连线所占用的面积更大。为了节省芯片面积，一般都采用单个MOS晶体管来连接逻辑资源。MOS晶体管的导通电阻可以达到千欧量级，可分割金属线段的电阻相对于MOS管来说是可以忽略的，然而它和地之间的电容达到了0.1pf[1]。为了评估FPGA的性能，用HSPICE仿真模型虽可以获得非常精确的结果，但是基于此模型需要花费太多的时间。这在基于时序驱动的工艺映射和布局布线以及静态时序分析中都是不可行的。于是，非常迫切地需要一种快速而精确的模型。 FPGA中连接盒、开关盒都是由MOS管组成的。FPGA中的时延很大部分取决于互连，而MOS传输晶体管在互连中又占了很大的比重。所以对于MOS管的建模对FPGA时延估算有很大的影响意义。对于MOS管，Muhammad[15]采用导通电阻来代替MOS管，然后用。Elmore[3]时延和Rubinstein[4]时延模型估算互连时延。Elmore时延用电路的一阶矩来近似信号到达最大值50％时的时延，而Rubinstein也是通过计算电路的一阶矩估算时延的上下边界来估算电路的时延，然而他们都是用来计算RC互连时延。传输管是非线性器件，所以没有一个固定的电阻，这就造成了Elmore时延和Rubinstein时延模型的过于近似的估算，对整体评估FPGA的性能带来负面因素。 本论文提出快速而精确的现场可编程门阵列FPGA中的互连资源MOS传输管时延模型。首先从阶跃信号推导出适合50％时延的等效电阻模型，然后在斜坡输入的时候，给出斜坡输入时的时延模型，并且给出等效电容的计算方法。结果验证了我们精确的时延模型在时间上的开销少的性能。 在岛型FPGA中，单个传输管能够被用来作为互连线和互连线之间的连接，或者互连线和管脚之间的连接，如VPR把互连线和管脚作为布线资源，管脚只能单独作为输入或者输出管脚，以致于它们不是一个线网的起点就是线网的终点。而这恰恰忽略了管脚实际在物理上可以作为互连线来使用的情况(VPR认为dogleg现象本身对性能提高不多)。本论文通过对dogleg现象进行了探索，并验证了在使用SUBSET开关盒的情况下，dogleg能提高FPGA的布通率。
上传时间： 2013-07-24
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一、临近空间概况 二、临近空间研究意义及军事应用 三、临近空间现有研究成果 四、临近空间飞行器的研究难点 五、临近空间飞行器在通信领域的研究难点 六、如何来研究在临近空间环境下的载波捕获
上传时间： 2013-08-05
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上帝掷骰子吗——量子物理史话是一本量子物理方面的科普著作。
上传时间： 2013-04-24
上传用户：vvbvvb123
基于探索大学物理电学实验仿真技术的目的，采用Multisim10仿真软件对RC电路时间常数参数进行了仿真实验测试。从RC电路电容充、放电时电容电压uC的表达式出发，分析了uC与时间常数之间的关系，给出了几种Multisim仿真测试时间常数的实验方案。仿真实验可直观形象地描述RC电路的工作过程及有关参数测试。将电路的硬件实验方式向多元化方式转移，利于培养知识综合、知识应用、知识迁移的能力，使电路分析更加灵活和直观。
上传时间： 2013-11-10
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物理科学与电子技术学院实验课表
上传时间： 2013-10-11
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摘要：使用单片机等先进技术对传统的物理实验仪器进行改进。实现了对大量测试数据的采集和对实验数据的处理、保存和显示，并显示测量曲线。利用串行口将多台实验仪器同时与一台PC机通信，将实验数据传送到PC机。关键词：单片机；夫兰克—赫兹实验
上传时间： 2013-10-24
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随着信号速率的不断提升，只对高速信号的发送端物理层测试已经不能够完全反应系统的特性，因此接收机测试也已成为了高速信号的必测项目，尤其是对于信号速率高于5Gbps以上，规范均会规定要求产品必须通过接收机一致性测试。接收端测试的基本原理是测试仪器（通常使用误码分析仪或者信号源和能分析误码的专用协议分析仪来完成）发出特定的码型给被测接收端，接收端在环回（Loopback）模式下再将数据接收、恢复后通过其Tx端发送回测试仪器，由测试仪器完成其发出去的数据和接收到的数据的对比，从而分析出误码的数量。
上传时间： 2013-10-22
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矿用电缆型号意义
上传时间： 2013-11-15
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大学物理实验求校准差很麻烦，我设计了一个程序可以迅速算出标准差！！！
上传时间： 2014-12-31
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上传时间： 2013-10-14
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