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IP核生成器生成ip后有两个文件对我们比较有用，假设生成了一个asyn_fifo的核，则asyn_fifo.veo给出了例化该核方式（或者在Edit－>Language Template->
当前，片上系统(SOC)已成为系统实现的主流技术。流片风险与费用增加、上市时间压力加大、产品功能愈加复杂等因素使得SOC产业逐渐划分为IP提供者、SOC设计服务者和芯片集成者三个层次。SOC设计已走向基于IP集成的平台设计阶段，经过严格验证...
该文档为基于FPGA的TFTLCD控制器IP核的设计总结文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………
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研究了C8051 微控制器IP 软核的参数化设计。首先介绍了指令系统的设计，其次从可重配置的存储器容量、可取舍的并行输入/输出端口、是否产生UART 和定时/计数器模块，以及可重配置的乘法器等