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有极电容

  • 电容应变式压力传感器原理及检测电路设计

    电容应变式压力传感器原理及检测电路设计:论述了电容应变式压力传感器的原理,给出了一种电容应变式压力传感器的电路,并分析了压力大小与电路输出电压之间的关系。关键词:电容传感器;压力;输出电

    标签: 电容 应变式 压力 传感器原理

    上传时间: 2013-06-26

    上传用户:manking0408

  • 有源功率因数校正技术的研究

    本 论文 对 功率因数的定义、有源功率因数校正(APFC)技术做了分析,在比较三 种工作模式的基础上选择了临界导电模式作为本文的研究对象。论文详细分析了临界导 电模式功率因数校正Bost开关变换器的工作原理,稳态特性,得出了开关频率与输入 电压、输入功率的关系,对器件的应力和输出电压纹波进行了详细的分析,为电路的设 计提供了依据。

    标签: 有源功率因数 校正技术

    上传时间: 2013-06-13

    上传用户:banyou

  • 一款基于SRAM的FPGA器件设计

    FPGA是一种可通过用户编程来实现各种数字电路的集成电路器件。用FPGA设计数字系统有设计灵活、低成本,低风险、面市时间短等好处。本课题在结合国际上FPGA器件方面的各种研究成果基础上,对FPGA器件结构进行了深入的探讨,重点对FPGA的互连结构进行了分析与优化。FPGA器件速度和面积上相对于ASIC电路的不足很大程度上是由可编程布线结构造成的,FPGA一般用大量的可编程传输管开关和通用互连线段实现门器件的连接,而全定制电路中仅用简单的金属线实现,传输管开关带来很大的电阻和电容参数,因而速度要慢于后者。这也说明,通过优化可编程连接方式和布线结构,可大大改善电路的性能。本文研究了基于SRAM编程技术的FPGA器件中逻辑模块、互连资源等对FPGA性能和面积的影响。论文中在介绍FPGA器件的体系构架后,首先对开关矩阵进行了研究,结合Wilton开关矩阵和Disioint开关矩阵的特点,得到一个连接更加灵活的开关矩阵,提高了FPGA器件的可布线性,接着本课题中又对通用互连线长度、通用互连线间的连接方式和布线通道的宽度等进行了探讨,并针对本课题中的FPGA器件,得出了一套适合于中小规模逻辑器件的通用互连资源结构,仿真显示新的互连方案有较好的速度和面积性能,在互连资源的面积和性能上达到一个很好的折中。 接下来课题中对FPGA电路的可编程逻辑资源进行了研究,得到了一种逻辑规模适中的粗粒度逻辑块簇,该逻辑块簇采用类似Xilinx 公司的FPGA产品的LUT加触发器结构,使逻辑块簇内部基本逻辑单元的联系更加紧密,提高了逻辑资源的功能和利用率。随后我们还研究了IO模块数目的确定和分布式SRAM结构中编程电路结构的设计,并简单介绍了SRAM单元的晶体管级设计原理。最后,在对FPGA构架研究基础上,完成了一款FPGA电路的设计并设计了相应的电路测试方案,该课题结合CETC58研究所的一个重要项目进行,目前已成功通过CSMC0.6μm 2P2M工艺成功流片,测试结果显示其完全达到了预期的性能。

    标签: SRAM FPGA 器件设计

    上传时间: 2013-04-24

    上传用户:6546544

  • 用FPGA实现8051内核及外设I2C接口

    8051处理器自诞生起近30年来,一直都是嵌入式应用的主流处理器,不同规模的805l处理器涵盖了从低成本到高性能、从低密度到高密度的产品。该处理器极具灵活性,可让开发者自行定义部分指令,量身订制所需的功能模块和外设接口,而且有标准版和经济版等多种版本可供选择,可让设计人员各取所需,实现更高性价比的结构。如此多的优越性使得8051处理器牢固地占据着庞大的应用市场,因此研究和发展8051及与其兼容的接口具有极大的应用前景。在众多8051的外设接口中,I2C总线接口扮演着重要的角色。通用的12C接口器件,如带12C总线的RAM,ROM,AD/DA,LCD驱动器等,越来越多地应用于计算机及自动控制系统中。因此,本论文的根本目的就是针对如何在8051内核上扩展I2C外设接口进行较深入的研究。 本课题项目采用可编程技术来开发805l核以及12C接口。由于8051内核指令集相容,我们能借助在现有架构方面的经验,发挥现有的大量代码和工具的优势,较快地完成设计。在8051核模块里,我们主要实现中央处理器、程序存储器、数据存储器、定时/计数器、并行接口、串行接口和中断系统等七大单元及数据总线、地址总线和控制总线等三大总线,这些都是标准8051核所具有的模块。在其之上我们再嵌入12C的串行通信模块,采用自下而上的方法,逐次实现一位的收发、一个字节的收发、一个命令的收发,直至实现I2C的整个通信协议。 8051核及I2C总线的研究通过可编程逻辑器件和一块外围I2C从设备TMPl01来验证。本课题的最终目的是可编程逻辑器件实现的8051核成功并高效地控制扩展的12C接口与从设备TMPl01通信。 用EP2C35F672C6芯片开发的12C接口,数据的传输速率由该芯片嵌入8051微处理的时钟频率决定。经测试其传输速率可达普通速率和快速速率。 目前集成了该12C接口的8051核已经在工作中投入使用,主要用于POS设备的用户数据加密及对设备温度的实时控制。虽然该设备尚未大批量投产,但它已成功通过PCI(PaymentCardIndustry)协会认证。

    标签: FPGA 8051 I2C 内核

    上传时间: 2013-06-18

    上传用户:731140412

  • 铝电解电容应用指南

    铝电解电容应用指南. 从结构上深入的揭示了世界上主要的铝电解电容型号的性能和应用的最新信息。

    标签: 铝电解电容 应用指南

    上传时间: 2013-07-12

    上传用户:维子哥哥

  • USBasp

    USBasp制作成功,全部资料包括原理图和PCB及驱动安装说明。首次制作过程中发现芯片烧写熔丝位后不工作,以为芯片被锁死,用8M有源晶振不能解锁,因手边没有示波器,所以郁闷了好几个小时,结果是因为晶振的电容容值不对,换成20PF的电容后问题就解决了,制作过程还算顺利的,

    标签: USBasp

    上传时间: 2013-06-24

    上传用户:dialouch

  • 安规X电容与Y电容的计算设计

    安规方面 X电容与Y电容的设计与计算方法

    标签: 安规 X电容 Y电容 计算

    上传时间: 2013-05-31

    上传用户:gjzeus

  • FPGA扩展接口设计和摄像头驱动程序

    当前正处于第三代移动通信技术发展的关键时期,各种与3G相关的无线网络终端的需求量与日俱增。为3G无线网络终端选择一个高性能的处理器,并且提供一套完整的系统解决方案,满足3G时代人们对数据通信业务的需求,无疑是一个有意义且亟待解决的重要问题。 OMAP(Open Multimedia Applications Platform)是美国德州公司(TI)推出的专门为支持第三代(3G)无线终端应用而设计的应用处理器体系结构。OMAP处理器平台堪称无线技术发展的里程碑,它提供了语音、数据和多媒体所需的带宽和功能,可以极低的功耗为高端3G无线设备提供极佳的性能。 本文的研究内容是开发基于OMAP5910处理器的具有多个扩展接口的嵌入式开发平台,以及摄像头显示驱动程序,以便能为3G相关的无线网络终端提供一个系统级的解决方案,本文首先介绍了OMAP技术的特点和优点,并对OMAP5910处理器的硬件结构进行了简单说明,在此基础上提出了基于OMAP5910嵌入式平台的FPGA设计,包括用FPGA扩展的接口:触摸屏接口,硬盘接口,以太网接口;控制的接口:USB口,串口;以及实现的功能:与OMAP5910处理器的通信功能,中断控制功能,选择启动顺序功能,复位延时功能。然后介绍了基于OMAP5910的摄像显示系统的硬件设计,主要包括摄像头接口和摄像头模块,EMIFS和EMIFF接口以及LCD接口。最后描述了嵌入式Linux操作系统下摄像头驱动程序的完整实现过程。

    标签: FPGA 扩展 接口设计 摄像头

    上传时间: 2013-05-24

    上传用户:mfhe2005

  • 基于AD_的电容触摸按键电路设计

    基于AD转换的电容触摸技术及触摸按键电路设计

    标签: AD 电容 触摸按键 电路设计

    上传时间: 2013-06-10

    上传用户:cursor

  • FPGA布线算法的研究

    现场可编程门阵列(FPGA)是一种可实现多层次逻辑器件。基于SRAM的FPGA结构由逻辑单元阵列来实现所需要的逻辑函数。FPGA中,互连线资源是预先定制的,这些资源是由各种长度的可分割金属线,缓冲器和.MOS管实现的,所以相对于ASIC中互连线所占用的面积更大。为了节省芯片面积,一般都采用单个MOS晶体管来连接逻辑资源。MOS晶体管的导通电阻可以达到千欧量级,可分割金属线段的电阻相对于MOS管来说是可以忽略的,然而它和地之间的电容达到了0.1pf[1]。为了评估FPGA的性能,用HSPICE仿真模型虽可以获得非常精确的结果,但是基于此模型需要花费太多的时间。这在基于时序驱动的工艺映射和布局布线以及静态时序分析中都是不可行的。于是,非常迫切地需要一种快速而精确的模型。 FPGA中连接盒、开关盒都是由MOS管组成的。FPGA中的时延很大部分取决于互连,而MOS传输晶体管在互连中又占了很大的比重。所以对于MOS管的建模对FPGA时延估算有很大的影响意义。对于MOS管,Muhammad[15]采用导通电阻来代替MOS管,然后用。Elmore[3]时延和Rubinstein[4]时延模型估算互连时延。Elmore时延用电路的一阶矩来近似信号到达最大值50%时的时延,而Rubinstein也是通过计算电路的一阶矩估算时延的上下边界来估算电路的时延,然而他们都是用来计算RC互连时延。传输管是非线性器件,所以没有一个固定的电阻,这就造成了Elmore时延和Rubinstein时延模型的过于近似的估算,对整体评估FPGA的性能带来负面因素。 本论文提出快速而精确的现场可编程门阵列FPGA中的互连资源MOS传输管时延模型。首先从阶跃信号推导出适合50%时延的等效电阻模型,然后在斜坡输入的时候,给出斜坡输入时的时延模型,并且给出等效电容的计算方法。结果验证了我们精确的时延模型在时间上的开销少的性能。 在岛型FPGA中,单个传输管能够被用来作为互连线和互连线之间的连接,或者互连线和管脚之间的连接,如VPR把互连线和管脚作为布线资源,管脚只能单独作为输入或者输出管脚,以致于它们不是一个线网的起点就是线网的终点。而这恰恰忽略了管脚实际在物理上可以作为互连线来使用的情况(VPR认为dogleg现象本身对性能提高不多)。本论文通过对dogleg现象进行了探索,并验证了在使用SUBSET开关盒的情况下,dogleg能提高FPGA的布通率。

    标签: FPGA 布线 法的研究

    上传时间: 2013-07-24

    上传用户:yezhihao