时钟速率
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用于高速AD的低抖动时钟稳定电路
介绍了一种用于高速ADC 的低抖动时钟稳定电路。这个电路由延迟锁相环(DLL)来实现。这个DLL 有两个功能：一是通过把一个时钟沿固定精确延迟半个周期，再与另一个沿组成一个新的时钟来调节时钟占
2023-10-25
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频率测量和周期测量的基本方法是采用以固定时钟作为参考时钟
频率测量和周期测量的基本方法是采用以固定时钟作为参考时钟，分别测量单个周期的计数为周期，单位时间的计数为频率。但是由于被测信号的频率不同，测量精度会发生变化，采用低频测量周期，高频测量频率，然后分别求倒数，便可得到对应的频率和周期
2013-12-23
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PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定
PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上； 顶层文件是P...
2017-07-24
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sbit DS1302_CLK = P3^4 //实时时钟时钟线引脚 sbit DS1302_IO = P3^3 //实时时钟数据线引
sbit DS1302_CLK = P3^4 //实时时钟时钟线引脚 sbit DS1302_IO = P3^3 //实时时钟数据线引脚 sbit DS1302_RST...
2017-08-18
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