VHDL语言编写的时钟显示代码
VHDL语言编写的时钟显示代码,简短而又易懂,个人觉得很不错...
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FPGA异步时钟设计中的同步策略,需要...
通过fpga产生时钟的VHDL源码,QII7.1下调试通过...
附件中资料时模拟时钟方面的信息,可用单片机仿真软件仿真。...
基于FPGA的新型数据位同步时钟提取(CDR)实现方法...
FPGA的时钟详细讲解,可以让你更加熟悉的了解FPGA的时钟设计。...
FPGA时钟分析,包括门控时钟与时钟偏仪分析,逻辑设计时钟分析,毛刺分析....
fpga/CPLD开发管理Digit-Serial DSP Functions...
CPLD/FPGA设计中的时钟应用讲解 及其实例...
采用MaxPlusII写的一个小时钟程序,也是供初学参考。呵呵。注///版主,开发环境里面没有MaxPlusII....