时钟协调
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用verilong编写的lcd显示可调数字时钟
一套基于Verilog的LCD显示可调数字时钟源代码。适用于FPGA开发，支持时间调节功能，适合电子工程和嵌入式系统学习者及开发者使用。
2025-12-20
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sbit DS1302_CLK = P3^4 //实时时钟时钟线引脚 sbit DS1302_IO = P3^3 //实时时钟数据线引
sbit DS1302_CLK = P3^4 //实时时钟时钟线引脚 sbit DS1302_IO = P3^3 //实时时钟数据线引脚 sbit DS1302_RST...
2017-08-18
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实时时钟设计
基于STC89C51单片机设计的8位共阴数码管（可以用两个四位的代替）显示的实时时钟电路设计，包含有源程序以及Proteus仿真图，完全可行，支持大家多多下载。
2013-11-13
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