时序收敛
时序收敛（英语：Timingclosure）是现场可编程逻辑门阵列、专用集成电路等集成电路设计过程中，调整、修改设计，从而使得所设计的电路满足时序要求的过程。
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设计倒计时时钟 倒计时：当程序运行时，从59秒递减，以实现倒计时。该实验使用了8253A，8259A，数码管等，以了解这些芯片结合后的硬件设计和软件编程的方法
2017-02-01
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