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新思

  • SuperJack DG-120+Ku极轴座的新功能

    Ku极轴座的新功能

    标签: SuperJack 120 DG Ku

    上传时间: 2013-12-22

    上传用户:jisiwole

  • 飞思卡尔智能车的舵机测试程序

    飞思卡尔智能车的舵机测试程序 #include <hidef.h>      /* common defines and macros */#include <MC9S12XS128.h>     /* derivative information */#pragma LINK_INFO DERIVATIVE "mc9s12xs128" void SetBusCLK_16M(void)             {       CLKSEL=0X00;        PLLCTL_PLLON=1;          //锁相环电路允许位    SYNR=0x00 | 0x01;        //SYNR=1    REFDV=0x80 | 0x01;          POSTDIV=0x00;            _asm(nop);              _asm(nop);    while(!(CRGFLG_LOCK==1));       CLKSEL_PLLSEL =1;          } void PWM_01(void) {     //舵机初始化   PWMCTL_CON01=1;    //0和1联合成16位PWM;    PWMCAE_CAE1=0;    //选择输出模式为左对齐输出模式    PWMCNT01 = 0;     //计数器清零;    PWMPOL_PPOL1=1;    //先输出高电平,计数到DTY时,反转电平    PWMPRCLK = 0X40;    //clockA 不分频,clockA=busclock=16MHz;CLK B 16分频:1Mhz     PWMSCLA = 0x08;    //对clock SA 16分频,pwm clock=clockA/16=1MHz;         PWMCLK_PCLK1 = 1;   //选择clock SA做时钟源    PWMPER01 = 20000;   //周期20ms; 50Hz;    PWMDTY01 = 1500;   //高电平时间为1.5ms;     PWME_PWME1 = 1;   

    标签: 飞思卡尔智能车 舵机 测试程序

    上传时间: 2013-11-04

    上传用户:狗日的日子

  • Xilinx UltraScale:为您未来架构而打造的新一代架构

      Xilinx UltraScale™ 架构针对要求最严苛的应用,提供了前所未有的ASIC级的系统级集成和容量。    UltraScale架构是业界首次在All Programmable架构中应用最先进的ASIC架构优化。该架构能从20nm平面FET结构扩展至16nm鳍式FET晶体管技术甚至更高的技术,同 时还能从单芯片扩展到3D IC。借助Xilinx Vivado®设计套件的分析型协同优化,UltraScale架构可以提供海量数据的路由功能,同时还能智能地解决先进工艺节点上的头号系统性能瓶颈。 这种协同设计可以在不降低性能的前提下达到实现超过90%的利用率。   UltraScale架构的突破包括:   • 几乎可以在晶片的任何位置战略性地布置类似于ASIC的系统时钟,从而将时钟歪斜降低达50%   • 系统架构中有大量并行总线,无需再使用会造成时延的流水线,从而可提高系统速度和容量   • 甚至在要求资源利用率达到90%及以上的系统中,也能消除潜在的时序收敛问题和互连瓶颈   • 可凭借3D IC集成能力构建更大型器件,并在工艺技术方面领先当前行业标准整整一代   • 能在更低的系统功耗预算范围内显著提高系统性能,包括多Gb串行收发器、I/O以及存储器带宽   • 显著增强DSP与包处理性能   赛灵思UltraScale架构为超大容量解决方案设计人员开启了一个全新的领域。

    标签: UltraScale Xilinx 架构

    上传时间: 2013-12-23

    上传用户:小儒尼尼奥

  • Cadence_16.6_OrCAD_Capture_CIS_新功能 连载(三)

    又到了该写些文档的时候了。以后我会每周更新新版本中的新功能以及使用小技巧的文档。希望大家拍砖。^_^

    标签: OrCAD_Capture_CIS Cadence 16.6 新功能

    上传时间: 2015-01-01

    上传用户:咔乐坞

  • 赛灵思spartan6系列FPGA片内资源设计指导

    赛灵思spartan6系列FPGA片内资源设计指导

    标签: spartan6 FPGA 赛灵思 资源

    上传时间: 2013-10-16

    上传用户:wang0123456789

  • 飞思卡尔的PCB布局布线应用笔记,很值得学习的

    飞思卡尔的PCB布局布线应用笔记,很值得学习的

    标签: PCB 飞思卡尔 布局布线 应用笔记

    上传时间: 2013-10-21

    上传用户:aa7821634

  • 全新赛灵思(Xilinx)FPGA 7系列芯片精彩剖析

        全新赛灵思(Xilinx)FPGA 7系列芯片精彩剖析:赛灵思的最新7系列FPGA芯片包括3个子系列,Artix-7、 Kintex-7和Virtex-7。在介绍芯片之前,先看看三个子系列芯片的介绍表,如下表1所示:   表1 全新Xilinx FPGA 7系列子系列介绍表   (1) Artix-7 FPGA系列——业界最低功耗和最低成本   通过表1我们不难得出以下结论: 与上一代 FPGA相比,其功耗降低了50%,成本削减了35%,性能提高30%,占用面积缩减了50%,赛灵思FPGA芯片在升级中,功耗和性能平衡得非常好。

    标签: Xilinx FPGA 赛灵思 系列芯片

    上传时间: 2013-12-20

    上传用户:dongbaobao

  • 赛灵思Artix-7 FPGA 数据手册:直流及开关特性

      本文是关于赛灵思Artix-7 FPGA 数据手册:直流及开关特性的详细介绍。   文章中也讨论了以下问题:   1.全新 Artix-7 FPGA 系列有哪些主要功能和特性?   Artix-7 系列提供了业界最低功耗、最低成本的 FPGA,采用了小型封装,配合Virtex 架构增强技术,能满足小型化产品的批量市场需求,这也正是此前 Spartan 系列 FPGA 所针对的市场领域。与 Spartan-6 FPGA 相比,Artix-7 器件的逻辑密度从 20K 到 355K 不等,不但使速度提升 30%,功耗减半,尺寸减小 50%,而且价格也降了 35%。   2.Artix-7 FPGA 系列支持哪些类型的应用和终端市场?   Artix-7 FPGA 系列面向各种低成本、小型化以及低功耗的应用,包括如便携式超声波医疗设备、军用通信系统、高端专业/消费类相机的 DSLR 镜头模块,以及航空视频分配系统等。

    标签: Artix FPGA 赛灵思 数据手册

    上传时间: 2013-11-12

    上传用户:songyue1991

  • 赛灵思FPGA芯片架构分析

    赛灵思FPGA芯片论文,值得一看。

    标签: FPGA 赛灵思 芯片架构

    上传时间: 2015-01-02

    上传用户:ljt101007

  • 赛灵思ZYNQ-7000EPP系列开辟新型器件先河

    赛灵思ZYNQ-7000EPP系列开辟新型器件先河

    标签: ZYNQ 7000 EPP 赛灵思

    上传时间: 2013-10-17

    上传用户:wangzhen1990