随着各种非线性电力电子设备的大量应用，电网中的谐波污染日益严重。为了保证电力系统的安全经济运行，保证电气设备和用电人员的安全，治理电磁环境污染、维护绿色环境，研究实时、准确的电力谐波分析系统，对电网中的谐波进行实时检测、分析和监控，都具有重要的理论和工程实际意义。 目前实际应用的电力谐波分析系统大多是以单片机为核心组成。单片机运行速度慢，实时性较差，不能满足实际应用中对系统实时性越来越高的要求。另外，单片机的地址线和数据线位数较少，这使得由单片机构成的电力谐波分析系统外围电路庞大，系统的可靠性和可维护性上都大打折扣。 本文首先研究了电力谐波的产生，危害及国内外研究现状，对电力谐波检测中常用的各种算法进行分析和比较；然后介绍了FPGA芯片的特性和SOPC系统的特点，并分析比较了传统测量谐波装置和基于FPGA的新型谐波测量仪器的特性。综述了可编程元器件的发展过程、主要工艺发展及目前的应用情况。 然后，对整个谐波处理器系统的框架及结构进行描述，包括系统的功能结构分配，外围硬件电路的结构及软件设计流程。其后，针对系统外围硬件电路、FFTIP核设计和SOPC系统的组建，进行详细的分析与设计。系统采用NiosⅡ处理器核和FFT运算协处理器相结合的结构。FFT运算用专门的FFT运算协处理器核完成，使得系统克服的单片机系统实时性差和速度慢的缺点。FFTIP核采用现在ASIC领域的一种主流硬件描述语言VHDL进行编写，采用顺序的处理结构和IEEE浮点标准运算，具有系统简单、占用硬件资源少和高运算精度的优点。谐波分析仪系统组建采用SOPC系统。SOPC系统具有可对硬件剪裁和添加的特点，使得系统的更简单，应用面更广，专用性更强的优点。最后，给出了对系统中各模块进行仿真及系统生成的结果。
上传时间： 2013-04-24
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8051系列是至今为止最成功的单片机之一，在FPGA平台上研究带硬件浮点运算器的8051是对其在SoC及专用化的方向上的一次迈进。文章首先介绍了8051的基本架构，包括硬件模块、指令系统、内存分配以及基本外设。然后讲解了在设计8051时如何划分模块，每个模块的功能与设计，同时也介绍了如何设计流水线来加速8051的处理速度。对于浮点运算器，文章介绍了IEEE浮点数的表示方法，包括各种特殊值的表示方法以及作用。在探讨浮点运算器设计的时候首先是给出了模块的划分及其实现的功能，然后以生动的实例介绍了加减乘除四种浮点运算的算法。在介绍完8051与浮点运算器设计以后，文章介绍了如何将浮点运算器集成到8051上，包括硬件上的数据线接口和控制线接口，以及软件中如何运用硬件浮点运算器。最后文章给出了此设计在ModelSim上的仿真结果以及在CyclonelIFPGA芯片上的验证过程，可以清楚地看到，与KeilC51软件库的浮点运算相比，加法运算从186个时钟周期减少到4个时钟周期，减法运算从200个时钟周期减少到4个时钟周期，乘法运算从241个时钟周期减少到4个时钟周期，而除法则由原来的¨lO个时钟周期减少到4个时钟周期，可见硬件浮点运算器使8051在运算能力上有了质的提高。 笔者也在“Google”和“百度”搜索引擎上，以及“维普数据论文网’’上搜索过，都没有发现有类似的设计，带硬件浮点运算器的8051可谓是一次创新，希望在实际应用中能有用武之地。
上传时间： 2013-04-24
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Altera大部分主流的器件选型手册，包括编程芯片、数据线、开发板的介绍等。
上传时间： 2013-07-23
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用于FPGA向DSP传送数据的接口，在硬件上实现需要FPGA的IO口与DSP的地址数据线互连
上传时间： 2013-08-24
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Hyperlynx仿真应用:阻抗匹配.下面以一个电路设计为例，简单介绍一下PCB仿真软件在设计中的使用。下面是一个DSP硬件电路部分元件位置关系(原理图和PCB使用PROTEL99SE设计)，其中DRAM作为DSP的扩展Memory(64位宽度，低8bit还经过3245接到FLASH和其它芯片)，DRAM时钟频率133M。因为频率较高，设计过程中我们需要考虑DRAM的数据、地址和控制线是否需加串阻。下面，我们以数据线D0仿真为例看是否需要加串阻。模型建立首先需要在元件公司网站下载各器件IBIS模型。然后打开Hyperlynx,新建LineSim File(线路仿真—主要用于PCB前仿真验证)新建好的线路仿真文件里可以看到一些虚线勾出的传输线、芯片脚、始端串阻和上下拉终端匹配电阻等。下面，我们开始导入主芯片DSP的数据线D0脚模型。左键点芯片管脚处的标志，出现未知管脚，然后再按下图的红线所示线路选取芯片IBIS模型中的对应管脚。 3http://bbs.elecfans.com/ 电子技术论坛 http://www.elecfans.com 电子发烧友点OK后退到“ASSIGN Models”界面。选管脚为“Output”类型。这样，一样管脚的配置就完成了。同样将DRAM的数据线对应管脚和3245的对应管脚IBIS模型加上(DSP输出，3245高阻，DRAM输入)。下面我们开始建立传输线模型。左键点DSP芯片脚相连的传输线，增添传输线，然后右键编辑属性。因为我们使用四层板，在表层走线，所以要选用“Microstrip”，然后点“Value”进行属性编辑。这里，我们要编辑一些PCB的属性，布线长度、宽度和层间距等，属性编辑界面如下：再将其它传输线也添加上。这就是没有加阻抗匹配的仿真模型(PCB最远直线间距1.4inch，对线长为1.7inch)。现在模型就建立好了。仿真及分析下面我们就要为各点加示波器探头了，按照下图红线所示路径为各测试点增加探头：为发现更多的信息，我们使用眼图观察。因为时钟是133M，数据单沿采样，数据翻转最高频率为66.7M，对应位宽为7.58ns。所以设置参数如下：之后按照芯片手册制作眼图模板。因为我们最关心的是接收端(DRAM)信号，所以模板也按照DRAM芯片HY57V283220手册的输入需求设计。芯片手册中要求输入高电平VIH高于2.0V，输入低电平VIL低于0.8V。DRAM芯片的一个NOTE里指出，芯片可以承受最高5.6V，最低-2.0V信号(不长于3ns)：按下边红线路径配置眼图模板：低8位数据线没有串阻可以满足设计要求，而其他的56位都是一对一，经过仿真没有串阻也能通过。于是数据线不加串阻可以满足设计要求，但有一点需注意，就是写数据时因为存在回冲，DRAM接收高电平在位中间会回冲到2V。因此会导致电平判决裕量较小，抗干扰能力差一些，如果调试过程中发现写RAM会出错，还需要改版加串阻。
上传时间： 2013-11-05
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I2C总线器件在高抗干扰系统中的应用: 摘要：本文先对I2C总线协议进行了简要叙述，然后介绍了一些常用的抗干扰措施，最后提供了一个利用I2C总线器件24WC01组成的高抗干扰应用方案。 一、I2C总线概述 I2C总线是一双线串行总线，它提供一小型网络系统为总线上的电路共享公共的总线。总线上的器件有单片机LCD驱动器以及E2PROM器等。型号有：PCF8566T、SAA1064T、24WC01等。 两根双向线中，一根是串行数据线（SDA），另一根是串行时钟线（SCL）。总线和器件间的数据传送均由这根线完成。每一个器件都有一个唯一的地址，以区别总线上的其它器件。当执行数据传送时，谁是主器件，谁是从器件详见表1。主器件是启动数据发送并产生时钟信号的器件。被寻址的任何器件都可看作从器件。I2C总线是多主机总线，意思是可以两个或更多的能够控制总线的器件与总线连接。
上传时间： 2013-11-05
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上传时间： 2013-10-19
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iPhone的充电器其实也没有什么特别，就是需要数据线也要有电压识别，不能只提供一个5v，否则不能充电，也就是为什么其他的手机可以充电的板子，为什么iPhone不能充的原因
上传时间： 2013-10-26
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在同轴电缆传输中即传输信号又传输电源，最早运用于有线电视系统。在国内，已经有十多年历史。而如今把有线电视技术转移到监控领域已经数年，但却很少有人把电源的传输技术同时转移过来。虽然我们曾反复倡议此技术在共缆监控领域的推广，但却还是有不少安防行业的朋友表示质疑甚至反对。而如今在监控系统中的电源线和数据线已经是一项不可忽略的开销（每公里距离两种线大约需要花费6000多元左右）。它应该引起业界的再度关注。
上传时间： 2013-11-21
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设计了基于MCS-51单片机的大容量（超64KB）数据存储器的扩展方案，采用具有19根地址线的大容量Flash芯片F29C51004作为扩展存储体。将数据线和地址线合并使用，对F29C51004进行分页访问，解决了单片机存储单元及端口不足的问题，释放了I／O口。文中以扩展8MB的数据存储器为例，给出了...
上传时间： 2013-11-19
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