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标签： 虚拟打印机
上传时间： 2022-02-20
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电子版PDF: Saber电路仿真及开关电源设计文件太大，分四次上传，请全部下载完解压Saber电路仿真及开关电源设计.part1.rar https://dl.21ic.com/download/saber-445055.html Saber电路仿真及开关电源设计.part2.rar https://dl.21ic.com/download/saber-445056.html Saber电路仿真及开关电源设计.part3.rar https://dl.21ic.com/download/saber-445057.html Saber电路仿真及开关电源设计.part4.rar https://dl.21ic.com/download/saber-445058.html
上传时间： 2022-03-16
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上传时间： 2022-03-16
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我们在完成 PCB 的设计后，要把设计文件转换成光绘文件，一方面利于文档保密，另一方面方便 PCB 厂家生产。 下面以一个 6 层板为例， 规范一下 Gerber文件输出的步骤和详细设置。 采用图文并茂的方式，详细介绍了Altium Designer如何生成Gerber、钻孔文件、坐标文件。
上传时间： 2022-03-24
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74LS373 HUB接口板 PROTEL 99SE 原理图+PCB+封装库文件,多年前设计文件，可以做为你的设计参考。
标签： 74ls373 hub 接口 protel 99se 原理图 pcb 封装 文件
上传时间： 2022-05-13
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Vivado设计分为Project Mode和Non-project Mode两种模式，一般简单设计中，我们常用的是Project Mode。在本手册中，我们将以一个简单的实验案例，一步一步的完成Vivado的整个设计流程一、新建工程1、打开Vivado 2013.4开发工具，可通过桌面快捷方式或开始菜单中xilinx DesignTools-Vivado 2013.4下的Vivado 2013.4打开软件，开启后，软件如下所示：2、单击上述界面中Create New Project图标，弹出新建工程向导，点击Next.3、输入工程名称、选择工程存储路径，并勾选Create project subdirectory选项，为工程在指定存储路径下建立独立的文件夹。设置完成后，点击Next注意：工程名称和存储路径中不能出现中文和空格，建议工程名称以字母、数字、下划线来组成。4、选择RTL Project一项，并勾选Do not specifty sources at this time，勾选该选项是为了跳过在新建工程的过程中添加设计源文件。点击Next.IA5、根据使用的FPGA开发平台，选择对应的FPGA目标器件。（在本手册中，以xilinx官方开发板KC705为例，Nexys4开发板请选择Artix-7 XC7A100TCSG324-2的器件，即Family和Subfamily均为Artix-7，封装形式（Package）为cSG324，速度等级（Speed grade）为-1，温度等级（Temp Grade）为C）。点击Next6、确认相关信息与设计所用的的FPGA器件信息是否一致，一致请点击Finish，不一致，请返回上一步修改。二、设计文件输入1、如下图所示，点击Flow Navigator下的Project Manager->Add Sources或中间Sources中的对话框打开设计文件导入添加对话框。2、选择第二项Add or Create Design Sources，用来添加或新建Verilog或VHDL源文件，点击Next
标签： vivado
上传时间： 2022-05-28
上传用户：默默
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标签： python
上传时间： 2022-06-06
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标签： pcb
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