基于FPGA的数字锁相环的研究与实现
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采用用verilog语言编写的全数字锁相环的源代码,适合感兴趣的学习者学习,可以提高自己的能力,大家可以多交流哈...
很好的全数字锁相环源程序,大家有需要的可以看看...
在过去的十几年间,FPGA取得了惊人的发展:集成度已达到1000万等效门、速度可达到400~500MHz。随着FPGA的集成度不断增大,在高密度FPGA中,芯片上时钟的分布质量就变得越来越重要。时钟延时和时钟相位偏移已成为影响系统性能的重要因素。现在,解决时钟延时问题主要使用时钟延时补偿电路。 为了...