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VHDL设计的数字时钟,有闹钟、整点报时等功能...
👤 zhouli
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设计IIR数字陷波器,采样率为6.4kHz,陷波频率点为50Hz、150Hz、250Hz;c1.mat为输入数据文件;并且包括陷波前后的频谱分析。...
👤 silenthink
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数字时钟的设计报告,包括简介和源代码在里边呢...
👤 hfmm633
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数字钟的设计,有时,分,秒,置数等功能。...
👤 qazxsw
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大型数字系统设计中,vhdl中从算法到硬线逻辑实现的教程...
👤 yuanyuan123
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