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本人写的数字锁相环,有模拟数据,学习锁相环很好的材料。参考书“数字锁相环路原理与应用”编写。
FPGA实现全数字锁相环,利用硬件描述评议verilog HDL,顶层文件DPLL.V
用FPGA实现数字锁相环,开发环境为ISE
16位高速数字相关器,简单易学,十分适合初学者使用
数字水印的相关知识,比较详细,初学者可以看。
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