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FPGA/CPLD数字电路设计经验分享，有助于设计能力提高...

📅 2013-08-17

FPGA/CPLD数字电路设计经验分享。大唐公司的！...

📅 2013-08-17

在数字电路的设计中，时序设计是一个系统性能的主要标志，在高层次设计方法中，对时序控制的抽象度也相应提高，因此在设计中较难把握，但在理解RTL电路时序模型的基础上，采用合理的设计方法在设计复杂数字系统是...

📅 2013-08-18

CPLD数字电路设计——使用MAX+plusⅡ入门篇.rar 不能错过的书籍...

📅 2013-08-22

基于VHDL语言智力抢答器的设计本人的课程设计...

📅 2013-08-27

关键词：FPGA 数字电路时序时延路径建立时间保持时间...

📅 2013-08-31

摘要本文介绍了一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法，详细分析了设计原理并给出了相应的仿真结果．这种设计方法已在我们研制的GPS，GLONASS兼容机中得到实际应用。...

📅 2013-09-01

CPLD数字电路设计硬件描述语言一例+一本经典教材，入门专用...

📅 2013-09-04

数字电路仿真，数字电路课程设计，proteus仿真，详细电路图...

📅 2013-09-25

高速数字电路测试技术...

📅 2013-11-17

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