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Verilog实现的DDS正弦信号发生器和测频测相模块，DDS模块可产生两路频率和相位差均可预置调整的值正弦波，频率范围为20Hz-5MHz，相位范围为0°-359°，测量的数据通过引脚传输给单片机，单片机进行计算和显示。...

📅 2013-08-28 👤 asdfasdfd

Verilog DDS 正弦信号发生器模块

数据采集基于DSP和FPGA的高精度数据采集卡设计...

📅 2013-08-29 👤 2728460838

FPGA DSP 高精度数据采集卡

是关于对数据采集卡的基于PC104总线的读写程序，开发环境Quarters , 用VHDL语言编写。...

📅 2013-08-29 👤 qw12

104 PC 数据采集卡总线

fpga cpld 常见模块设计，包括基于fpga 的全数字锁向环，基于fpga cpld 的半整数分频器的设计等，很有用...

📅 2013-08-30 👤 mhp0114

fpga cpld 模块设计

一个好程序关于CPLD的直线插补在数字积分中的应用...

📅 2013-08-31 👤 lixqiang

CPLD 程序直线数字

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