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VHDL语言描述,时钟分频,给定CPLD试验板系统时钟设置50M,但由于本作品的需要,我们将系统时钟经过20分频得到DS18B20所需的工作时钟,大约为1.25M。

2014-12-06 25 描述

ABEL硬件描述语言概述:是一种层次化的硬件描述语言,它支持多种行为级输入形式,其中包括逻辑方程式、状态图和真值表等。

2023-04-01 7 描述

硬件描述语言,对学习EDA的人,特别是初学者都有很大的参考价值。

2015-04-05 79 描述