专辑类-可编程逻辑器件相关专辑-96册-1.77G -可编程序控制器原理及应用系统设计技术-236页-10.9M.pdf
上传时间： 2013-07-24
上传用户：lingzhichao
专辑类-单片机专辑-258册-4.20G 时间触发嵌入式系统设计模式-8051系列微控制器应用-783页-26.8M.pdf
上传时间： 2013-04-24
上传用户：czl10052678
开发板上已经调试过的电梯控制器程序设计与仿真
上传时间： 2013-06-13
上传用户：Neal917
选相控制开关又称同步开关或相控开关，其实质就是控制开关在电压或电流的期望相位完成合闸或分闸，以主动消除开关过程所产生的涌流和过电压等电磁暂态效应，提高开关的开断能力。本论文首先分析了提高断路器可靠性的途径，介绍了相控开关的研究意义及其优点；相控开关的基本原理和分合闸操作过程，为同步开关选相控制器的设计提供了理论依据。 永磁操动机构是近几年正在发展的一种新型操动机构，它利用永久磁铁产生的磁力将真空断路器保持在分合闸位置，而无需任何传统机械脱扣锁扣装置。它机构零部件少，结构简单，使断路器动作的可靠性大大提高。二次控制回路采用电子控制模块，动作迅速并可以实现精确时间控制，采用开关电源输入范围宽，输入输出用光耦隔离，功耗低，极大地提高了可靠性，使永磁机构真空断路器成为真正意义的免维护智能化断路器。单线圈永磁机构结构简单、体积小，在中压领域得到越来越广泛的应用。相控真空开关采用三相独立操动的单线圈永磁机构，其操作电源为由大功率电力电子器件控制的储能大容量电容器，通过多次的测试结果表明单线圈永磁机构能很好地满足相控开关的要求，是相控开关的理想选择。 本文详细介绍了以Mega16为控制核心的单线圈永磁机构智能控制器，这种控制系统集保护、控制、开关量监测等功能于一体。可实现对电容电压实时显示，具有过电流速断保护、过电压和欠电压保护、闭锁以及报警等功能。 通过相关试验测试，表明本系统已经初步达到了设计所要达到的预期效果，为以后的研究以及同步控制系统的完善和优化提供了有益的经验和参考。
上传时间： 2013-07-02
上传用户：一诺88
目前，能源危机与环境污染已经备受关注，被各个国家提上纪事日程。在众多的新能源中，风能以它可再生、清洁、无污染等特点受到人们的青睐。在风力发电技术上也从独立型逐渐向并网型转变，因此并网技术已成为主流。由于变速恒频具有发电量大，对风电场风速的变化适应性好具有较高的叶尖速比等优点，所以变速恒频必然会取代恒速恒频。实现变速恒频的风力发电机组有很多种，其中永磁同步直驱式风力发电机由于不需要齿轮箱，因而改善风能转换效率，减小维护，降低了噪音，提高可靠性，本文以永磁同步直驱式发电系统为研究对象。 本文针对永磁同步直驱式发电双PWM变换器系统，首先在对变速恒频理论研究的基础上，对风力机的数学模型进行了分析，完成了对风力机的最大风力跟踪模拟仿真。由于发电机发出的电随着风速的不断变化，因此就靠控制变换器来实现恒压恒频的电压并送入电网。其次在对永磁同步发电机和变换器的数学模型研究的基础上提出了对整流侧和电网侧变换器分开控制，控制整流器来控制发电机的转速，控制逆变器来实现稳压和恒频的向电网输送电压。并对逆变器侧的直流电容和电感选值给出了范围，在这些理论基础上对逆变器进行了MATLAB/SIMULINK仿真，给出了仿真结果。在前面理论分析的基础上，针对逆变器部分做了硬件和软件的设计。选用智能功率模块(IPM)作为逆变器，采用霍尔电压、电流传感器实现了对电压电流的采样，控制器选用TMS320F2407A，并制作了对采样信号处理电路板、PWM信号处理电路板和传感器电路板，编写了程序。
上传时间： 2013-06-17
上传用户：youlongjian0
随着计算机网络与嵌入式控制技术的迅速发展，作为传统运输行业的铁路系统对此也有了新的要求，列车通信网络应运而生。经过多年的发展，国际电工委员会(IEC)为了规范列车通信网络，于1999年通过了IEC61375-1标准。该标准将列车通信网络分为两条总线：绞线式列车总线(WTB)和多功能车辆总线(MVB)。MVB是一个标准通信介质，为挂在其上的设备传输和交换数据。而多功能车辆总线控制器(MVBC)是MVB与MVB实际物理层之间的接口，其主要实现MVB数据链路层的功能。由于该项关键技术仍被国外公司垄断，因此开发具有自主知识产权的MVBC迫在眉睫。 鉴于上述原因，本文深入研究了IEC61375-1标准。根据MVBC的技术特点，本文提出了使用FPGA来实现其具体功能的方案。挂在MVB总线上的设备分为五类，他们的功能各不相同。而支持4类设备的MVBC具有设备状态、过程数据、消息数据通信和总线管理功能，并且兼容2类和3类设备。本文的目的就是用FPGA实现支持4类设备的MVBC。 本文采用自顶向下的设计方法。整个MVBC主要划分为：编码模块、译码模块、冗余控制模块、报文分析单元、通信存储控制器、主控制单元、地址逻辑模块。在整个开发流程中，使用Xilinx的ISE集成开发环境。使用Verilog HDL硬件描述语言对上述各个模块进行RTL级描述，并用Synplify Pro进行综合。最后，在ModelSim中对各个模块进行了布线后仿真和验证。 在实验室条件下，通过严格的仿真验证后，其结果证明了本文设计的模块达到了IEC61375-1标准的要求。因此，用FPGA实现MVBC这一方案具有可操作性。 关键词：列车通信网；多功能车辆总线；多功能车辆总线控制器；现场可编程门阵列
上传时间： 2013-07-18
上传用户：wxhwjf
随着计算机及其外围设备的发展，传统的并行接口和串行接口在灵活性和接口扩展等方面存在的缺陷愈来愈不可回避，并逐渐成为计算机通信的瓶颈。在这种情况下，通用串行总线(Universal Serial Bus，USB)诞生了。USB由于具有传输速率高、价格便宜、使用方便、灵活性高、支持热插拔、接口标准化和易于扩展等优点，目前已经成为计算机外设接口的主流技术，在计算机外围设备和消费类电子领域正获得越来越多的应用。 @@ 本文基于USB2．0协议规范，设计了一款支持高速和全速传输的USB2．0设备控制器IP核。文中着重介绍了这款设备控制器IP核的设计和FPGA验证工作，详细研究并分析了USB2．0规范，根据规范提出了一种USB2．0设备控制器整体构架方案，描述了各个功能子模块硬件电路的功能及实现。从可重用的角度出发，对设备控制器模块进行优化设计，增加多个灵活的配置选项，根据不同的应用对硬件进行配置，使其在满足要求的情况下去除冗余电路，以减少占用面积和功耗，从而使其灵活地应用于各种USB系统。本文还研究了IP核的验证方法，并对所设计的USB2．0设备控制器建立了功能完备的ModelSim仿真验证环境，搭建了FPGA硬件验证平台，设计了具有AHB接口的设备控制器和带有8051的设备控制器，并分别在FPGA平台上进行了功能验证。 @@ 本文所设计的USB2．0设备控制器IP核可配置性高，使用者可以自由配置所需端点的个数以及每个端点类型等，可以集成于多种USB系统中，适于各类USB设备的开发。本课题所取得的成果为USB2．0设备类的研究和开发积累了经验，并为后来实验室某项目测试芯片的USB数据采集提供了参考方案，也为未来USB3．0接口IP核的开发和应用奠定了基础。 @@关键词USB2．0控制器；IP核；FPGA；验证
上传时间： 2013-06-30
上传用户：nanfeicui
DDR2 SDRAM是目前内存市场上的主流内存。除了通用计算机系统外，大量的嵌入式系统也纷纷采用DDR2内存，越来越多的SoC系统芯片中会集成有DDR2接口模块。因此，设计一款匹配DDR2的内存控制器将会具有良好的应用前景。 论文在研究了DDR2的JEDEC标准的基础上，设计出DDR2控制器的整体架构，采用自项向下的设计方法和模块化的思想，将DDR2控制器划分为若干模块，并使用Verilog HDL语言完成DDR2控制器IP软核中初始化模块、配置模块、执行模块和数据通道模块的RTL级设计。根据在设计中遇到的问题，对DDR2控制器的整体架构进行改进与完善。在分析了Altera数字PHY的基本性能的基础上，设计DDR2控制器与数字PHY的接口模块。搭建DDR2控制器IP软核的仿真验证平台，针对设计的具体功能进行仿真验证，并实现在Altera Stratix II GX90开发板上对DDR2存储芯片基本读/写操作控制的FPGA功能演示。 论文设计的DDR2控制器的主要特点是： 1.支持数字PHY电路，不需要实际的硬件电路就完成DDR2控制器与DDR2存储芯片之间的物理层接口，节约了设计成本，缩小了硬件电路的体积。 2.将配置口从初始化模块中分离出来，简化了具体操作。 3.支持多个DDR2存储芯片，使得DDR2控制器的应用范围更为广阔。 4.支持DDR2的三项新技术，充分发挥DDR2内存的特性。 5.自动DDR2刷新控制，方便用户对DDR2内存的控制。
上传时间： 2013-06-10
上传用户：ynzfm
本文对基于FPGA的对象存储控制器原型的硬件设计进行了研究。主要内容如下： ⑴研究了对象存储控制器的硬件设计，使其高效完成对象级接口的智能化管理和复杂存储协议的解析，对对象存储系统整体性能提升有重要意义。基于SoPC(片上可编程系统)技术，在FPGA(现场可编程门阵列)上实现的对象存储控制器，具有功能配置灵活，调试方便，成本较低等优点。 ⑵采用Cyclone II器件实现的对象存储控制器的网络接口，包含处理器模块、内存模块、Flash模块等核心组成部分，提供千兆以太网的网络接口和PCI(周边元件扩展接口)总线的主机接口，还具备电源模块、时钟模块等以保证系统正常运行。在设计实现PCB(印制电路板)时，从叠层设计、布局、布线、阻抗匹配等多方面解决高达100MHz的全局时钟带来的信号完整性问题，并基于IBIS模型进行了信号完整性分析及仿真。针对各功能模块提出了相应的调试策略，并完成了部分模块的调试工作。 ⑶提出了基于Virtex-4的对象存储控制器系统设计方案，Virtex-4内嵌PowerPC高性能处理器，可更好地完成对象存储设备相关的控制和管理工作。实现了丰富的接口设计，包括千兆以太网、光纤通道、SATA(串行高级技术附件)等网络存储接口以及较PCI性能更优异的PCI-X(并连的PCI总线)主机接口；提供多种FPGA配置方式。使用Cadence公司的Capture CIS工具完成了该系统硬件的原理图绘制，通过了设计规则检查，生成了网表用作下一步设计工作的交付文件。
上传时间： 2013-04-24
上传用户：lijinchuan
随着以太网技术的不断发展，网络的传输速度已经由最初的10M发展到现在的10,000M。用可编程逻辑器件(FPGA)实现以太网控制器与其它SOC系统的互连成为当前的研究热点。本文阐述了MAC层的FPGA设计、仿真及测试；介绍了整个系统的内部结构、模块划分，并对各个模块的设计过程进行了详细阐述，接着介绍了开发环境和验证工具，同时给出测试方案、验证数据、实现结果及时序仿真波形图。 对MAC层的主要功能模块如:发送模块、接收模块、MAC流程控制模块、寄存器模块、MⅡ接口模块和主机接口模块以及CRC，CSMA/CD，HASH表等算法给出了基于FPGA及硬件描述语言的解决方法。 本课题针对以下三个方面进行了研究并取得一定的成果: 1)FPGA开发平台的硬件实现。选用Xilinx公司的XC3S1000-FT256-4-C和ATMEL公司的ARM9200作为测试的核心器件，采用LXT971芯片作为物理层芯片，AT91RM9200作为数据输入源和双blockram作为帧缓存搭建FPGA硬件验证开发平台。 2)基于FPGA实现以太网控制器。用VerilogHDL语言构建以太网控制器，实现CSMA/CD协议、10M/100M自适应以及与物理层MⅡ接口等。 3)采用片上系统通用的WS接口。目的是便于与具有通用接口的片上系统互连，也为构建SOC上处理器提供条件。 本论文实现了一个基于WS总线接口可裁减的以太网MAC控制器IP软核，为设计具有自主知识产权的以太网MAC控制器积累了经验。同时，为与其它WS接口的控制器实现直接互连创造了条件，对高层次设计这一先进ASIC设计方法也有了较为深入的认识。
上传时间： 2013-07-17
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