总加器

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一个简单的典型加法器应用，实现4位BCD码的的加法器设计，来源于一次数字实验的实验报告，讲解的非常清晰，包括原理，器件选择，电路原理图，值得一看！

2023-09-24 10 总加器

代码是用verilog编写的加法器的源代码，有进位选择，连波进位，还有进位跳跃多种方法描述全加器

2025-02-20 8 总加器

信号传输距离有限，常用于一个PCB板之内；总线上挂接的节点器件有限，受容性负载最大值400pF的限制；拓扑结构只能是二线总线型，不能扩充到星型结构；速度只能取最低值，高速I2C器件速度发挥不出来；不同电平的器件不能挂接在同一总线上；如果要解...

2013-10-17 189 总加器

SN65HVD230 CAN总线收发器的详细原理与实际应用解析，涵盖电气特性、通信协议及典型电路设计，适用于工业控制与车载系统开发。

2026-02-10 2 总加器

Xilinx的I2C总线控制器，verilog版本，文档号是XAPP333，可到Xilinx网上查找具体说明，有对应的VHDL版本的

2013-12-08 64 总加器