随着国民经济的发展和社会的进步，人们越来越需要便捷的交通工具，从而促进了汽车工业的发展，同时汽车发动机检测维修等相关行业也发展起来。在汽车发动机检测维修中，发动机电脑(Electronic Control．Unit-ECU)检测维修是其中最关键的部分。发动机电脑根据发动机的曲轴或凸轮轴传感器信号控制发动机的喷油、点火和排气。所以，维修发动机电脑时，必须对其施加正确的信号。目前，许多发动机的曲轴和凸轮轴传感器信号已不再是正弦波和方波等传统信号，而是多种复杂波形信号。为了能够提供这种信号，本文研究并设计了一种能够产生复杂波形的低成本任意波形发生器(Arbitrary Waveform Generator-AWG)。 本文提出的任意波形发生器依据直接数字频率合成(Direct Digial FrequencySynthesis-DDFS)原理，采用自行设计现场可编程门阵列(FPGA)的方案实现频率合成，扩展数据存储器存储波形的量化幅值(波形数据)，在微控制单元(MCU)的控制与协调下输出频率和相位均可调的信号。 任意波形发生器主要由用户控制界面、DDFS模块、放大及滤波、微控制器系统和电源模块五部分组成。在设计中采用FPGA芯片EPF10K10QC208-4实现DDFS的硬件算法。波形调整及滤波由两级放大电路来完成：第一级对D/A输出信号进行调整；第二级完成信号滤波及信号幅值和偏移量的调节。电源模块利用三端集成稳压器进行电压值变换，利用极性转换芯片ICL7660实现正负极性转换。 该任意波形发生器与通用模拟信号源相比具有：输出频率误差小，分辨率高，可产生任意波形，成本低，体积小，使用方便，工作稳定等优点，十分适合汽车维修行业使用，具有较好的市场前景。
上传时间： 2013-04-24
上传用户：KIM66
未来的时代是信息时代，信息需要通过媒体来进行记录、传播和获取。视频数据的压缩技术和解压缩技术成了多媒体技术中的关键技术之一，本论文设计的芯片正是基于FPGA实现视频编码器的设计，主要面向于对音频和视频信号进行压缩和解压缩的广泛场合。 本论文首先对FPGA技术做了介绍，主要从FPGA的结构和特点，阐述了FPGA设计的输入、综合、仿真、实现等，其次介绍了当今主流的视频编码标准，如H．263、H．264。本论文基于FPGA来实现视频编码，提出了视频编解码器系统设计方案，包括系统设计和模块设计，最后，文章又提出了图像预处理部分和运动估计部分的设计思想和实现步骤，其中的运动估计设计部分是整个论文的关键，以及通过仿真得到理想的结果。
上传时间： 2013-06-28
上传用户：aa17807091
在很多高精度计算场合需要采用浮点运算。过去用门电路进行各种运算通常为定点运算，但其计算精度有限。随着现场可编程门阵（FPGA）的迅速发展，可以采用FPGA实现浮点运算。 本文首先介绍定点数和浮点数的格式，完成基于FPGA的几种常用浮点运算器的VHDL设计，包括浮点数与定点数之间的相互转换，浮点加法器、减法器、乘法器以及除法器。在这些浮点运算单元电路中采用多级流水线技术，并在某些方面优化算法，提高了运算器的性能。在此基础上讨论浮点运算器的应用，通过调用自主开发的浮点乘、加模块设计浮点FIR滤波器，并将其应用于正交中频采样，结果表明浮点运算的正交中频采样可以得到更高的镜频抑制比。最后应用浮点运算模块设计浮点FFT处理器，在FPGA中实现高精度的FFT处理。
上传时间： 2013-05-20
上传用户：hechao3225
随着多媒体编码技术的发展，视频压缩标准在很多领域都得到了成功应用，如视频会议(H.263)、DVD(MPEG-2)、机顶盒(MPEG-2)等等，而网络带宽的不断提升和高效视频压缩技术的发展使人们逐渐把关注的焦点转移到了宽带网络数字电视(IPTV)、流媒体等基于传输的业务上来。带宽的增加为流式媒体的发展铺平了道路，而高效的视频压缩标准的出台则是流媒体技术发展的关键。H.264/AVC是由国际电信联合会和国际标准化组织共同发展的下一代视频压缩标准之一。新标准中采用了新的视频压缩技术，如多模式帧间预测、1/4像素精度预测、整数DCT变换、变块尺寸运动补偿、基于上下文的二元算术编码(CABAC)、基于上下文的变长编码(CAVLC)等等，这些技术的采用大大提高了视频压缩的效率，更有利于宽带网络数字电视(IPTV)、流媒体等基于传输的业务的实现。 本文主要根据视频会议应用的需要对JM8.6代码进行优化，目标是实现基于Baseline的低复杂度的CIF编码器，并对部分功能模块进行电路设计。在设计方法上采用自顶向下的设计方法，首先对H.264编码器的C代码和算法进行优化，并对优化后的结果进行测试比较，结果显示在图像质量没有明显降低的情况下，H.264编码器编码CIF格式视频每秒达到15帧以上，满足了视频会议应用的实时性要求。然后，以C模型为参考对H.264编码器的部分功能模块电路进行设计。采用Verilog HDL实现了这些模块，并在Quartus Ⅱ中进行了综合、仿真、验证。主要完成了Zig-zag扫描和CAVLC模块的设计，详细说明模块的工作原理和过程，然后进行多组的仿真测试，结果与C模型相应部分的结果一致，证明了设计的正确性。
上传时间： 2013-06-11
上传用户：kjgkadjg
使用Java语言有非常多的好处，如安全的对象引用、语言级支持多线程和跨平台等特性。但是嵌入式系统中Java语言的应用却很少见，这是由于Java如下两方面的不足： (1)Java虚拟机实现需要大量的硬件资源；(2)Java语言的运行时间不可预测。 为此，本论文将实现一个能够应用在低端FPGA器件的实时Java虚拟机。论文的主要创新点如下： 1．使用基于堆栈的RISC模型处理器实现CISC模型的JVM； 2．处理器微指令无任何相关性； 3．所设计的JVM能使Java程序拥有足够的底层访问能力。 论文的主要内容和工作如下： 1．制定基于堆栈的RISC结构处理器各级结构。 2．设计简洁高效的处理器微指令，并且微指令能够满足字节码的需要。 3．制定Java字节码到处理器代码的转换关系和快速转换结构。 4．设计中使用高速缓存，提高运行速度。 5．优化堆栈的硬件结构，使得出栈入栈操作更加简洁快速。 6．设计一系列的本地方法，使得Java程序能够直接访问底层资源。 7．将Java类库使用本地方法实现。 8．自定义程序在内存中的结构，并使用装载工具实现。 9．制定处理外围数据处理机制，如IO和内存接口10．制定中断处理方式，并且实现软中断的机制。
上传时间： 2013-06-11
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PROFIBUS现场总线技术是当今控制领域的一个热点。目前国内对于PROFIBUS-DP的应用和研究主要以西门子等国外大公司的成套设备为主，用单片机+固态程序的方法做PROFIBUS-DP接口控制器的技术比较成熟，而自主开发PROFIBUS-DP通用接口的研究却比较少。针对这一现状，本论文采用FPGA做控制器，提出了基于FPGA技术的从站接口通信模块的设计方案，使具有RS-232接口的从站可以通过该接口通信模块与PROFIBUS-DP主站进行通讯连接。 论文首先对PROFIBUS现场总线技术进行概述，主要从现场总线的技术特点、协议结构、传输技术、存取协议等方面进行介绍。对PROFIBUS-DP系统组成和配置、工作方式及数据传递、DP的功能和从站状态机制等进行研究和分析。然后详细论述了基于PROFIBUS-DP的通信接口的硬件及软件实现。 在硬件设计中，本文从PROFIBUS协议芯片SPC3实现的具体功能出发，结合EDA(Electronic Design Amomation)设计自项向下的设计思想，给出了总线接口的总体设计方案。同时给出其设计逻辑框图、算法流程图、引脚说明以及部分模块的仿真结果。并充分考虑了硬件的通用性及将来的扩展。 本设计使用VHDL描述，在此基础之上采用专门的综合软件对设计进行了综合优化，最后在FPGA(Field Programmable Gate Array)芯片EP1C6上得以实现。在软件设计中，详细介绍了通信接口的软件设计实现，包括状态机的实现、各种通信报文的实现、GSD文件的编写等。 再通过Siemens公司的CP5611网络接口卡和PC机做主站，使用COMPROFIBUS组态软件，组建系统进行通讯测试，得到良好结果。
标签： PROFIBUSDP FPGA 接口
上传时间： 2013-05-25
上传用户：xwd2010
该论文基于NIOS Ⅱ软核处理器和Altera的FPGA技术，设计了一种便携式的振动频谱分析仪，用于旋转机械的故障监测和诊断。以SOPC技术为手段，将信号采集和信号处理电路通过可编程片上系统来实现，其特点是将对ADC的控制、数字信号的滤波、快速傅立叶变换的设计，通过FPGA芯片集成在一起，以NIOS Ⅱ来完成32位CPU的状态控制功能。工程机械、汽车车辆中都存在诸如发动机类的旋转机械，这类设备的异常振动往往会影响正常工作，严重时还会出现各种重大事故，该分析仪可以实时地或定期地对发动机、齿轮箱等旋转机械进行振动频谱分析和监测，运用于民用机械能产生非常好的经济效益。 该论文从四个方面进行了研究工作。其一，利用FPGA对ADC芯片的工作进行控制，使其在规定的时间内与DSP模块进行数据交换，并对ADC各引脚时序进行控制，使两者协调同步工作，编制了相应的VHDL语言程序。其二，采用SOPC Builder设计开发，实现了基于NIOS Ⅱ的32位CPU软核，创建了相应的C/C++和汇编的宏代码，使得软件可以访问用户自定义逻辑。对顶层设计产生的VHDL的RTL代码和仿真文件进行了综合、编译适配以及仿真。其三，配合Matlab和DSP Builder的强大功能进行DSP模块设计，开发出了FIR和FFT等功能模块，并且添加到SOPC系统中，使其可以由NIOS Ⅱ很容易的调用。其四，在NIOS Ⅱ系统中添加了uC/OS Ⅱ操作系统，提高了整个系统的稳定性，并且降低了开发难度，提高了系统升级的能力。由于整个设计是基于FPGA开发的，所以该系统包括了所有FPGA系统的特点，包括并行的DSP处理、在系统可编程、升级简单等特点，极易使设计产品化。
上传时间： 2013-04-24
上传用户：amandacool
随着科学技术的发展，指纹识别技术被广泛应用到各种不同的领域。对于一般的指纹识别系统，其设计要求具有很高的实时性和易用性，因此识别算法应该具有较低的复杂度，较快的运算速度，从而满足实时性的要求。所以有必要根据不同的识别算法采用不同的实现平台，使得指纹识别系统具有较高的可靠性、实时性、有效性等性能要求。 SOPC片上可编程系统和嵌入式系统是当前电子设计领域中最热门的概念。NiosⅡ是Altera．公司开发的一种采用流水线技术、单指令流的RISC嵌入式处理器软核，可以将它嵌入到FPGA内部，与用户自定义逻辑组建成一个基于FPGA的片上专用系统。 本文在综合考虑各种应用情况的基础上，以网络技术、数据库技术、指纹识别技术和嵌入式系统技术为理论基础，提出了一种有效可行的系统架构方案。对指纹识别技术中各个环节的算法和原理进行了深入研究，合理的改进了部分指纹识别算法；同时为了提高系统的实时性，采用NiosⅡ嵌入式处理器和FPGA硬件模块实现指纹图像处理主要算法。论文主要包括以下几个方面： 1、对指纹图像预处理、特征提取和特征匹配算法原理进行阐述，同时改进了指纹图像的细化算法，提高了算法的性能，并设计了一套实用的指纹特征数据结构； 2、针对指纹图像预处理模块，包括图像的归一化、频率提取、方向提取以及方向滤波，采用基于FPGA的硬件电路的方式实现。实验结果表明，在保证系统误识率较低、可靠性高的基础上，大大提高了系统的执行速度； 3、改变了传统的单枚指纹识别方法，提出采用多枚指纹唯一标识身份，大大降低了识别系统的误识率； 4、改进了传统的基于三角形匹配中获取基准点的方法，同时结合可变界限盒思想进行指纹特征匹配。 5、结合COM+技术、数据库技术和网络技术，开发了后台指纹特征匹配服务系统，实现了嵌入式指纹识别系统同数据库的实时信息交换。 实验结果表明，本文所提出的系统构架方案有效可行，基于FPGA的自动指纹识别系统在速度、功耗、扩展性等方面具有独特的优势，拥有广阔的发展前景。
上传时间： 2013-04-24
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随着计算机和信息技术的飞速发展，信息的安全性越来越受到人们的重视。敏感信息的电子化在使用户得到便利的同时，数据、资源免泄漏也成为了人们必须注意的一个大隐患。在这个信息全球化的时代，病毒、黑客、电子窃听欺骗、网络攻击都是人们所必须面对的重大问题。出于这种需要，加密自然吸引了人们的注意力，而传统的软件加密技术已经越来越不能满足信息安全对运算速度和系统安全性的需求，硬件设施的开发显示出其重要性，硬件加密模块的地位也越来越重要。但其安全性仍存在着一定的问题，对安全性研究仍是不可放松的一个重要问题。 本文介绍了目前几种流行加密算法及标准，并对典型的公钥密码标准RSA进一步说明。RSA算法可以进行数字签名、数据加/解密，将其应用于数据安全领域具有很大的意义。针对于目前硬件加解密相对于软件加解密的种种优势，论文重点研究RSA算法的基于硬件FPGA的设计实现方案。FPGA是近几年的超大规模集成电路设计的焦点，其速度及成本等都占有一定的优势。对RSA算法的FPGA设计，论文主要研究两方面的内容：密钥生成部分中的素数检测问题和加/解密算法中关键瓶颈--大数模乘及模幂运算。并进行了软硬件的仿真、验证与测试。论文对RSA设计模块的可应用领域之一--智能卡及其安全性做了简单的介绍，并对论文所研究实现的模块在其中的应用进行了说明，从而体现了其实际应用价值。
上传时间： 2013-07-06
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随着现场可编程门阵列(FPGA)在工业中的广泛应用，使得基于FPGA数字信号处理的实现在雷达信号处理中有着重要地位。模型化设计是一种自顶向下的面向FPGA的快速原型验证法，它不仅降低了FPGA设计门槛，而且缩短了开发周期，提高了设计效率。这使得FPGA模型化设计成为了FPGA系统设计的发展趋势。本文针对常见雷达信号处理模块的FPGA模型化实现，在以下几个方面展开研究：首先对基于FPGA的模型化设计方法进行了研究，给出了模型化设计方法的发展现状和趋势，并对本文中使用的模型化设计方法的软件工具System Generator和AccelDSP进行了介绍。其次使用这两种软件工具对FIR滤波器进行了模型化设计并同RTL(寄存器传输级)设计方法进行对比，全面分析了模型化设计方法和RTL设计方法的优缺点。然后在简明阐述雷达信号处理原理的基础上，使用System Generator对数字下变频(DDC)、脉冲压缩、动目标显示(MTI)及恒虚警(CFAR)处理等雷达信号处理模块进行了自顶向下的模型化设计。在Simulink中进行了功能仿真验证，生成了HDL代码，并在Xilinx FPGA中进行了RTL的时序仿真分析。关键词：雷达信号处理 FPGA 模型化设计 System Generator AccelDSP
上传时间： 2013-07-25
上传用户：zhangsan123
