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VHDL语言描述,时钟分频,给定CPLD试验板系统时钟设置50M,但由于本作品的需要,我们将系统时钟经过20分频得到DS18B20所需的工作时钟,大约为1.25M。

2014-12-06 25 引脚描述

ABEL硬件描述语言概述:是一种层次化的硬件描述语言,它支持多种行为级输入形式,其中包括逻辑方程式、状态图和真值表等。

2023-04-01 7 引脚描述

LT153是采用低耗高速CMOS工艺制造的8位单片机,它内部包含一个1024*13bit的一次性可编程只读电存储器(OTP-ROM)。有15位选项位可满足用户要求,其中的保护位可用来防止程序被读出。

2013-10-08 110 引脚描述