为了提高语音信号的识别率，提出了一种改进的LPCC参数提取方法。该方法先对语音信号进行预加重、分帧加窗处理，然后进行小波分解，在此基础上提取LPCC参数，从而构成新向量作为每帧信号的特征参数。最后采用高斯混合模型（GMM）进行说话人语音识别，实验表明新特征参数取得了较好的识别率。
上传时间： 2013-10-10
上传用户：asdgfsdfht
提出一种基于USB的彩色CCD高清图像采集系统设计方案。图像数据的来源采用的是SONY公司的 ICX205AK芯片，结合USB2.0接口，复杂可编程逻辑器件CPLD设计了一个高速的彩色CCD图像采集系统。文中详细阐述了系统内不同模块的硬件电路设计思路和软件运行流程。整个系统由电源系统、CCD传感器、A/D模数转换器、CPLD控制器、USB2.0高速接口、上位机控制程序等各个部分组成。本系统的硬件电路可以协调正常工作完成分辨率为140万的高清图像采集，最高采集帧率达7.5 frame/s。
上传时间： 2013-10-24
上传用户：tianming222
为了对中频PCM信号进行直接解调，提出一种全新的数字化PCM中频解调器的设计方法。在实现过程中，采用大规模的FPGA芯片对位帧同步器进行了融合，便于设备的集成化和小型化。这种新型的中频解调器比传统的基带解调器具有硬件成本低和误码率低等优点。
上传时间： 2013-12-20
上传用户：jiangxiansheng
介绍了多制式数字视频信号转换电路的实验设计。其主要功能是对模拟视频信号进行解码和数字化，并作隔行／逐行转换、尺度变换、帧频转换等处理，同时为PDP整机提供行、场同步信号以及消隐和时钟信号等。
上传时间： 2013-12-16
上传用户：nanshan
摘要: 介绍了时钟分相技术并讨论了时钟分相技术在高速数字电路设计中的作用。 关键词: 时钟分相技术; 应用 中图分类号: TN 79 文献标识码:A 文章编号: 025820934 (2000) 0620437203 时钟是高速数字电路设计的关键技术之一, 系统时钟的性能好坏, 直接影响了整个电路的 性能。尤其现代电子系统对性能的越来越高的要求, 迫使我们集中更多的注意力在更高频率、 更高精度的时钟设计上面。但随着系统时钟频率的升高。我们的系统设计将面临一系列的问 题。 1) 时钟的快速电平切换将给电路带来的串扰(Crosstalk) 和其他的噪声。 2) 高速的时钟对电路板的设计提出了更高的要求: 我们应引入传输线(T ransm ission L ine) 模型, 并在信号的匹配上有更多的考虑。 3) 在系统时钟高于100MHz 的情况下, 应使用高速芯片来达到所需的速度, 如ECL 芯 片, 但这种芯片一般功耗很大, 再加上匹配电阻增加的功耗, 使整个系统所需要的电流增大, 发 热量增多, 对系统的稳定性和集成度有不利的影响。 4) 高频时钟相应的电磁辐射(EM I) 比较严重。 所以在高速数字系统设计中对高频时钟信号的处理应格外慎重, 尽量减少电路中高频信 号的成分, 这里介绍一种很好的解决方法, 即利用时钟分相技术, 以低频的时钟实现高频的处 理。 1 时钟分相技术 我们知道, 时钟信号的一个周期按相位来分, 可以分为360°。所谓时钟分相技术, 就是把 时钟周期的多个相位都加以利用, 以达到更高的时间分辨。在通常的设计中, 我们只用到时钟 的上升沿(0 相位) , 如果把时钟的下降沿(180°相位) 也加以利用, 系统的时间分辨能力就可以 提高一倍(如图1a 所示)。同理, 将时钟分为4 个相位(0°、90°、180°和270°) , 系统的时间分辨就 可以提高为原来的4 倍(如图1b 所示)。 以前也有人尝试过用专门的延迟线或逻辑门延时来达到时钟分相的目的。用这种方法产生的相位差不够准确, 而且引起的时间偏移(Skew ) 和抖动 (J itters) 比较大, 无法实现高精度的时间分辨。 近年来半导体技术的发展, 使高质量的分相功能在一 片芯片内实现成为可能, 如AMCC 公司的S4405, CY2 PRESS 公司的CY9901 和CY9911, 都是性能优异的时钟 芯片。这些芯片的出现, 大大促进了时钟分相技术在实际电 路中的应用。我们在这方面作了一些尝试性的工作: 要获得 良好的时间性能, 必须确保分相时钟的Skew 和J itters 都 比较小。因此在我们的设计中, 通常用一个低频、高精度的 晶体作为时钟源, 将这个低频时钟通过一个锁相环(PLL ) , 获得一个较高频率的、比较纯净的时钟, 对这个时钟进行分相, 就可获得高稳定、低抖动的分 相时钟。 这部分电路在实际运用中获得了很好的效果。下面以应用的实例加以说明。2 应用实例 2. 1 应用在接入网中 在通讯系统中, 由于要减少传输 上的硬件开销, 一般以串行模式传输 图3 时钟分为4 个相位 数据, 与其同步的时钟信号并不传输。 但本地接收到数据时, 为了准确地获取 数据, 必须得到数据时钟, 即要获取与数 据同步的时钟信号。在接入网中, 数据传 输的结构如图2 所示。 数据以68MBös 的速率传输, 即每 个bit 占有14. 7ns 的宽度, 在每个数据 帧的开头有一个用于同步检测的头部信息。我们要找到与它同步性好的时钟信号, 一般时间 分辨应该达到1ö4 的时钟周期。即14. 7ö 4≈ 3. 7ns, 这就是说, 系统时钟频率应在300MHz 以 上, 在这种频率下, 我们必须使用ECL inp s 芯片(ECL inp s 是ECL 芯片系列中速度最快的, 其 典型门延迟为340p s) , 如前所述, 这样对整个系统设计带来很多的困扰。 我们在这里使用锁相环和时钟分相技术, 将一个16MHz 晶振作为时钟源, 经过锁相环 89429 升频得到68MHz 的时钟, 再经过分相芯片AMCCS4405 分成4 个相位, 如图3 所示。 我们只要从4 个相位的68MHz 时钟中选择出与数据同步性最好的一个。选择的依据是: 在每个数据帧的头部(HEAD) 都有一个8bit 的KWD (KeyWord) (如图1 所示) , 我们分别用 这4 个相位的时钟去锁存数据, 如果经某个时钟锁存后的数据在这个指定位置最先检测出这 个KWD, 就认为下一相位的时钟与数据的同步性最好(相关)。 根据这个判别原理, 我们设计了图4 所示的时钟分相选择电路。 在板上通过锁相环89429 和分相芯片S4405 获得我们所要的68MHz 4 相时钟: 用这4 个 时钟分别将输入数据进行移位, 将移位的数据与KWD 作比较, 若至少有7bit 符合, 则认为检 出了KWD。将4 路相关器的结果经过优先判选控制逻辑, 即可输出同步性最好的时钟。这里, 我们运用AMCC 公司生产的 S4405 芯片, 对68MHz 的时钟进行了4 分 相, 成功地实现了同步时钟的获取, 这部分 电路目前已实际地应用在某通讯系统的接 入网中。 2. 2 高速数据采集系统中的应用 高速、高精度的模拟- 数字变换 (ADC) 一直是高速数据采集系统的关键部 分。高速的ADC 价格昂贵, 而且系统设计 难度很高。以前就有人考虑使用多个低速 图5 分相技术应用于采集系统 ADC 和时钟分相, 用以替代高速的ADC, 但由 于时钟分相电路产生的相位不准确, 时钟的 J itters 和Skew 比较大(如前述) , 容易产生较 大的孔径晃动(Aperture J itters) , 无法达到很 好的时间分辨。 现在使用时钟分相芯片, 我们可以把分相 技术应用在高速数据采集系统中: 以4 分相后 图6 分相技术提高系统的数据采集率 的80MHz 采样时钟分别作为ADC 的 转换时钟, 对模拟信号进行采样, 如图5 所示。 在每一采集通道中, 输入信号经过 缓冲、调理, 送入ADC 进行模数转换, 采集到的数据写入存储器(M EM )。各个 采集通道采集的是同一信号, 不过采样 点依次相差90°相位。通过存储器中的数 据重组, 可以使系统时钟为80MHz 的采 集系统达到320MHz 数据采集率(如图6 所示)。 3 总结 灵活地运用时钟分相技术, 可以有效地用低频时钟实现相当于高频时钟的时间性能, 并 避免了高速数字电路设计中一些问题, 降低了系统设计的难度。
上传时间： 2013-12-17
上传用户：xg262122
摘要：本系统采用cPLD和AvR单片机作为逻辑控制核心，设计了姿态存储测试系统，以实现姿态信息的采集、编帧和存储。详细介绍了姿态测试系统的工作原理和硬件设计。利用AVR单片机，控制数据的写、读、擦除操作，利用cPLD的逻辑控制功能完善了存储测试系统的各个工作状态，提高了存储测试系统工作的可靠性。验证了该系统可以完成对模拟信号的高速采样和存储。结合cPLD、AVR单]fit~ 1]Flash存储器的优点，实现了8通道数据的高速采集，其存储容量大、噪声小、功耗低。
上传时间： 2014-12-22
上传用户：skhlm
#ifndef __485_C__ #define __485_C__ #include #include #define unsigned char uchar #define unsigned int uint /* 通信命令 */ #define __ACTIVE_ 0x01 // 主机询问从机是否存在 #define __GETDATA_ 0x02 // 主机发送读设备请求 #define __OK_ 0x03 // 从机应答 #define __STATUS_ 0x04 // 从机发送设备状态信息 #define __MAXSIZE 0x08 // 缓冲区长度 #define __ERRLEN 12 // 任何通信帧长度超过12则表示出错 uchar dbuf[__MAXSIZE]; // 该缓冲区用于保存设备状态信息 uchar dev; // 该字节用于保存本机设备号 sbit M_DE = P1^0; // 驱动器使能，1有效 sbit M_RE = P1^1; // 接收器使能，0有效
上传时间： 2014-12-26
上传用户：604759954
首先研究CAN总线和SAE J1939协议，提出一种基于MC9S12HZ256微控制器的总线式汽车数字仪表解决方案。详细介绍SAE J1939协议的报文帧格式及应用层协议中发动机相关参数的定义，以及步进电机及其驱动和车速信号的处理方法。该数字仪表系统硬件平台由微处理器和信号采集和信息处理及显示等模块组成。软件设计部分编程实现了对CAN总线和各传感器数据的读取、处理。该系统能够实时反映车辆工况。 Abstract: In this paper，CAN bus and SAE J1939protocol are researched，and a vehicle digital instrument solution based on MC9S12HZ256MCU is proposed.The message frame format and some engine-related parameters’definition in SAE J1939application layer protocol are introduced in detail.Stepper motor and its driver，the methods of speed signal process-ing are also introduced.The hardware platform of vehicle digital instrument is composed by MCU，signal acquisition mod-ule，and signal processing and displaying module.Data receiving and processing from CAN bus and sensors are accom-plished by programming，and vehicle condition can be reflected in real-time.
上传时间： 2013-10-20
上传用户：huannan88
介绍一种基于CAN总线的牵引变电站自动化系统通讯规约的设计，CAN通讯规约采用标准帧，报文采用主动发送和发送查询两种处理形式。该设计在城市轻轨与地铁牵引变电站中的应用表明：可实现间隔层和通讯处理层的数据快速、可靠的交换，提高牵引变电站的安全性和稳定性 。 Abstract: This paper firstly presents a kind of design dealing with communicational protocol to the traction substation automation system based on CAN bus,and then comes up with the ideas that all frames of CAN communicational protocol should adopt the standard frame,and that messages be processed by two ways:sending initiatively and sending quiries.Subway and light rail application shows that the use of the CAN bus is possible to exchange data quickly and reliably between the layers of the middle and the communicational processing,hence to improve the safety and stability of traction substations.
上传时间： 2013-11-07
上传用户：bs2005
1.UART增加2个新的特性，即帧错误检测和多机通信中的从机地址自动识别。(1)帧错误检测可用于UART检查工作方式1、2和3时的停止位。例如，由于UART通信线路上的噪声或者2个MCU同时发送可能引起停止位的丢失。(2)多机通信中的从机地址自动识别功能即是说只允许该地址从机被硬件中断，而不是由软件进行地址比较的，那么自动地址识别可以减少为UART服务所需要的MCU时间。与此同时使用广播地址可以一次寻址所有的从处理器。2.4个中断优先级：IPH和IP结合使用决定了每个中断的优先级，00、01、10、11的排列依次由低到高组成4级中断优先权。3.双DPTR指针：可用于寻址外部数据存储器。通过对AUCR1的DPS位编程，以实现对2个16位DPTR寄存器的切换。4.将AUXR.0置位，禁止ALE的信号输出，从而达到降低单片机本身的EMI电磁干扰。
上传时间： 2013-10-23
上传用户：hj_18
