随着电子设备的迅猛发展，“让全部设备接入网络”已经成为一种发展趋势。通过嵌入式串口服务器，可以让现有的串行设备拥有联网功能，避免了投资大量人力、物力，有利于对传统串行设备进行更换或者升级。 本文设计的串口服务器采用嵌入式处理器和Linux操作系统，把现有的基于串行接口的数据转化成以太网数据，然后进行数据存取，将传统的串行数据送往网络。 论文主要研究了以下内容： 第一，在研究串口服务器网关工作机理的基础上，分析高性能串口网络服务器的功能需求。 第二，基于AT91ARM9200微处理器及LXT971ALE网络接口芯片等构建嵌入式系统，完成RS232-TCP/IP转换网关的软硬件设计，实现最多32路串行终端同时接入以太网的高性能串口服务器。 第三，在RH Linux 9.0为ARM处理器提供的交叉开发工具下移植Linux，为嵌入式串口服务器设计服务器端与客户端工作模式，同时设计实现系统参数的在线配置功能。 第四，在客户端和服务器端分别设计串口服务器的基本API函数，为系统二次开发打下良好的基础。
上传时间： 2013-04-24
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进入20世纪90年代后，随着全球信息化、智能化、网络化的发展，嵌入式系统技术获得了前所未有的发展空间。 嵌入式系统的最大特点之_是其所具有的目的性或针对性，即每一套嵌入式系统的开发设计都有其特殊的应用场合与特定功能，这也是嵌入式系统与通刚的计算机系统最主要的区别。由于嵌入式系统是为特定的目的而设计的，且常常受到体积、成本、功能、处理能力等各种条件的限制。因此，如果可以最大限度地提高应用系统硬件上和软件上的灵活性，就可以用最低的成本，最少的时间，快速的完成功能的转换。 本课题的目的在于提出并设计一种基于ARM(Advanced RISC Machines)和CPLD(Complex Programmable Logic Device)的可扩展功能嵌入式系统平台，并完成了系统的硬件设计和PCI(Peripheral Component Interconnect)桥的固件设计。设计过程中采用美国ALTIUM公司的ALTIUM DESIGNER 6.0 EDA软件开发了系统的硬件部分。在整个硬件开发环节中，充分采用高速PCB(Printed Circuit Board)的设计原则，并进行全面的电路仿真试验，保证了硬件系统的高度可靠性。本系统承袭了ARM7系列处理器高性能、低功耗、低成本的优点，并充分考虑到用户的需要，扩展了多种常用的外部设备接口以及蓝牙无线接口等，为将米各种可能的应用提供了完善的硬件基础。概括总结起来本文具体工作如下： 1．完全自主设计了具有高扩展性的基于LPC2292嵌入式处理器的嵌入式系统应用开发平台。基于该硬件平台，可以实现许多基于ARM架构处理器的嵌入式应刚而无需对硬什系统作出大的改变，如多协议转换器、CAN(Control Area Network)总线网关、以太网关、各种工业控制应用等。并在具体的设计实践中，总结出了嵌入式系统硬件平台的设计原则及设计方法。 2．完成了基于CPLD的PCI桥接芯片的同什设计，在ARM硬件平台上成功扩展了PCI设备，成功解决了ARM处理器和PCI从设备之间通讯的问题。 3．完成了对所开发的嵌入式系统硬件平台的测试工作，完成了基于AT89C51的PCI测试卡软硬件设计。基于此测试卡，可以实现对系统中的PCI通讯功能进行有效测试，以保证整个硬件系统正常、高效、稳定地运行。本系统的设计完成，使其可以作为嵌入式应用的二次开发或实验平台，用于工业产品开发及高校相关专业的实践教学。
上传时间： 2013-05-22
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语音编码技术始终是语音研究的热点。语音编码作为多媒体通信中信息传输的一个重要环节，越来越受到广泛的重视。G729是由美国、法国、日本和加拿大的几家著名国际电信实体联合开发的，国际电信联盟(ITU-T)于1995年11月正式通过了G729。96年ITU-T又制定了G729的简化方案G729A，主要降低了计算的复杂度以便于实时实现。因其具有良好的合成语音质量、适中的复杂度、较低的时延等优点，G729A标准已被广泛应用在VOIP网关、IP电话中。 论文利用Altera公司的新一代可编程逻辑器件在数字信号处理领域的优势，对G729A语音编码中的线性预测(LP)滤波器系数提取的FPGA(现场可编程门阵列，Field Programmable Gate Array)实现进行了深入研究。论文首先对语音信号处理及其发展进行介绍，深入讨论了G729A语音编解码技术。第二，对Altera公司的Stratix系列可编程器件的内部结构进行了研究，分析了在QuartusII开发平台上进行FPGA设计的流程。第三，基于FPGA，对G729A编码系统的LP分析部分做了具体设计，其中包括自相关函数和杜宾(Durbin)递推两个主要功能模块，并对其工作过程进行了详细的分析。第四，针对系统所使用的除法运算都是商小于1的特点，设计并实现了一个系统专用的除法器模块。最后，在Altera FPGA目标芯片EP1S30F780C7上，对LP分析系统进行了验证，证明了方案的可行性。
上传时间： 2013-04-24
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特点： 精确度0.1%满刻度 可作各式數學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT类比输出功能 输入与输出绝缘耐压2仟伏特/1分钟(input/output/power) 宽范围交直流兩用電源設計 尺寸小,穩定性高
上传时间： 2014-12-23
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开关在电路中起接通信号或断开信号的作用。最常见的可控开关是继电器，当给驱动继电器的驱动电路加高电平或低电平时，继电器就吸合或释放，其触点接通或断开电路。CMOS模拟开关是一种可控开关，它不象继电器那样可以用在大电流、高电压场合，只适于处理幅度不超过其工作电压、电流较小的模拟或数字信号。 一、常用CMOS模拟开关引脚功能和工作原理 1.四双向模拟开关CD4066 CD4066 的引脚功能如图1所示。每个封装内部有4个独立的模拟开关，每个模拟开关有输入、输出、控制三个端子，其中输入端和输出端可互换。当控制端加高电平时，开关导通；当控制端加低电平时开关截止。模拟开关导通时，导通电阻为几十欧姆；模拟开关截止时，呈现很高的阻抗，可以看成为开路。模拟开关可传输数字信号和模拟信号，可传输的模拟信号的上限频率为40MHz。各开关间的串扰很小，典型值为－50dB。
上传时间： 2013-10-27
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减小电磁干扰的印刷电路板设计原则 内 容 摘要……1 1 背景…1 1.1 射频源.1 1.2 表面贴装芯片和通孔元器件.1 1.3 静态引脚活动引脚和输入.1 1.4 基本回路……..2 1.4.1 回路和偶极子的对称性3 1.5 差模和共模…..3 2 电路板布局…4 2.1 电源和地…….4 2.1.1 感抗……4 2.1.2 两层板和四层板4 2.1.3 单层板和二层板设计中的微处理器地.4 2.1.4 信号返回地……5 2.1.5 模拟数字和高压…….5 2.1.6 模拟电源引脚和模拟参考电压.5 2.1.7 四层板中电源平面因该怎么做和不应该怎么做…….5 2.2 两层板中的电源分配.6 2.2.1 单点和多点分配.6 2.2.2 星型分配6 2.2.3 格栅化地.7 2.2.4 旁路和铁氧体磁珠……9 2.2.5 使噪声靠近磁珠……..10 2.3 电路板分区…11 2.4 信号线……...12 2.4.1 容性和感性串扰……...12 2.4.2 天线因素和长度规则...12 2.4.3 串联终端传输线…..13 2.4.4 输入阻抗匹配...13 2.5 电缆和接插件……...13 2.5.1 差模和共模噪声……...14 2.5.2 串扰模型……..14 2.5.3 返回线路数目..14 2.5.4 对板外信号I/O的建议14 2.5.5 隔离噪声和静电放电ESD .14 2.6 其他布局问题……...14 2.6.1 汽车和用户应用带键盘和显示器的前端面板印刷电路板...15 2.6.2 易感性布局…...15 3 屏蔽..16 3.1 工作原理…...16 3.2 屏蔽接地…...16 3.3 电缆和屏蔽旁路………………..16 4 总结…………………………………………17 5 参考文献………………………17
上传时间： 2013-10-24
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特点(FEATURES) 精确度0.1%满刻度 (Accuracy 0.1%F.S.) 可作各式数学演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A| (Math functioA+B/A-B/AxB/A/B/A&B(Hi&Lo)/|A|/etc.....) 16 BIT 类比输出功能(16 bit DAC isolating analog output function) 输入/输出1/输出2绝缘耐压2仟伏特/1分钟(Dielectric strength 2KVac/1min. (input/output1/output2/power)) 宽范围交直流两用电源设计(Wide input range for auxiliary power) 尺寸小,稳定性高(Dimension small and High stability)
上传时间： 2013-11-24
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TLC2543是TI公司的12位串行模数转换器，使用开关电容逐次逼近技术完成A/D转换过程。由于是串行输入结构，能够节省51系列单片机I/O资源；且价格适中，分辨率较高，因此在仪器仪表中有较为广泛的应用。 TLC2543的特点 （1）12位分辩率A/D转换器； （2）在工作温度范围内10μs转换时间； （3）11个模拟输入通道； （4）3路内置自测试方式； （5）采样率为66kbps； （6）线性误差±1LSBmax； （7）有转换结束输出EOC； （8）具有单、双极性输出； （9）可编程的MSB或LSB前导； （10）可编程输出数据长度。 TLC2543的引脚排列及说明 TLC2543有两种封装形式：DB、DW或N封装以及FN封装，这两种封装的引脚排列如图1，引脚说明见表1 TLC2543电路图和程序欣赏 #include<reg52.h> #include<intrins.h> #define uchar unsigned char #define uint unsigned int sbit clock=P1^0; sbit d_in=P1^1; sbit d_out=P1^2; sbit _cs=P1^3; uchar a1,b1,c1,d1; float sum,sum1; double sum_final1; double sum_final; uchar duan[]={0x3f,0x06,0x5b,0x4f,0x66,0x6d,0x7d,0x07,0x7f,0x6f}; uchar wei[]={0xf7,0xfb,0xfd,0xfe}; void delay(unsigned char b) //50us { unsigned char a; for(;b>0;b--) for(a=22;a>0;a--); } void display(uchar a,uchar b,uchar c,uchar d) { P0=duan[a]|0x80; P2=wei[0]; delay(5); P2=0xff; P0=duan[b]; P2=wei[1]; delay(5); P2=0xff; P0=duan[c]; P2=wei[2]; delay(5); P2=0xff; P0=duan[d]; P2=wei[3]; delay(5); P2=0xff; } uint read(uchar port) { uchar i,al=0,ah=0; unsigned long ad; clock=0; _cs=0; port<<=4; for(i=0;i<4;i++) { d_in=port&0x80; clock=1; clock=0; port<<=1; } d_in=0; for(i=0;i<8;i++) { clock=1; clock=0; } _cs=1; delay(5); _cs=0; for(i=0;i<4;i++) { clock=1; ah<<=1; if(d_out)ah|=0x01; clock=0; } for(i=0;i<8;i++) { clock=1; al<<=1; if(d_out) al|=0x01; clock=0; } _cs=1; ad=(uint)ah; ad<<=8; ad|=al; return(ad); } void main() { uchar j; sum=0;sum1=0; sum_final=0; sum_final1=0; while(1) { for(j=0;j<128;j++) { sum1+=read(1); display(a1,b1,c1,d1); } sum=sum1/128; sum1=0; sum_final1=(sum/4095)*5; sum_final=sum_final1*1000; a1=(int)sum_final/1000; b1=(int)sum_final%1000/100; c1=(int)sum_final%1000%100/10; d1=(int)sum_final%10; display(a1,b1,c1,d1); } }
上传时间： 2013-11-19
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#include<iom16v.h> #include<macros.h> #define uint unsigned int #define uchar unsigned char uint a,b,c,d=0; void delay(c) { for for(a=0;a<c;a++) for(b=0;b<12;b++); }; uchar tab[]={ 0xc0,0xf9,0xa4,0xb0,0x99,0x92,0x82,0xf8,0x80,0x90,
上传时间： 2013-10-21
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a_bit equ 20h ;个位数存放处 b_bit equ 21h ;十位数存放处 temp equ 22h ;计数器寄存器 star: mov temp,#0 ;初始化计数器 stlop: acall display inc temp mov a,temp cjne a,#100,next ;=100重来 mov temp,#0 next: ljmp stlop ;显示子程序 display: mov a,temp ;将temp中的十六进制数转换成10进制 mov b,#10 ;10进制/10=10进制 div ab mov b_bit,a ;十位在a mov a_bit,b ;个位在b mov dptr,#numtab ;指定查表启始地址 mov r0,#4 dpl1: mov r1,#250 ;显示1000次 dplop: mov a,a_bit ;取个位数 MOVC A,@A+DPTR ;查个位数的7段代码 mov p0,a ;送出个位的7段代码
上传时间： 2013-11-06
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