实时卷积

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(2,1,9)卷积编解码器，译码部分采用Vitebi译码算法，设计使用Verilog HDL语言，在Modelsim平台下仿真通过

2013-12-17 151 实时卷积

TI 5509A DSP平台上的卷积算法入门例程，包含完整代码和实现说明，适合初学者掌握数字信号处理基础。

2026-01-26 2 实时卷积