定点设计
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查看全部 500 份 →FPGA上浮点加_减法器的设计
· 摘要： 浮点加减运算是现代数字信号处理应用中非常频繁的操作,介绍了字长为20位的TI DSP浮点数在VirtexTM-E系列FPGA上的实现,这种设计在用三拍实现浮点加减运算时,速度达到了80M以上. &...
2024-08-25
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Verilog HDL程序设计教程,以可综合的设计为重点
Verilog HDL程序设计教程,以可综合的设计为重点，同时对仿真和模拟也作了深入阐述。全面介绍了verilog HdL 词法，语法。
2014-01-19
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设定无线接入点能够始终提供最大吞吐量
设定无线接入点能够始终提供最大吞吐量，终端节点的冗余通信模块各自的网络信道信噪比值随机变化，由此计算得冗余网络各自的CHF值。CHF切换机制根据冗余网络各自的采样值大小进行切换判决，考虑门限的CHF切换机制根据设定的上下切换门限值进行切换判...
2014-11-23
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