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systemverilog是新出现的一种高级硬件描述和验证语言

systemverilog是新出现的一种高级硬件描述和验证语言，这里给出了一些书和文章还有使用vmm方法开发testbench的例子...

📅 2015-12-14 👤 waitingfy

systemverilog 硬件验证语言

经修正并验证过在 IAR MSP430 v3.42A 下编译正之 uC/OS-II For MSP430F149 的例程(修正一般网站上重复 Define 无法编译的问题),而且我以于 Simulat

经修正并验证过在 IAR MSP430 v3.42A 下编译正之 uC/OS-II For MSP430F149 的例程(修正一般网站上重复 Define 无法编译的问题),而且我以于 Simulator 内并设好了 Watch Dog Interrup 及观测的断点也设好了,可以直接于 IAR M...

📅 2014-11-24 👤 bruce5996

430 MSP Simulat Define