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这是转载的一个实验报告,我觉得很好,与大家共享
数字频率计的设计,1.频率测量范围:1Hz—9999Hz。
基于FPGA简易数字频率计设计
PLD数字显示频率计的设计1
基于FPGA的数字频率计的设计,可测量从1hz到10000hz,误差在1hz以内,是EDA课程学习很好的实例。
4位数字频率计的verilog HDL设计,精度比较准的
基于51单片机的数字频率计的设计,数字频率计广泛应用于日常实验。
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