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时钟分频器clk2scl.rar,很简单,很明了,看看就知道!
用一个堆栈实现回文的测试程序,分测试的字符长度是奇数还是偶数个两中情况
如何给时钟倍频或者分频,以及altera提供的IP核使用方法
fpga上实现的最小是0.5分频的任意分频器
三分频程序,对输入的时钟信号进行分频,在此基础上可以进行倍频和分频的转化。
数值分析,通过自身递归调用实现奇偶分离,用于一维快速傅立叶程序变换代码的实现
用VHDL写成的一个数控分频程序.本例中把64HZ分成1HZ
·期刊论文:一种基于小波变换与奇异值分解对振动系统模态频率进行识别的新方法
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