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多尺度联合

  • 基于FPGA采用PCM通信实现多路数据采集器的研制

    本文研制的数据采集器,用于采集导弹过载模拟试车台的各种参数,来评价导弹在飞行过程中的性能,由于试车台是高速旋转体,其工作环境恶劣,受电磁干扰大,而且设备要求高,如果遇到设备故障或设备事故,其损失相当巨大,保证设备的安全性和可靠性较为困难。 本文在分析数字通信技术的基础上,选用了基于现场可编程逻辑阵列(FPGA)采用脉冲编码调制(PCM)通信实现多路数据采集器的设计,其优点是FPGA技术在数据采集器中可以进行模块化设计,增加了系统的抗干扰性、灵活性和适应性,并且可以将整个PCM通信系统设计成可编程序系统,用户只要稍加变更程序,则系统的被测路数、帧结构、码速率、标度等均可改变以适应任何场合。并且采用合理的纠错和加密编码能够实现数据在传输工程中的完整性和安全性。 通过对PCM通信的特点研究,研制了一套集采集与传输的系统。文章给出了各个模块的具体建模与设计,系统采用的是FPGA技术来实现数据采集和信号处理,采用VHDL实现了数字复接器和分接器、编解码器、调制与解调模块的建模与设计。采用基于NiosII实现串口通讯,构建了实时性和准确性通信网络,实现了数据的采集。 测试数据和数据采集的实验结果证明,采用FPGA技术实现PCM信号的编码、传输、解码,能够有较强的抗干扰性、抗噪声性能好、差错可控、易加密、易与现代技术结合,并且误码率较低,要远远优于传统的方法。

    标签: FPGA PCM 通信实现 多路

    上传时间: 2013-04-24

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  • 基于ARM的燃料电池汽车仪表系统设计

    作为新能源与汽车工业相结合的产物,燃料电池汽车已经逐渐成为了汽车家族的后起之秀。随着电子控制单元与车载设备的不断增多,传统内燃机汽车的仪表盘已经不能满足以燃料电池为动力的汽车仪表复杂信息显示的要求。本文以燃料电池汽车为研究背景,设计开发了基于嵌入式技术的仪表系统,实现了对燃料电池汽车整车运行状态以及模块数据的实时监测、存储与图形化显示。 本文介绍了燃料电池汽车仪表系统的设计原理,对仪表系统进行了需求分析,确定了系统整体框架与模块划分,提出了基于ARM微处理器、实时操作系统以及图形用户界面的仪表系统解决方案。该方案采用高性能的S3C44BOX作为底层核心处理器,以RTOS和GUI为中间层构建软件系统平台,在此基础上以实时多任务软件设计方法进行仪表系统应用程序的开发。 在上述方案的基础上,进行了仪表系统硬件平台的设计,包括存储器系统、通信总线、人机交互界面等接口电路的设计。根据高速数字电路的设计要求,在双面板上实现了基于ARM的燃料电池汽车仪表系统的PCB布线。编写了系统初始化代码,完成了对硬件平台的调试工作。 根据仪表系统的实际情况,选择了实时多任务操作系统μC/OS-Ⅱ和嵌入式图形用户界面μC/GUI作为本系统的软件平台,完成了两者在仪表系统硬件平台上的移植。针对μC/GUI环境下简体中文汉字的显示问题,给出了一种比较完善的解决方案。μ按照实时多任务软件的开发流程,设计了仪表系统应用程序,包括CAN总线监听任务、数据处理任务、用户界面任务以及历史数据记录任务等,划分了各个任务的优先级,确定了任务之间的通信同步机制,描述了各个任务的主要功能和实现方法,重点论述了基于μC/GUI的用户界面任务设计的思路与过程,最后介绍了在硬件平台上进行系统集成、软硬件联合调试以及系统测试的流程。

    标签: ARM 燃料电池 汽车仪表 系统设计

    上传时间: 2013-06-20

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  • 单片机多功能调试助手V1.2.7

    本板的特色在于为之量身定制了一款多功能调试软件,不仅含有串口调试功能、而且该软件强大之处支持USB数据收发、网络数据收发、51/AVR单片机波特率计算、数码管字型码生成、进制转换、点阵生成、校验值(奇偶校验/校验和/CRC冗余循环校验)/BMP转16进制等功能,还带有自动升级功能,买家手上的调试助手永远是最新的,享受我们提供的软件服务。

    标签: 单片机 多功能 调试助手

    上传时间: 2013-07-08

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  • 基于ARM的网络型多环境参数测控系统的研究

    本课题是江苏省“十一五”工业攻关项目“总线化智能多参数高精度检测及控制仪表开发与产业化(BE2006090)”。本项目要求多环境参数测控、多总线接口,选择具有丰富接口的高速处理器作为本项目的核心。为满足多参数测控精度和多网络接口通讯可靠性,嵌入式设计是应用系统的理想选择。本文所研究的多参数测控装置是以三星公司生产的32位ARM微处理器S3C2410为核心的嵌入式系统,该系统能实时地获取水环境参数,为水环境和多总线接口提供基本的数据和控制信息。 本文详细地介绍了MODBUS和CAN-BUS总线协议和通讯原理,阐述了水产养殖几个重要环境参数一溶解氧、温度、PH值的检测算法原理、以及传感器调理电路和温度、溶解氧的控制策略,进行了测控系统的硬件架构和各个模块的原理设计,实现了操作系统的移植,编写了驱动程序。在基于QT/E环境下实现了系统的测控和总线通讯部分上层软件设计。提出并实施了系统测试方案,成功地完成了测控系统的硬件、软件测试、以及通信功能测试和现场在线测试。 本论文的研究开发工作是在实践的基础上完成的,实验结果证明该系统充分利用了S3C2410芯片提供的资源,具有高性能、低功耗、低成本的优点,在各个方面的性能比传统的水环境参数测控系统有很大提高,通过测试实现了预期的各种功能,完全达到预期要求。

    标签: ARM 网络 环境 参数

    上传时间: 2013-06-28

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  • 基于C8051F330单片机的多路温湿度测控系统

    介绍了一种高速、高性能的单片机C8051F330,该单片机内部集成了众多的功能部件,是真正的混合信号在片系统。本文对单片机的功能和特点做了详细的介绍,并以一个实际的多路温湿度测控系统为例,给出

    标签: C8051F330 单片机 多路 温湿度测控系统

    上传时间: 2013-07-28

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  • H264AVC的CAVLC编码算法研究及FPGA实现

    H.264/AVC是国际电信联盟与国际标准化组织/国际电工委员会联合推出的活动图像编码标准,简称H.264。作为最新的国际视频编码标准,H.264/AVC与MPEG-4、H.263等视频编码标准相比,性能有了很大的提高,并已在流媒体、数字电视、电话会议、视频存储等诸多领域得到广泛的应用。 本论文的研究课题是基于H.264/AVC视频编码标准的CAVLC(Context-based Adaptive Variable Length Coding,基于上下文的自适应可变长编码)编码算法研究及FPGA实现。对于变换后的熵编码,H.264/AVC支持两种编码模式:基于上下文的可变长编码(CAVLC)和基于上下文的自适应算术编码(CABAC,Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中,尽管CAVLC算法也是采用了VLC编码,但是同以往标准不同,它所有的编码都是基于上下文进行。这种方法比传统的查单一表的方法提高了编码效率,但也增加了设计上的困难。 作者在全面学习H.264/AVC协议和深入研究CAVLC编码算法的基础上,确定了并行编码的CAVLC编码器结构框图,并总结出了影响CAVLC编码器实现的瓶颈。针对这些瓶颈,对CAVLC编码器中的各个功能模块进行了优化设计,这些优化设计包括多参考块的表格预测法、快速查找表法、算术消除法等。最后,用Verilog硬件描述语言对所设计的CAVLC编码器进行了描述,用EDA软件对其主要功能模块进行了仿真,并在Cyclone II系列EP2C20F484的FPGA上验证了它们的功能。结果表明,该CAVLC编码器各编码单元的编码速度得到了显著提高且均能满足实时通信要求,为整个CAVLC编码器的实时通信提供了良好的基础。

    标签: CAVLC H264 FPGA 264

    上传时间: 2013-06-04

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  • OFDMMIMO系统接收机关键技术研究与FPGA实现

    近年来,移动通信技术在全球范围内得到了迅猛的发展及应用,各种全新的无线通信概念层出不穷、各种新的体制及其关键技术日新月异。由于正交频分复用(OFDM)技术可以高效地利用频谱资源并有效地对抗频率选择性衰落,多入多出(MIMO)利用多个天线实现多发多收,在不增加带宽和发送功率的情况下,可以成倍提高信道容量,因此OFDM-MIMO技术被广泛认为是后三代通信系统(B3G)的关键技术,是当今移动通信领域研究的热点。 本文对OFDM-MIMO通信系统接收机的关键技术--数字下变频,OFDM同步、解调进行了相关研究,在多天线接收板的XC2VP70-5FF1704芯片上,完成了数字下变频,OFDM同步和解调的FPGA设计与实现。通过功能仿真、时序仿真、板级电路测试,验证了该设计的正确性。 本文首先介绍了OFDM基本原理以其特点,然后对同步技术和数字下变频技术作了相应的介绍。同步是OFDM系统设计中的一项关键技术,即是针对系统中存在的时间偏差、频率偏差进行定时恢复、频偏的估计与补偿,来减少各种同步偏差对系统性能的影响。数字下变频是软件无线电的核心技术之一,其基本功能是从高速中频数字信号中提取所需的窄带信号,将其下变频为基带信号,降低数据率,以供后续DSP器件作进一步处理。 在数字下变频器的设计和实现方面,本文先介绍了数字下变频器的原理和基本结构,然后根据系统要求对其进行了设计,并在实现上作了一些简化,节约了硬件资源。 在对时间同步的设计和实现方面,本文采用了利用PN序列进行时间同步的算法。在实现上根据系统实际情况将数据分为四路分别与本地PN码做滑动相关运算,更有效的利用了同步数据,达到了更好的同步性能。 在OFDM的频率同步的设计和实现方面,本文采用重复的PN码两两相关来估计频偏值,并联合一个二阶负反馈环路进行补偿。该算法利用环路自身噪声带宽抑制噪声,提高频率估计精度,并同时利用负反馈扩大频偏估计范围。本文在对算法的详细研究分析的基础上对其进行了FPGA设计与实现。

    标签: OFDMMIMO FPGA 接收机

    上传时间: 2013-04-24

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  • 基于FPGA的多路码分复用通信系统实现

    第三代移动通信系统及技术是目前通信领域的研究热点。本系统采用了第三代移动通信系统的部分关键技术,采用直接序列扩频方式实现多路宽带信号的码分复用传输。在系统设计中,我们综合考虑了系统性能要求,功能实现复杂度与系统资源利用率,选择了并行导频体制、串行滑动相关捕获方式、延迟锁相环跟踪机制、导频信道估计方案和相干解扩方式,并在Quartus软件平台上采用VHDL语言,在FPGA芯片CycloneEP1C12Q240C8上完成了系统设计。通过对硬件测试板的测试表明文中介绍的方案和设计方法是可行和有效的。并在测试的基础上对系统提出了改进意见。

    标签: FPGA 多路 通信系统

    上传时间: 2013-06-27

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  • 基于DDSFPGA的多波形信号源的研究

    直接数字合成(DDS)技术采用全数字的合成方法,所产生的信号具有频率分辨率高、频率切换速度快、频率切换时相位连续、输出相位噪声低和可以产生任意波形等诸多优点。本文研究的是一种基于DDS/FPGA的多波形信号源系统,其中,DDS技术是其核心技术。DDS可以精确地控制合成信号的三个参量:幅度、相位以及频率,因此利用DDS技术可以合成任意波形。但因其数字化合成的固有特点,使其输出信号中存在大量杂散信号。杂散信号的主要来源是:相位截断带来的杂散信号;幅度量化带来的杂散信号;DAC的非线性特性带来的杂散信号。这些杂散信号严重影响了合成信号的频谱纯度。因此抑制这些杂散信号是提高合成信号谱质的关键。 本文在研究各种抑制DDS杂散技术的基础上,提出了中和加扰技术,这可以在很大程度上减小杂散对DDS输出信号谱质的影响。 EP1S808956C6是一款高性能的FPGA芯片,其超强的数据处理能力十分适合应用于DDS多波形信号源的开发。在QuartusⅡ平台下运用Verilog HDL语言和原理图设计可以很方便地应用各种抑制杂散信号的方法来提高输出信号的谱质。 结合高速DDS技术和FPGA两者的优点,本文设计了一种基于DDS/FPGA的多波形信号源,它能完成正弦波、余弦波、三角波、锯齿波、方波、AM、SSB、FM、2ASK、2FSK、π/4-QDPSK等多种信号。使得所设计的信号源可以适应多种不同的工作环境,给工作带了方便。

    标签: DDSFPGA 多波形 信号源

    上传时间: 2013-07-27

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  • 高吞吐量LDPC码编码构造及其FPGA实现

    低密度校验码(LDPC,Low Density Parity Check Code)是一种性能接近香农极限的信道编码,已被广泛地采用到各种无线通信领域标准中,包括我国的数字电视地面传输标准、欧洲第二代卫星数字视频广播标准(DVB-S2,Digital Video Broadcasting-Satellite 2)、IEEE 802.11n、IEEE 802.16e等。它是3G乃至将来4G通信系统中的核心技术之一。 当今LDPC码构造的主流方向有两个,分别是结合准循环(QC,Quasi Cyclic)移位结构的单次扩展构造和类似重复累积(RA,Repeat Accumulate)码构造。相应地,主要的LDPC码编码算法有基于生成矩阵的算法和基于迭代译码的算法。基于生成矩阵的编码算法吞吐量高,但是需要较多的寄存器和ROM资源;基于迭代译码的编码算法实现简单,但是吞吐量不高,且不容易构造高性能的好码。 本文在研究了上述几种码构造和编码算法之后,结合编译码器综合实现的复杂度考虑,提出了一种切实可行的基于二次扩展(Dex,Duplex Expansion)的QC-LDPC码构造方法,以实现高吞吐量的LDPC码收发端;并且充分利用该类码校验矩阵准循环移位结构的特点,结合RU算法,提出了一种新编码器的设计方案。 基于二次扩展的QC-LDPC码构造方法,是通过对母矩阵先后进行乱序扩展(Pex,Permutation Expansion)和循环移位扩展(CSEx,Cyclic Shift Expansion)实现的。在此基础上,为了实现可变码长、可变码率,一般编译码器需同时支持多个乱序扩展和循环移位扩展的扩展因子。本文所述二次扩展构造方法的特点在于,固定循环移位扩展的扩展因子大小不变,支持多个乱序扩展的扩展因子,使得译码器结构得以精简;构造得到的码字具有近似规则码的结构,便于硬件实现;(伪)随机生成的循环移位系数能够提高码字的误码性能,是对硬件实现和误码性能的一种折中。 新编码器在很大程度上考虑了资源的复用,使得实现复杂度近似与码长成正比。考虑到吞吐量的要求,新编码器结构完全抛弃了RU算法中串行的前向替换(FS,Forward Substitution)模块,同时简化了流水线结构,由原先RU算法的6级降低为4级;为了缩短编码延时,设计时安排每一级流水线计算所需的时钟数大致相同。 这种码字构造和编码联合设计方案具有以下优势:相比RU算法,新方案对可变码长、可变码率的支持更灵活,吞吐量也更大;相比基于生成矩阵的编码算法,新方案节省了50%以上的寄存器和ROM资源,单位资源下的吞吐量更大;相比类似重复累积码结构的基于迭代译码的编码算法,新方案使高性能LDPC码的构造更为方便。以上结果都在Xilinx Virtex II pro 70 FPGA上得到验证。 通过在实验板上实测表明,上述基于二次扩展的QC-LDPC码构造和相应的编码方案能够实现高吞吐量LDPC码收发端,在实际应用中具有很高的价值。 目前,LDPC码正向着非规则、自适应、信源信道及调制联合编码方向发展。跨层联合编码的构造方法,及其对应的编码算法,也必将成为信道编码理论未来的研究重点。

    标签: LDPC FPGA 吞吐量 编码

    上传时间: 2013-07-26

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