VERILOG HDL 数字系统设计
夏宇闻教授的数字系统设计教程Verilog HDL...
夏宇闻教授的数字系统设计教程Verilog HDL...
Verilog HDL是一种硬件描述语言(HDL:Hardware Discription Language),是一种以文本形式来描述数字系统硬件的结构和行为的语言,用它可以表示逻辑电路图、逻辑表达式,还可以表示数字逻辑系统所完成的逻辑功能。 Verilog HDL和VHDL是目前世界上最流行的两种...
夏宇闻著作:从算法设计到硬线逻辑的实现,fpga经验谈,数字信号处理的FPGA实现...
复杂数字逻辑系统的VerilogHDL 设计技术和方法...
这是一个IIC的接口程序,是夏宇闻编的书《verilog 数字系统设计教程》的IIC的源码,很通俗易懂...