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  • AVR单片机I2C总线实验.rar

    AVR单片机I2C总线实验。 1、用24C02记录CPU启动次数,并在PB口上显示出来。 2、内部1 M晶振,程序采用单任务方式,软件延时。 3、进行此实验请插上JP1的所有8个短路块,JP7(LED_EN)/PC0/PC1短路块。 4、通过此实验,可以I2C总线操作有个初步认识。

    标签: AVR I2C 单片机

    上传时间: 2013-07-28

    上传用户:cylnpy

  • SPI接口实验LED显示.rar

    SPI接口实险,LED数据管显示。 1、程序通过SPI接口输出数据到HC595芯片驱动LED数据管简单显示。 2、内部1 M晶振,程序采用单任务方式,软件延时。 3、进行此实验请插上JP1的所有8个短路块,JP6(SPI_EN)短路块。

    标签: SPI LED 接口

    上传时间: 2013-06-29

    上传用户:123啊

  • 智能断路器理论方法与关键技术的研究.rar

    断路器是电力系统中重要的控制和保护设备,对维护电力系统的安全、稳定和可靠运行起着重要的作用。如何使断路器高度智能化,并且更安全和可靠,是电力系统保护的发展要求,也是本论文研究的目的。 本文在深入研究了智能断路器国内外发展状况的基础上,精心设计了以数字信号处理器DSP和复杂可编程逻辑器件CPLD为核心的系统硬件。DSP是智能断路器测控单元的核心器件,它实现断路器的各种保护、报警、显示与控制功能。CPLD完成状态量的监测,以及各种逻辑信号的输出。两种器件相互配合使得断路器系统更加智能化。研究了断路器测控单元的测量原理及保护算法,并进行了具体的硬件和软件模块的设计,旨在实现断路器的智能保护、远程控制和集中管理。本设计以TI公司的DSP芯片TMS320LF2407为核心。硬件设计主要包括信号调理模块设计、信号采样模块设计、保护执行模块设计、CPLD模块设计和输入输出模块设计。并且利用TMS320LF2407本身具有的CAN2.0模块,通过CAN总线实现断路器和上位机的通信,实现遥测、遥调、遥控、遥信等“四遥”功能。软件采用模块化设计,每一个模块相对独立,完成某个特定功能,便于维护和添加新功能,并且调试灵活方便。文中给出了主程序及各个子程序的流程图,其中子程序有数据采集子程序、FFT计算子程序、液晶显示子程序、短路瞬时保护子程序、过载长延时保护子程序、接地故障保护子程序和短路短延时保护子程序等。并且设计中充分考虑了断路器工作环境的恶劣性,分析了各种干扰的来源,并针对各种干扰采取了对应的软件和硬件的抗干扰措施。最后,为了验证全波傅氏算法能否满足电网数据处理精度的要求,利用MATLAB搭建仿真平台,对其进行了仿真。结果表明全波傅氏算法能达到系统的要求。

    标签: 智能断路器 关键技术

    上传时间: 2013-04-24

    上传用户:BK094

  • 基于FPGA的Turbo码编译码器设计.rar

    作为性能优异的纠错编码,Turbo码自诞生以来就一直受到理论界以及工程应用界的关注。TD—SCDMA是我国拥有自主知识产权的3G通信标准,该标准把Turbo码是作为前向纠错体制,但Turbo码的译码算法比较复杂并且需要多次迭代,这造成Turbo码译码延时大,译码速度慢,因此限制了Turbo码的实际应用。因此有必要研究如何将现有的Turbo码译码算法进行简化,加速,使其转化成为适合在硬件上实现的算法,将实验室的理论研究成果转化成为硬件产品。 论文主要的研究内容有以下两点: 其一,提出信道自适应迭代译码方案。在事先设定最大迭代次数的情况下,自适应Turbo码译码算法能够根据信道的变化自动调整迭代次数。 仿真结果表明:该自适应迭代译码方案能够根据信道的变化自动调整迭代次数,在保证译码性能基本上没有损失的情况下,有效减少译码时间,明显提高译码速度。 其二,根据得到的信道自适应迭代译码方案,借助Xilinx公司Spartan3 FPGA硬件平台,使用Verilog硬件描述语言,将用C/C++语言写成的信道自适应迭代译码算法转化成为硬件设计实现,得到硬件电路,并对得到的译码器硬件电路进行测试。 测试结果表明:随着信道的变化,硬件电路的译码速度也随之自动变化,信噪比越高译码速度越快,并且硬件译码器性能(误比特率)与实验仿真基本一致。

    标签: Turbo FPGA 编译码器

    上传时间: 2013-05-31

    上传用户:huyiming139

  • 基于FPGA的GSM解扩解调的设计与实现.rar

    扩频通信系统与常规的通信系统相比,具有很强的抗窄带干扰,抗多径干扰,抗人为干扰的能力,并具有信息隐蔽、多址保密通信等优点,在近年来得到了迅速的发展。论文针对直扩通信系统中伪码和载波同步问题而展开,研究了直扩系统的结构、性能及完成了相关参数的计算,改进了包络算法,设计了解扩和解调器,最后用ISE9.1实现了解扩和解调器的仿真波形,验证了设计的正确性。 论文研究了扩频通信系统的特点、国内外发展现状及理论基础,完成了DS-QPSK接收机的解扩器和解调器的设计与实现。解扩器主要围绕着伪码的捕获与跟踪这一核心,分析了解扩器的结构、性能及其完成了相关参数的计算,完成了数字下变频器、伪码发生电路、伪码相关积分提取电路、多通道快码捕获电路、伪码跟踪鉴相电路、伪码时钟调整电路的设计,并在ISE9.1编程综合得到仿真结果,验证了设计的正确性。由于相关积分包络算法是整个系统的基础和核心,为了减少时延和系统所占硬件资源,改进了包络算法并得到了仿真验证。结果表明,它不但减少了硬件资源的占用、缩短了延时,而且对整个系统的优化起着决定性的作用。论文给出了伪码同步的仿真结果及资源占用情况,有力地说明了解扩器占用资源少、时延短等特点。 解调器研究了频偏及载波相位误差对信号的影响及同步方案,完成了数控振荡器、反正切鉴频器、环路滤波器的设计并得到了相关的仿真波形,实现了载波的跟踪,给出了仿真结果及资源占用情况,对系统实现过程中的一些经验进行了总结。最后是对论文工作的一些总结和对今后工作的展望。

    标签: FPGA GSM 解调

    上传时间: 2013-06-13

    上传用户:924484786

  • GSM接收机同步技术研究与基于FPGA和DSP的接收机设计.rar

    GSM是全球使用最为广泛的一种无线通信标准,不仅在民用领域,也在铁路GSM-R等专用领域发挥着极为重要的作用。由于无线信道具有瑞利衰落和延时效应,在通信系统的收发两端也存在不完全匹配等未知因素,因此接收的信号叠加有各种误差因素的影响。GSM接收机的实现离不开系统的同步,为了得到更好的同步质量,就必须对GSM基带同步技术进行研究,选择一种最合适的同步算法。GSM的同步既有时间同步,也有频率同步。 @@ 软件无线电是当前通信领域引入注目的热点之一。长期以来,GSM的接收和解调都是由专用的ASIC芯片来完成的,通过软件来实现GSM接收机的基带算法,体现了软件无线电技术的思想,选择用它们来实现的GSM接收机具有灵活、可靠、扩展性好的优点。 @@ 论文主要讨论GSM接收机同步算法与基于FPGA和DSP的GSM接收机设计, @@  主要内容包括: @@ 通过相关理论知识的学习,设计验证了GSM基带同步算法。对FB时间同步,讨论了包络检测和FFT变换两种不同的方法;对SB时间同步,介绍实相关和复相关两种方法;对频率同步,给出了一种对FB运用相关运算来精确估计频率误差的算法。 @@ 设计了使用GSM射频收发芯片RDA6210并通过实验室的ALTERA EP3C25FPGA开发板进行控制的GSM射频端的解决方案,论文对RDA6210的性能和控制方式进行了详细的介绍,设计了芯片的控制模块,得到了下变频后的GSM基带信号。 @@ 设计了基于RF前端+FPGA的GSM接收机方案。利用ALTERA EP2S180开发平台来完成基带数据的处理。针对ALTERA EP2S180开发平台模数转换器AD9433的特点使用THS4501设计了单独的差分运算放大器模块;设计了平台的数据存储方案并将该平台得到的基带采样数据用于同步算法的仿真。 @@ 设计了基于RF前端+DSP的GSM接收机方案。利用模数转换器AD9243、FPGA芯片和TMS320C6416TDSP芯片来完成基带数据的处理。设计了McBSP+EDMA传输的数据存储方案。 @@ 给出了接收机硬件测试的结果,从多方面验证了所设计硬件平台的可靠性。 @@关键词:GSM接收机;同步;RF; FPGA;DSP;

    标签: FPGA GSM DSP

    上传时间: 2013-07-01

    上传用户:sh19831212

  • 基于FPGA的RS255,223编解码器的高速并行实现.rar

    随着信息时代的到来,用户对数据保护和传输可靠性的要求也在不断提高。由于信道衰落,信号经信道传输后,到达接收端不可避免地会受到干扰而出现信号失真。因此需要采用差错控制技术来检测和纠正由信道失真引起的信息传输错误。RS(Reed—Solomon)码是差错控制领域中一类重要的线性分组码,由于它编解码结构相对固定,性能强,不但可以纠正随机差错,而且对突发错误的纠错能力也很强,被广泛应用在数字通信、数据存储系统中,以满足对数据传输通道可靠性的要求。因此设计一款高性能的RS编解码器不但具有很大的应用意义,而且具有相当大的经济价值。 本文首先介绍了线形分组码及其子码循环码、BCH码的基础理论知识,重点介绍了BCH码的重要分支RS码的常用编解码算法。由于其算法在有限域上进行,接着介绍了有限域的有关理论。基于RS码传统的单倍结构,本文提出了一种八倍并行编码及九倍并行解码方案,并用Verilog HDL语言实现。其中编码器基于传统的线性反馈移位寄存器除法电路并进行八倍并行扩展,译码器关键方程求解模块基于修正的欧几里德算法设计了一种便于硬件实现的脉动关键方程求解结构,其他模块均采用九倍并行实现。由于进行了超前运算、流水线及并行处理,使编解码的数据吞吐量大为提高,同时延时更小。 本论文设计了C++仿真平台,并与HDL代码结果进行了对比验证。Verilog HDL代码经过modelsim仿真验证,并在ALTERA STRATIX3 EP3SL15OF1152C2 FPGA上进行综合验证以及静态时序分析,综合软件为QUATURSⅡ V8.0。验证及测试表明,本设计在满足编解码基本功能的基础上,能够实现数据的高吞吐量和低延时传输,达到性能指标要求。本论文在基于FPGA的RS(255,223)编解码器的高速并行实现方面的研究成果,具有通用性、可移植性,有一定的理论及经济价值。

    标签: FPGA 255 223

    上传时间: 2013-04-24

    上传用户:思琦琦

  • 基于FPGA的无线传感器网络MAC层控制器的设计与实现.rar

    无线传感器网络(Wireless Sensor Networks,WSN)是由大量传感器节点组成,这些节点部署在监测区域内通过无线通信方式,形成的一个多跳自组织的网络。整个网络的作用是协作地感知、采集和处理网络覆盖区域中监测对象的信息,并发送给观察者,可广泛应用于环境监测、医疗护理、军事、商业等多个领域。 媒体访问控制(Medium Access Control,MAC)协议处于无线传感器网络协议的物理层和路由层之间,用于在传感器节点间公平有效地共享通信媒介,对传感器网络的性能有较大影响。与传统无线网络不同,提高能量效率和可扩展性是无线传感器网络MAC协议设计的主要目标。 本文主要阐述基于FPGA对IEEE802.15.4 MAC层功能的实现。首先介绍了无线传感器网络的体系结构、MAC协议的设计要求以及已有的MAC层协议,讨论了无线传感器网络MAC层的主要要求和功能。然后详细介绍和分析了IEEE802.15.4的MAC协议,并在此基础上,通过NS2平台对MAC层协议进行了仿真,研究不同网络负荷下信道访问机制的各个参数对吞吐量,丢包率,传输延时的影响,分析了隐蔽站问题、确认帧机制。 本文对MAC层中的主要功能,诸如数据收发、帧处理、信道接入方式以及帧检验等提出了基于FPGA的硬件解决方法。设计选用硬件描述语言VerilogHDL,在QuartusⅡ中完成模块的综合和布局布线,在QuartusⅡ和Modelsim中进行时序仿真验证,最终下载到自主设计Altera公司的Cyclone开发板中。 对设计的验证采取的是由里及外的方式,先对系统主模块的功能进行验证,然后下载到与CC2430开发板相连接的FPGA中对设计进行验证测试。验证流程是功能仿真、时序仿真和板级调试,最终通过测试,验证了该设计的功能。测试结果表明,该模块能满足无线传感器网络低速率应用环境的需要,具有优良的扩展性能,达到了预期的设计目标。

    标签: FPGA MAC 无线传感器网络

    上传时间: 2013-06-14

    上传用户:竺羽翎2222

  • 基于FPGA的数字图像实时消像旋的方法研究.rar

    本研究针对目标识别等系统中由于载机转动而使目标图像发生旋转,给测量及人眼观察带来的影响,因此需要对目标图像进行实时的反旋转处理,对目前出现的消像旋技术进行分析和比较,选择从电子学消旋方法出发,研究图像消像旋的方法,并给出了基于FPGA的实时消像旋系统的完整结构和相应的算法设计。 本文在对电子图像消旋原理的深入分析的基础上,设计并利用Visual C++6.0软件仿真实现了一种优化的快速旋转算法,再利用后插值处理保证了图像的质量;构建了以ACEX EP1K100为核心的数字图像实时消像旋系统,利用VHDL硬件描述语言实现了整个消像旋算法的FPGA设计。该系统利用高速相机和Camera Link接口传输图像,提高了系统的运行速度。利用QuartusII和Matlab软件对整个算法设计进行混合仿真实验。实验结果表明,该系统能够成功地对采集到的灰度图像进行消像旋处理,旋转后的图像清晰稳定,像素误差小于一个像素,而且对于视频信号只有一帧的延时不到20ms,达到系统参数要求。

    标签: FPGA 数字图像 方法研究

    上传时间: 2013-07-04

    上传用户:MATAIYES

  • 基于单片机控制的步进电机调速系统的设计.zip

    论文于单片机控制的基步进电机调速系统的设计 摘要: 步进电机是将电脉冲信号转变为角位移或线位移的开环控制元件。在非超载的情况下,电机的转速、停止的位置只取决于脉冲信号的频率和脉冲数,而不受负载变化的影响,即给电机加一个脉冲信号,电机则转过一个步距角。这一线性关系的存在,加上步进电机只有周期性的误差而无累积误差等特点。使得在速度、位置等控制领域用步进电机来控制变的非常的简单。步进电机的调速一般是改变输入步进电机的脉冲的频率来实现步进电机的调速,因为步进电机每给一个脉冲就转动一个固定的角度,这样就可以通过控制步进电机的一个脉冲到下一个脉冲的时间间隔来改变脉冲的频率,延时的长短来具体控制步进角来改变电机的转速,从而实现步进电机的调速。在本设计方案中采用AT89C51型单片机内部的定时器改变CP脉冲的频率从而实现对步进电机的转速进行控制,实现电机调速与正反转的功能。

    标签: zip 单片机控制 步进电机 调速系统

    上传时间: 2013-06-15

    上传用户:yw14205