基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码
基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码,其功能主要有:时间设置,时间显示,跑表,分频,日期设置,日期显示等...
基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码,其功能主要有:时间设置,时间显示,跑表,分频,日期设置,日期显示等...
s3c2410开发板cpld源码,希望有些参考价值...
FPGA RSIC CPU设计文档和源码是EDA中对CPU设计非常好用的程序...
通过fpga产生时钟的VHDL源码,QII7.1下调试通过...
ACTEL A3P StartKit FPGA开发全套文挡(含测试源码)...