可进化IP核

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可配置静态存储器（SRAM）模块是现场可编程门阵列（FPGA）的重要组成部分，它必须尽量满足用户不同的需要，所以要有良好的可配置性能。本文设计了一款深亚微米工艺下的4-Kb高速双端口可配置静态存储器（SRAM），它可以配置为4K×1、2K×...

2023-09-29 3 可进化IP核

这是一个fft的IP核，安装要求为quartus6.0以上。解压安装后可在quartus里例化使用，元件主要为cyclone和stratix,最大支持1024点的转换。

2013-12-24 192 可进化IP核

从基础到实践，逐步解析如何用Verilog HDL实现ARM7内核的逻辑设计。适合对数字电路和处理器架构感兴趣的开发者，提供清晰的代码结构与设计思路。

2026-02-25 3 可进化IP核