可调时间
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用verilong编写的lcd显示可调数字时钟
一套基于Verilog的LCD显示可调数字时钟源代码。适用于FPGA开发,支持时间调节功能,适合电子工程和嵌入式系统学习者及开发者使用。
2025-12-20
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有源可调延时和幅度均衡器设计
要求 设计一个可调的有源延迟和幅度均衡器,它的可调延迟范围是 0.5 ~ 3ms ,可调幅度范围是 ± 12dB ,中心频率为 1000Hz 。
2024-11-10
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设计一个能显示时、分、秒的简易数字钟,具有时间调整功能
设计一个能显示时、分、秒的简易数字钟,具有时间调整功能,利用GW48-PK2系统上的数码管显示时间,调整时间用的按键也使用GW48-PK2系统上的按键。
2014-01-07
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