可编程光纤延迟线系统开发主程序，C 语言，51单片机开发。
上传时间： 2017-08-09
上传用户：hustfanenze
可编程逻辑器件相关专辑 96册 1.77G可编程ASIC集成数字系统 420页 11.1M.pdf
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上传时间： 2014-05-05
上传用户：时代将军
该文档为基于FPGA的片上系统(SoC)原型验证的研究与实现概述资料，讲解的还不错，感兴趣的可以下载看看…………………………
标签： fpga
上传时间： 2021-10-18
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该文档为FPGA_ASIC-AHB片上系统总线的建模与验证讲解文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………
标签： fpga
上传时间： 2022-03-11
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GBT 20438.1-2017电气 电子 可编程电子安全相关系统的功能安全（全）
上传时间： 2022-04-12
上传用户：kent
PSoC 4是真正的可编程嵌入式片上系统，在同一芯片中集成了自定义的模拟和数字外设功能、存储器以及ARM Cortex-MO微控制器这样的系统和大部分混合信号嵌入式系统不完全一样，它们使用了一个微控制器单元（MCU）和外部模拟和数字外设的组合。除MCU外，通常它还需要多个集成电路，如运算放大器、模数转换器（ADC）和应用特定的集成电路（ASIC）PSoC 4提供了一个低成本的备用方案-批量生产中一般低于一美元一该方案可以替代一般的MCU加外部集成电路（IC）的组合方案。它的可编程模拟和数字子系统不仅可以降低整个系统成本，而且还支持极为灵活地调整设计，使产品快速上市。PSoC 4的一流的功耗性能可以在仍保持SRAM数据、可编程逻辑以及响应中断唤醒的前提下仅消耗低达150 nA的电流。在非数据保持的电源模式，PSoC 4仅消耗20 nA的电流。PSoC 4中的电容式触摸感应特性，称为CapSense"，能提供前所未有的信噪比、一流的防水性能以及支持各种类型的传感器，如按键、滑条、触控板和接近传感器。除PSoC4外，赛普拉斯PSoC系列还包括PSoC 1，PSoC 3和PSoC 5LP.这些器件提供了不同的架构和外设，更多有关的信息，请参见赛普拉斯平台PSoC解决方案的路线图PSoC 4系列的比较PSoC4包括下面三个器件系列：CYBC4000，CY8C4100以及CY8C4200，表1显示的是这些器件具有的特性。PSoC 4的功能集PSoC 4具有一个很大的功能集，包括：一个CPU和存储器子系统、一个数字子系统、一个模拟子系统以及全部系统资源，如图1所示。下面各节对每个特性进行了简要说明，更多有关信息，请查看PSoC 4的参考资源一节中所列出的PSoC 4系列器件的数据手册、技术参考手册（TRM）以及应用笔记.图1显示的是CY8C4200器件系列的各项特性。对于其他器件系列具备的这些特性的子集，请参考第2页上的表1.
标签： psoc4
上传时间： 2022-05-29
上传用户：trh505
现场可编程逻辑门阵列(FPGA)具有开发周期短、成本小、风险低和现场可灵活配置等优点,可以在更短的时间实现更复杂的功能,使得基于FPGA的开发平台的研究成为工业界和学术界日益关注的问题.基于FPGA的高集成度、高可靠性,可将整个设计系统下载于同一芯片中,实现片上系统,从而大大缩小其体积,因此以FPGA为代表的可编程逻辑器件应用日益广泛.在国外,FPGA技术发展与应用已达到相当高的程度;而在国内,FPGA技术发展仍处在起步阶段,与国外相比还存在较大的差距.本文提出了一种FPGA通用接口开发平台的设计思路,研制了一种FPGA快速实验开发装置,对研制过程中遇到的软、硬件问题加以归纳总结,提高了系统运行效率.分别研究了基于FPGA器件Altera公司的FLEX6000的字符型LCD、PC机ISA总线,基于FLEX10K的图像点阵型LCD、PC机PCI总线接口中.最后通过一个通用实验装置系统的设计和实现,综合上述应用,介绍了FPGA实验系统的软件开发环境,实现了基于FGPA的交通信号灯逻辑控制和电子钟,研究了FPGA技术在通用接口控制器设计中的应用.
上传时间： 2013-04-24
上传用户：龙飞艇
随着微电子技术和计算机技术的迅猛发展，尤其是现场可编程器件的出现，为满足实时处理系统的要求，诞生了一种新颖灵活的技术——可重构技术。它采用实时电路重构技术，在运行时根据需要，动态改变系统的电路结构，从而使系统既有硬件优化所能达到的高速度和高效率，又能像软件那样灵活可变，易于升级，从而形成可重构系统。可重构系统的关键在于电路结构可以动态改变，这就需要有合适的可编程逻辑器件作为系统的核心部件来实现这一功能。 论文利用可重构技术和“FD-ARM7TDMLCSOC”实验板的可编程资源实现了一个8位微程序控制的“实验CPU”，将“实验CPU”与实验板上的ARMCPU构成双内核CPU系统，并对双内核CPU系统的工作方式和体系结构进行了初步研究。 首先，文章研究了8位微程序控制CPU的开发实现。通过设计实验CPU的系统逻辑图，来确定该CPU的指令系统，并给出指令的执行流程以及指令编码。“实验CPU”采用的是微程序控制器的方式来进行控制，因此进行了微程序控制器的设计，即微指令编码的设计和微程序编码的设计。为利用可编程资源实现该“实验CPU”，需对“实验CPU”进行VHDL描述。 其次，文章进行了“实验CPU”综合下载与开发。文章中使用“Synplicity733”作为综合工具和“Fastchip3.0”作为开发工具。将“实验CPU”的VHDL描述进行综合以及下载，与实验箱上的ARMCPU构成双内核CPU，实现了基于可重构技术的双内核CPU的系统。根据实验板的具体环境，文章对双内核CPU系统存在的关键问题，如“实验CPU”的内存读写问题、微程序控制器的实现，以及“实验CPU'’框架等进行了改进，并通过在开发工具中添加控制模块和驱动程序来实现系统工作方式的控制。 最后，文章对双核CPU系统进行了功能分析。经分析，该系统中两个CPU内核均可正常运行指令、执行任务。利用实验板上的ARMCPU监视用“实验CPU”的工作情况，如模拟“实验CPU”的内存，实现机器码运行，通过串行口发送的指令来完成单步运行、连续运行、停止、“实验CPU"指令文件传送、“实验CPU"内存修改、内存察看等工作，所有结果可显示在超级终端上。该系统通过利用ARMCPU来监控可重构CPU，研究双核CPU之间的通信，尝试新的体系结构。
上传时间： 2013-04-24
上传用户：royzhangsz
随着FPGA技术的发展，在FPGA上实现片上系统在技术上已经可能。基于FPGA片上系统开发已成为目前FPGA应用的一个热点。但是基于FPGA片上系统对使用者的知识要求比较高，使用流程比较复杂，参考资料不多。成为目前开发者应用的瓶颈。本书针对基于FPGA片上系统开发的核心，用户IP的开发，并结合XILINX的嵌入式开发工具EDK，详细讲解了怎么去开发和调试客户自己的用户硬件外设（用户IP），使得开发者可以很快地熟练使用EDK，进行自己的片上系统开发。书中内容主要针对嵌入式用户硬件外设的开发流程和调试方法，不涉及开发语言的细节。在使用本书前必须熟练掌握硬件描述语言。本书基于XILINX的嵌入式开发平台，讲解了嵌入式系统的基本概念：FPGA原理和MicroBlaze处理器和最新的多端口内存控制器（MPMC）。以基于3个不同总线和接口的试验，详细讲述了怎样开发用户自定义IP。本书前三章以基本概念介绍为主。后四章以试验为主，分别介绍了在XILINX嵌入式开发平台上常用接口上用户IP开发的实现：第4章是介绍了EDK工具的使用流程；第5章是PLB总线的用户IP的开发；第6章是FSL总线的用户IP的开发；第7章是多端口内存控制器（mpmc）中NPI接口的用户IP的开发。
上传时间： 2022-07-28
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GBT 20438.3-2017(IEC 61508-3-2010) 电气 电子 可编程电子安全相关系统的功能安全 第3部分：软件要求
上传时间： 2022-04-12
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