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可<b>测</b>性设计

  • Altium Designer介绍

    Altium 公司认识到越来越需要把所有核心EDA 软件工具集中到一个集成软件包中,从而可以实现从设计概念直到生产的无缝集成。因此Altium 发布了专为Windows NT 平台构建的Protel98,这是首次将所有5 种核心EDA 工具集成于一体的产品,这5 种核心EDA 工具包括原理图输入、可编程逻辑器件(PLD)设计、仿真、板卡设计和自动布线。

    标签: Designer Altium

    上传时间: 2014-12-30

    上传用户:pei5

  • Allegro FPGA System Planner中文介绍

      完整性高的FPGA-PCB系统化协同设计工具   Cadence OrCAD and Allegro FPGA System Planner便可满足较复杂的设计及在设计初级产生最佳的I/O引脚规划,并可透过FSP做系统化的设计规划,同时整合logic、schematic、PCB同步规划单个或多个FPGA pin的最佳化及layout placement,借由整合式的界面以减少重复在design及PCB Layout的测试及修正的过程及沟通时间,甚至透过最佳化的pin mapping、placement后可节省更多的走线空间或叠构。   Specifying Design Intent   在FSP整合工具内可直接由零件库选取要摆放的零件,而这些零件可直接使用PCB内的包装,预先让我们同步规划FPGA设计及在PCB的placement。  

    标签: Allegro Planner System FPGA

    上传时间: 2013-11-06

    上传用户:wwwe

  • NI Multisim和NI Ultiboard评估软件(专业版)

    Multisim可用于原理图输入、SPICE仿真、和电路设计,无需SPICE专业知识,即可通过仿真来减少设计流程前期的原型反复。Multisim可识别错误、验证设计,以及更快地原型。此外,Multisim原理图可无缝转换到NI Ultiboard中完成PCB设计。评估版软件不能打印图表以及导出最终Gerber文件。更多信息请访问ni.com/multisim/zhs/。

    标签: Ultiboard Multisim NI 评估软件

    上传时间: 2013-10-29

    上传用户:micheal158235

  • Allegro FPGA System Planner中文介绍

      完整性高的FPGA-PCB系统化协同设计工具   Cadence OrCAD and Allegro FPGA System Planner便可满足较复杂的设计及在设计初级产生最佳的I/O引脚规划,并可透过FSP做系统化的设计规划,同时整合logic、schematic、PCB同步规划单个或多个FPGA pin的最佳化及layout placement,借由整合式的界面以减少重复在design及PCB Layout的测试及修正的过程及沟通时间,甚至透过最佳化的pin mapping、placement后可节省更多的走线空间或叠构。   Specifying Design Intent   在FSP整合工具内可直接由零件库选取要摆放的零件,而这些零件可直接使用PCB内的包装,预先让我们同步规划FPGA设计及在PCB的placement。  

    标签: Allegro Planner System FPGA

    上传时间: 2013-10-19

    上传用户:shaojie2080

  • 清华大学Altera FPGA工程师成长手册(光盘视频)

       《Altera FPGA工程师成长手册》以altera公司的fpga为例,由浅入深,全面、系统地详细讲述了基于可编程逻辑技术的设计方法。《Altera FPGA工程师成长手册》讲解时穿插了大量典型实例,便于读者理解和演练。另外,为了帮助读者更好地学习,《Altera FPGA工程师成长手册》提供了配套语音教学视频,这些视频和《Altera FPGA工程师成长手册》源代码一起收录于《Altera FPGA工程师成长手册》配书光盘中。   《Altera FPGA工程师成长手册》涉及面广,从基本的软件使用到一般电路设计,再到nios ⅱ软核处理器的设计,几乎涉及fpga开发设计的所有知识。具体内容包括:eda开发概述、altera quartus ii开发流程、altera quartus ii开发向导、vhdl语言、基本逻辑电路设计、宏模块、lpm函数应用、基于fpga的dsp开发设计、sopc系统构架、soc系统硬件开发、sopc系统软件开发、nios ii常用外设、logiclock优化技术等。

    标签: Altera FPGA 清华大学 工程师

    上传时间: 2015-01-01

    上传用户:123啊

  • WP370 -采用智能时钟门控技术降低动态开关功耗

        赛灵思推出业界首款自动化精细粒度时钟门控解决方案,该解决方案可将 Virtex®-6 和 Spartan®-6 FPGA 设计方案的动态功耗降低高达 30%。赛灵思智能时钟门控优化可自动应用于整个设计,既无需在设计流程中添加更多新的工具或步骤,又不会改变现有逻辑或时钟,从而避免设计修改。此外,在大多数情况下,该解决方案都能保留时序结果。

    标签: 370 WP 智能时钟 动态

    上传时间: 2015-01-02

    上传用户:wutong

  • 基于Labview的远程虚拟通信实验室开发

    传统的通信类实验课程需要购置大量的仪器设备用于教学,在操作过程中设备、线路的故障和老化又会影响实验进度。针对《通信原理》、《现代通信技术》等实验课的教学现状,本文在Labview2009的平台上开发一个远程虚拟通信实验室系统,可根据主要知识点自主设计扩展实验项目,学生可以在任何时候通过网络访问该系统进行实验,加深学生对理论知识的理解,提高学习效率,也可为高校节约大量资金。文中以线性分组码编解码系统和2FSK调制解调系统为例,详细介绍了该系统的具体设计和实现。

    标签: Labview 远程 虚拟通信 实验室

    上传时间: 2013-11-13

    上传用户:dljwq

  • 5位数微电脑型盘面式电表(24*48mm)

    特点: 精确度0.05%滿刻度±1位數 可量测交直流电流/交直流电压/電位計/傳送器/Pt-100/热电偶/荷重元/電阻 等信号 显示范围-19999~99999可任意规划 具有自动归零或保持或双显示功能 (optional) 小数点可任意规划 尺寸小,穩定性高

    标签: 24 48 mm 微电脑

    上传时间: 2013-11-20

    上传用户:libinxny

  • 微电脑型交流电力控制电表

    特点: 精确度0.25%满刻度±1位數 可量测交流瓦特/乏爾/功率因數/相角 显示范围0- ±19999可任意规划 输入与输出绝缘耐压2仟伏特/1分钟(input/output/power)) 突波测试强度4仟伏特(1.2x50us) 2组警报功能 (Optional) 15BIT类比输出功能 (Optional) 数位RS-485界面 (Optional)

    标签: 微电脑 交流 电力控制 电表

    上传时间: 2013-11-08

    上传用户:330402686

  • 微电脑型盘面式控制电表(显示幕0.56”)

    特点 精确度0.05%滿刻度 ±1位數 可量测 交直流電流/交直流电压/電位計/传送器/Pt-100/荷重元/電阻 等信号 显示范围0- ±19999可任意规划 具有自动归零与保持(开根号)功能 具有9段线性折補功能 4組警報功能 15BIT 类比输出功能 數位RS-485界面

    标签: 0.56 微电脑 控制 电表

    上传时间: 2013-10-12

    上传用户:gonuiln