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双处理器

双核处理器(DualCoreProcessor)是指在一个处理器上集成两个运算核心,从而提高计算能力。“双核”的概念最早是由IBM、HP、Sun等支持RISC架构的高端服务器厂商提出的,不过由于RISC架构的服务器价格高、应用面窄,没有引起广泛的注意。简而言之,双核处理器即是基于单个半导体的一个处理器上拥有两个一样功能的处理器核心。换句话说,将两个物理处理器核心整合入一个核中。芯片制造厂商们也一直坚持寻求增进性能而不用提高实际硬件覆盖区的方法。多核处理器解决方案针对这些需求,提供更强的性能而不需要增大能量或实际空间。
  • 基于FPGA的音频处理器的设计与实现

    本文分析了数字音频处理技术中数字滤波器的各种传统实现算法,尤其是研究了FIR数字滤波器的实现算法,在分析了数字滤波器的传统算法的基础上,针对家用和便携式音频处理系统,提供一种基于FPGA的音频处理器的实现方案,以适应便携式和家用设备对处理器体积和功耗小的发展要求.该方案对实现N阶FIR数字滤波器的传统算法进行了改良,将滤波器的系数用浮点数表示法来表示,使得原本至少需要一个乘法器和一个加法器来实现滤波功能,现在仅需要若干次加法和移位运算就可以实现,很大程度降低了设计的复杂度和系统功耗,也减少了芯片的面积.同时采用硬件描述语言VHDL实现了音频处理器各个模块的设计.

    标签: FPGA 音频处理器

    上传时间: 2013-06-02

    上传用户:cknck

  • 采用FPGA实现基于ATCA架构的2.5Gbps串行背板接口

    当前,在系统级互连设计中高速串行I/O技术迅速取代传统的并行I/O技术正成为业界趋势。人们已经意识到串行I/O“潮流”是不可避免的,因为在高于1Gbps的速度下,并行I/O方案已经达到了物理极限,不能再提供可靠和经济的信号同步方法。基于串行I/O的设计带来许多传统并行方法所无法提供的优点,包括:更少的器件引脚、更低的电路板空间要求、减少印刷电路板(PCB)层数、PCB布局布线更容易、接头更小、EMI更少,而且抵抗噪声的能力也更好。高速串行I/O技术正被越来越广泛地应用于各种系统设计中,包括PC、消费电子、海量存储、服务器、通信网络、工业计算和控制、测试设备等。迄今业界已经发展出了多种串行系统接口标准,如PCI Express、串行RapidIO、InfiniBand、千兆以太网、10G以太网XAUI、串行ATA等等。 Aurora协议是为私有上层协议或标准上层协议提供透明接口的串行互连协议,它允许任何数据分组通过Aurora协议封装并在芯片间、电路板间甚至机箱间传输。Aurora链路层协议在物理层采用千兆位串行技术,每物理通道的传输波特率可从622Mbps扩展到3.125Gbps。Aurora还可将1至16个物理通道绑定在一起形成一个虚拟链路。16个通道绑定而成的虚拟链路可提供50Gbps的传输波特率和最大40Gbps的全双工数据传输速率。Aurora可优化支持范围广泛的应用,如太位级路由器和交换机、远程接入交换机、HDTV广播系统、分布式服务器和存储子系统等需要极高数据传输速率的应用。 传统的标准背板如VME总线和CompactPCI总线都是采用并行总线方式。然而对带宽需求的不断增加使新兴的高速串行总线背板正在逐渐取代传统的并行总线背板。现在,高速串行背板速率普遍从622Mbps到3.125Gbps,甚至超过10Gbps。AdvancedTCA(先进电信计算架构)正是在这种背景下作为新一代的标准背板平台被提出并得到快速的发展。它由PCI工业计算机制造商协会(PICMG)开发,其主要目的是定义一种开放的通信和计算架构,使它们能被方便而迅速地集成,满足高性能系统业务的要求。ATCA作为标准串行总线结构,支持高速互联、不同背板拓扑、高信号密度、标准机械与电气特性、足够步线长度等特性,满足当前和未来高系统带宽的要求。 采用FPGA设计高速串行接口将为设计带来巨大的灵活性和可扩展能力。Xilinx Virtex-IIPro系列FPGA芯片内置了最多24个RocketIO收发器,提供从622Mbps到3.125Gbps的数据速率并支持所有新兴的高速串行I/O接口标准。结合其强大的逻辑处理能力、丰富的IP核心支持和内置PowerPC处理器,为企业从并行连接向串行连接的过渡提供了一个理想的连接平台。 本文论述了采用Xilinx Virtex-IIPro FPGA设计传输速率为2.5Gbps的高速串行背板接口,该背板接口完全符合PICMG3.0规范。本文对串行高速通道技术的发展背景、现状及应用进行了简要的介绍和分析,详细分析了所涉及到的主要技术包括线路编解码、控制字符、逗点检测、扰码、时钟校正、通道绑定、预加重等。同时对AdvancedTCA规范以及Aurora链路层协议进行了分析, 并在此基础上给出了FPGA的设计方法。最后介绍了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT设计工具,可在标准ATCA机框内完成单通道速率为2.5Gbps的全网格互联。

    标签: FPGA ATCA Gbps 2.5

    上传时间: 2013-05-29

    上传用户:frank1234

  • 嵌入式USB总线器件端处理器的FPGA实现研究

      本文提出了一种适合于嵌入式SoC的USB器件端处理器的硬件实现结构。并主要研究了USB器件端处理器的RTL级实现及FPGA原型验证、和ASIC实现研究,包括从模型建立、算法仿真、各个模块的RTL级设计及仿真、FPGA的下载测试和ASIC的综合分析。它的速度满足预定的48MHz,等效门面积不超过1万门,完全可应用于SOC设计中。  本文重点对嵌入式USB器件端处理器的FPGA实现作了研究。为了准确测试本处理器的运行情况,本文应用串口传递测试数据入FPGA开发板,测试模块读入测试数据,发送入PC机的主机端。通过NI-VISA充当软件端,检验测试数据的正确。     

    标签: FPGA USB 嵌入式 器件

    上传时间: 2013-07-24

    上传用户:1079836864

  • 基于FPGA的双自触发脉冲激光测距关键技术研究

    激光测距技术被广泛应用于现代工业测量、航空与大地的测量、国防及通信等诸多领域。本文从已获得广泛应用的脉冲激光测距技术入手,重点分析了近年提出的自触发脉冲激光测距技术(STPLR)特别是其中的双自触发脉冲激光测距技术(BSTPLR),通过分析发现其核心部件之一就是用于测量激光脉冲飞行时间(周期)的高精度高速计数器,而目前一般的方式是采用昂贵的进口高速计数器或专用集成电路(ASIC)来完成,这使得激光测距仪在研发、系统的改造升级和自主知识产权保护等诸多方面受到制约,同时在其整体性能上特别是在集成化、小型化和高可靠性方面带来阻碍。为此,本文研究了采用现场可编程门阵列(FPGA)来实现脉冲激光测距中的高精度高速计数及其他相关功能,基本解决了以上存在的问题。 论文通过对双自触发脉冲激光测距的主要技术要求和技术指标进行分析,对其中的信号处理单元采用了FPGA+单片机的设计形式。由FPGA主控芯片(EPF10K20TC144-4)作为周期测量模块,在整个测距系统中是信号处理的核心部件,借助其用户可编程特性及很高的内部时钟频率,设计了专用于BSTPLR的高速高精度计数芯片,负责对测距信号产生电路中的时刻鉴别电路输出信号进行计数。数据处理模块则主要由单片机(AT89C51)来实现。系统可以通过键盘预置门控信号的宽度以均衡测量的精度和速度,测量结果采用7位LED数码管显示。本设计在近距离(大尺寸)范围内实验测试时基本满足设计要求。

    标签: FPGA 自触发脉冲 激光测距 关键技术

    上传时间: 2013-06-02

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  • 基于FPGA的MPEG4协同处理器研究

    网络带宽依然在不断增长(尤其是在本地网),最后一公里的高速接入日益普及;另一方面的情况是大容量的磁盘、FLASH移动存储盘和激光盘的容量不断增大,使得传送和储存数据的成本不断地下降。不仅使人发问:我们孜孜不倦的搞视频压缩高级算法还有多少意义?我们可以看到,算法的复杂性日益增加,但性能的提高却接近边缘。 是什么还在要求更高的压缩速率?还有被我们遗忘的地方吗?还有什么应用让我们继续追求更精妙的压缩算法? 在作者看来,这个应用领域就是移动视频服务。无线频谱这种稀缺资源的有限性决定了我们必须继续对视频压缩技术进行研究。即使伴随UMTS/IMT2000的到来,移动终端可以获得的数据速率也限制在144Kbit/s,在微蜂窝的时候最高能达到的速率上限也在2Mbit/s。144Kbit/s的速率对于较高质量的视频传输来讲,仍然是有限的。因此,可以预见,移动终端的空中接口这个瓶颈使得我们必须继续进行视频压缩。 另一方面,移动终端领域开发视频压缩算法,在其低功耗和实时性要求下,也是异常困难的。为了减少计算的复杂性和运动估计的功耗,业界提出了许多快速算法,例如2-D的对数搜索,三步搜索,联合搜索。尽管这些方法减少了功耗,其结果是视频压缩性能的降低,因为这些算法的本质是减少了运动搜索的空间。为了实现运动搜索的低功耗,在电路领域又提出了搜索窗口和时钟管理的措施。但这些方法都是在牺牲视频压缩比性能的基础进行的折中,并没有强调算法映射结构上做出处理。 本论文提出了一种新的解决MPEG-4运动估计运算的低功耗实时处理器架构。其基础是采用了心肌阵列并行处理技术和低功耗控制电路。运动估计的繁复运算通过心肌阵列分布式运算得到有效处理。从理论上看,心肌阵列有其简单易理解性,然后,由于FPGA的互联网络有限性,设计这样一个阵列仍有许多值得注意的问题。论文提出使用保守近似处理在全局运动估计中减少功耗,其本质是消除不必要的冗余运算。宏块的最小误差匹配是一个典型的串行操作过程。论文新提出的方法是在进行绝对匹配前使用保守计算,如果保守误差值与最小误差差别过大,则不进行绝对误差计算。 总的说来,论文实现了两个目标:通过心肌阵列实现了实时的运动估计编码,通过在算法层次引入控制电路,降低运动估计电路的功耗。

    标签: MPEG4 FPGA 处理器

    上传时间: 2013-06-23

    上传用户:lacsx

  • 基于ARMDSP的双足机器人导航控制系统的研究

    双足机器人是一个多自由度、多变量、非线性的复杂动力学系统。其控制平台的研究往往涉及嵌入式技术、传感器技术、步态规划、路径导航、人工智能、自动化控制等多种理论与技术,体现了信息科学和人工智能技术的最新成果,应用领域广大,具有重要的研究价值。其中,双足机器人导航控制系统是双足机器人控制平台研究中的重点和难点,将在自动驾驶、未知区域的探索、危险环境作业、核电站的维护等领域中发挥极大的作用。 本文以双足机器人导航控制系统的设计为研究背景,结合嵌入式系统开发的关键技术,主要论述了两个核心内容:一是双足机器人导航决策系统的设计。该系统是基于一种新式的ARM&DSP主从控制模式下的设计。该设计借助内外传感器系统的反馈,通过对多传感器信息的融合与处理,在导航决策算法的作用下,实现双足机器人在未知环境下平滑的自主导航。二是为增强双足机器人导航的人机交互性和控制系统对突发事件的处理能力,在基于MiniGUI的系统平台上设计了双足机器人的导航控制系统界面。论文的主要内容包括: 首先,设计了双足机器人的本体模型,并对双足机器人的步态规划做了理论研究,为步态控制获得理论上的支持。 然后,就双足机器人导航控制平台的搭建做了详细的介绍,并着重对主从控制器间通讯的CAN接口做了详细的设计。 接着,从两个层面设计了导航决策系统,一是根据内部传感器得到的关节信息,比对决策层中的步态规划算法,对关节的运动进行实时的补偿和调整,实现各关节动作的协调,得到标准的步态,保证每一步的稳定和准确。二是对外部传感器获得的外界环境信息进行处理,构建出供决策层使用的外部环境模型,之后在基于模糊神经网络的导航算法的指引下,实现双足机器人对外界环境做出合理、平滑的响应。 最后,介绍了导航控制界面的设计与实现。重点介绍了MiniGUI开发平台的搭建、基于MiniGUI的界面程序的设计以及程序在开发板上的移植,实现了控制界面在双足机器人导航上的应用。

    标签: ARMDSP 双足机器人 导航控制系统

    上传时间: 2013-04-24

    上传用户:527098476

  • 基于ARM处理器的便携式仪表人机接口的设计

    随着现代工业的发展,人机接口在工业生产以及社会生活中发挥着越来越重要的作用,同时,人机接口的各项技术问题也日益凸现出来,越来越受到世界各国的关注。 本课题就基于便携式仪表人机接口的设计开展研究。设计的关键步骤包括:人机接口的软硬件设计、实验系统的搭建以及在一条天然气管道上进行管道检测实验,验证人机接口的实用性。 论文中介绍了人机接口技术的发展过程与现状、人机接口系统的软硬件详细设计。人机接口硬件包括:ARM处理器控制核心、通信接口电路、LCD显示接口电路、USB接口储存电路;软件包括人机接口的底层软件与应用软件。在实验过程中,首先获取一段有裂纹的天然气管道,接着使用自行设计的采样模块检测磁场信号,通过串口将数据发送到人机接口平台,人机接口平台使用嵌入式Linux作为操作系统,使用Qt程序在LCD上显示实时曲线。而后人机接口将数据存储在闪盘中,同时使用一系列算法程序对数据进行处理,最后利用检测到的漏磁场法向分量HP(Y)的具有显著特征的最大梯度值的位置来判断裂纹的位置,再与实际的裂纹位置对比,得出可行性结论。经过大量的实验,该系统可以很好的实现检测目的,验证了人机接口的实用性。

    标签: ARM 处理器 便携式仪表 人机接口

    上传时间: 2013-06-28

    上传用户:www240697738

  • 基于ARM处理器的数据采集系统设计

    在现代工业测控领域,人们对数据采集的要求越来越高;不仅要求高速、高精度还要求采集设备便携化、网络化和智能化,此外还需要友好的人机界面。传统的8/16位单片机因资源极度受限,难以满足上述要求;而PCI或ISA数据采集卡,则存在着安装麻烦、价格昂贵且电磁兼容性差等缺点。32位嵌入式微处理器的出现很好地解决了上述矛盾,本文的研究正是基于ARM的嵌入式数据采集系统的设计。 本文以齿轮箱或机械转轴的振动信号为采集对象设计了基于ARM处理器和嵌入式Linux的数据采集系统。该系统硬件平台以S3C2410主控板和自行研制的振动信号调理板为核心,在此基础上扩展了UART、RS485、USB、TCP/IP以及单总线通信接口,适应多种条件下的数据传输。同时系统提供了LCD显示和触摸屏输入模块,具备良好的人机交互功能。软件方面,搭建Linux交叉开发环境,实现了基于Linux操作系统的Bootloader的移植。最后,根据课题需要,完成了A/D采样和单总线驱动程序的设计。 本嵌入式数据采集系统存储容量大,硬件接口丰富,软件资源配置灵活,设计方案具有很好的通用性和可扩展性。

    标签: ARM 处理器 数据采集 系统设计

    上传时间: 2013-05-28

    上传用户:D&L37

  • 基于ARM的DeviceNet从站开发

    DeviceNet现场总线标准作为工业现场总线的国际标准,其开放性和先进性得到了广泛关注和充分肯定。开发符合DeviceNet现场标准的自动化产品意义重大,也是必要的。 文中从现场通用的老式串口(RS232和RS485)与新兴DeviceNet网络的兼容问题以及模拟量,数字量和多种总线等多功能的一体化问题为出发点,以Atmel的32位ARM7高速处理器为开发平台,充分发挥其处理高速和功能多样的优势,同时结合DeviceNet现场总线高效和诊断的优点,开发了一个带8路数字量输入,8数字量输出,4路模拟量输入以及RS232为底层自定义协议串口,RS485为底层的在线可配置Modbus协议的DevciceNet一体化通讯网关。 最后文中还利用双口RAM的协同处理能力,构成双CPU处理能力的结构,将avr162的8位处理器处理PROFIBUS总线数据,而将32位的ARM7处理器处理DeviceNet总线数据。文中特别从系统硬件开发和软件开发两方面加以阐述,并结合OMRON PLC主站测试系统,最终成功给于测试。 为了便于读者理解和文章的完整性,本文首先对DeviceNet现场总线标准做了简单介绍;后根据DeviceNet标准对所需求的产品的进行总体设计,以及相应的DeviceNet网关的硬件和软件的设计和开发。最后,搭建了DeviceNet-Modbus测试系统和DeviceNet-PROFIBUS DP两套测试系统对所开发产品进行的了功能测试。本课题按照预期设计思想完成了DeviceNet多功能网关的软硬件的开发,并将系统程序下载到处理器中,在测试平台下能够长时间的正常运行,达到了期望效果。

    标签: DeviceNet ARM

    上传时间: 2013-04-24

    上传用户:huangzchytems

  • 双足机器人设计(含程序)

    介绍双足舵机机器人制作及方法程序,并有同时控制24路舵机方法技巧

    标签: 双足机器人 程序

    上传时间: 2013-06-27

    上传用户:小宇NVO