采用软件方法来实现单片机的通用串口引脚来模拟UART。根据要求采用P1.0作为发送端（TXD）,P1.1做为数据接受端（RXD），并采用全双工通信模式。由于MAX232电平转换芯片除了做UART的几个引脚后，还剩余T2IN,T2OUT,R2IN,R2OUT.所以采用模仿UART的接法.每次通信，发送的数据加1，接收的数据加2.用51系列单片机。
上传时间： 2013-12-17
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Verilog HDl语言实现CPLD-EPC240与电脑的串口通讯QUARTUS逻辑工程源码 //本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在//PC机上安装一个串口调试工具来验证程序的功能。//程序实现了一个收发一帧10个bit（即无奇偶校验位）的串口控//制器，10个bit是1位起始位，8个数据位，1个结束//位。串口的波特律由程序中定义的div_par参数决定，更改该参数可以实//现相应的波特率。程序当前设定的div_par 的值是0x145，对应的波特率是//9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时间//划分为8个时隙以使通信同步.//程序的工作过程是：串口处于全双工工作状态，按动key1，FPGA/CPLD向PC发送“21 EDA"//字符串（串口调试工具设成按ASCII码接受方式）；PC可随时向FPGA/CPLD发送0-F的十六进制
标签： verilog hdl cpld 串口通讯 quartus
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