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单相全桥

  • VIP专区-嵌入式/单片机编程源码精选合集系列(116)

    VIP专区-嵌入式/单片机编程源码精选合集系列(116)资源包含以下内容:1. 有关节1027的知识很有用.2. Atmel的AT91SAM7x256芯片的usb存储的源程序.3. Atmel的AT91SAM7X256的串行Flash读写的源程序.4. 这是一个驱动大功率电机的控制模块.5. Atmel的AT91SAM7X256的和24系列EEPROM通讯的源程序.6. 学习嵌入式应用系统设计.7. I2C 通讯严格的时序是很多初学者头痛的问题.8. 万年历.9. 基于LWIP的服务器.10. PLC的基本回路程式集(真的是很好用的東西,初學者必讀).11. 《数据结构》算法实现及解析.12. s52单片机对PS2键盘的输入解码.13. 终于用AVR驱动起来这个型号是FL032-C0 控制芯片是ILI9320 的240*320 TFT LCD. AVR芯片用的是M32 当然这个屏最合适用ARM来驱动。16bit总线.14. 简单有效的应用程序.15. 1602显示万年历程序,C语言和汇编的都在,我也是从网上下的,大家可以参考一下.16. Developing.Series.60.Applications.A.Guide.for.Symbian.OS.C.Developers.17. test file nucleus source.18. This file is an example to use timer2 in mode 0..19. google为mobile开发的搜索SDK.20. LPC2104/5/6嵌入式系统程序实例,带有PROTUES7.1仿真文件,适合做入门指导.21. LPC2104/5/6嵌入式系统程序实例,带有PROTUES7.1仿真文件,适合做入门指导.22. 利用8279键盘显示后接口电路做做电子钟.23. 使用AVR单片机做的单相电表项目,采用取最大值的办法计算有效值,算法比较简单,有protel99的原理图..24. 使用STR710的SPI接口访问外部EEPROM的例子程序.使用KEIL UV3编译.使用了MDK3.05操作系统..25. 使用STR710的IIC接口对PCF8563时钟芯片的测试程序.采用KEIL UV3编译.使用了MDK3.05操作系统..26. 关于matlab图形用户界面的有关知识.27. aduc842原程序代码 ad公司芯片应用笔记.28. 与语音信号处理有关的代码,在GUIDE界面下做的.29. 学习写flash驱动程序的好助手,很宝贵!.30. 51+sl811读写U盘的源程序+原理图.31. 采用C#编写.32. PIC实用子程序,51实用子程序,96实用子程序.33. IC_CARD 4442芯片 的源程序.34. I2C接口的AD及D A转换器的应用..源程序.35. nucleus 源码包括具体的内核适合研究 nucleus.36. iar 嵌入式开发软件,破解版version4.20a.37. 初学plc相关资料.38. 与书ARM嵌入式应用系统开发典型实例光盘配套.39. SPI接口实险.40. 祥细介绍Freescale HCS12 微控制器 MC9S12DP256/DG128开发的中文资料.

    标签: 激光 基础知识

    上传时间: 2013-07-18

    上传用户:eeworm

  • VIP专区-嵌入式/单片机编程源码精选合集系列(135)

    VIP专区-嵌入式/单片机编程源码精选合集系列(135)资源包含以下内容:1. AT89C52红外接收c源码 已经过调试 下载即可使用.2. 步进电机驱动控制技术及其应用设计研究 一编论文.3. Nucleus PLUS source code anasisy. An open source OS which is widely used in embedded development dom.4. 数字系统CAD 开发平台实验部分共有6 个实验.5. 12位ads7816的两种读取方式:SPI方式和手动方式.6. 可用于嵌入式编程学习.7. ADE7755应用于单相CPU卡表的硬件设计原理图.8. 电能表的结构原理介绍和工作原理介绍.9. 这是一个关于C++编程规范的资料.10. C/C++bianchengguifan.11. 赛车程序:先对赛道和赛车建立模型.12. This document teach how you interface the microcontroller to the devices using i2c , spi and serial.13. 我收集的一些I2C的技术文档和在linux环境的应用分析等.14. 模糊PID在电阻炉温度控制系统中的应用。提出了FUZZY-PID控制器.15. 在网站上找到的一个比较不错的字符叠加程序.16. 包的运用.17. 嵌入式高速数据采集器的研制.18. 嵌入式C_C++语言精华文章集锦.19. Visual C++网络通信协议分析与应用实现代码.20. 嵌入式C编程语言入门与深入.21. 周立功的PCI51XX CAN卡在VC6.0下的开发示例.22. 飞思卡尔S12系Serial_Peripheral_Interphase_(SPI)应用范例.23. 飞思卡尔S12系列Inter-IC_Bus__(IIC)应用范例.24. 开机时.25. 简单的程序.26. U2270B组成的读卡头原理图!典型应用电路.27. lpc214x的开发平台下载软件 使用lpc214x的开发.28. ZIGBEE1015无线传感器统会自动删除debug和release目录.29. Introduction: 1. Macro1: AddFailureModeCol is used to the test report generated from GNPO Rpt Tools.30. 适合用于嵌入式的zc301摄像头驱动。解压缩之后放在/driver/media/video/zc0301目录下.31. 开源嵌入式图形软件FLTK使用 视频教程.32. jz4740 nand boot source code. jz4740 nand 引导代码.33. 用C++写的一个模拟ATM自动取款机的程序.我这个程序不同于网上现有的那个不能记录用户填写信息的..34. 该电子日历可显示年、月、日、星期、时、分的时间信息。 整个系统采用AT89C52作为中央处理芯片.35. 让你了解AODV在OPNET下怎么运用.36. 基于GPS定位的嵌入式汽车监控器设计.37. 使用手册.38. Zigbee培训资料.39. EASYARM2210的原理图 设计ARM硬件的重要参考.40. 嵌入式平台的开发全过程 非常易懂 嵌?胧狡教ǖ目⑷?非常易懂.

    标签: 夜视

    上传时间: 2013-05-25

    上传用户:eeworm

  • FPGA内全数字延时锁相环的设计.rar

    现场可编程门阵列(FPGA)的发展已经有二十多年,从最初的1200门发展到了目前数百万门至上千万门的单片FPGA芯片。现在,FPGA已广泛地应用于通信、消费类电子和车用电子类等领域,但国内市场基本上是国外品牌的天下。 在高密度FPGA中,芯片上时钟分布质量变的越来越重要,时钟延迟和时钟偏差已成为影响系统性能的重要因素。目前,为了消除FPGA芯片内的时钟延迟,减小时钟偏差,主要有利用延时锁相环(DLL)和锁相环(PLL)两种方法,而其各自又分为数字设计和模拟设计。虽然用模拟的方法实现的DLL所占用的芯片面积更小,输出时钟的精度更高,但从功耗、锁定时间、设计难易程度以及可复用性等多方面考虑,我们更愿意采用数字的方法来实现。 本论文是以Xilinx公司Virtex-E系列FPGA为研究基础,对全数字延时锁相环(DLL)电路进行分析研究和设计,在此基础上设计出具有自主知识产权的模块电路。 本文作者在一年多的时间里,从对电路整体功能分析、逻辑电路设计、晶体管级电路设计和仿真以及最后对设计好的电路仿真分析、电路的优化等做了大量的工作,通过比较DLL与PLL、数字DLL与模拟DLL,深入的分析了全数字DLL模块电路组成结构和工作原理,设计出了符合指标要求的全数字DLL模块电路,为开发自我知识产权的FPGA奠定了坚实的基础。 本文先简要介绍FPGA及其时钟管理技术的发展,然后深入分析对比了DLL和PLL两种时钟管理方法的优劣。接着详细论述了DLL模块及各部分电路的工作原理和电路的设计考虑,给出了全数字DLL整体架构设计。最后对DLL整体电路进行整体仿真分析,验证电路功能,得出应用参数。在设计中,用Verilog-XL对部分电路进行数字仿真,Spectre对进行部分电路的模拟仿真,而电路的整体仿真工具是HSIM。 本设计采用TSMC0.18μmCMOS工艺库建模,设计出的DLL工作频率范围从25MHz到400MHz,工作电压为1.8V,工作温度为-55℃~125℃,最大抖动时间为28ps,在输入100MHz时钟时的功耗为200MW,达到了国外同类产品的相应指标。最后完成了输出电路设计,可以实现时钟占空比调节,2倍频,以及1.5、2、2.5、3、4、5、8、16时钟分频等时钟频率合成功能。

    标签: FPGA 全数字 延时

    上传时间: 2013-06-10

    上传用户:yd19890720

  • 单片机控制的可控硅三相全控桥整流触发电路

    研究以MCS-96系列80C196KB单片机为基础,结合外围器件来实现对可控硅三相全控桥的触发控制。采用锁相环技术及过零触发的方法,实现触发脉冲与电源信号(线电压)的同步,提高了触发器的抗干扰能力,

    标签: 单片机控制 三相全控桥 可控硅 整流

    上传时间: 2013-04-24

    上传用户:fredguo

  • 基于单线圈永磁机构的相控开关控制器的设计.rar

    选相控制开关又称同步开关或相控开关,其实质就是控制开关在电压或电流的期望相位完成合闸或分闸,以主动消除开关过程所产生的涌流和过电压等电磁暂态效应,提高开关的开断能力。本论文首先分析了提高断路器可靠性的途径,介绍了相控开关的研究意义及其优点;相控开关的基本原理和分合闸操作过程,为同步开关选相控制器的设计提供了理论依据。 永磁操动机构是近几年正在发展的一种新型操动机构,它利用永久磁铁产生的磁力将真空断路器保持在分合闸位置,而无需任何传统机械脱扣锁扣装置。它机构零部件少,结构简单,使断路器动作的可靠性大大提高。二次控制回路采用电子控制模块,动作迅速并可以实现精确时间控制,采用开关电源输入范围宽,输入输出用光耦隔离,功耗低,极大地提高了可靠性,使永磁机构真空断路器成为真正意义的免维护智能化断路器。单线圈永磁机构结构简单、体积小,在中压领域得到越来越广泛的应用。相控真空开关采用三相独立操动的单线圈永磁机构,其操作电源为由大功率电力电子器件控制的储能大容量电容器,通过多次的测试结果表明单线圈永磁机构能很好地满足相控开关的要求,是相控开关的理想选择。 本文详细介绍了以Mega16为控制核心的单线圈永磁机构智能控制器,这种控制系统集保护、控制、开关量监测等功能于一体。可实现对电容电压实时显示,具有过电流速断保护、过电压和欠电压保护、闭锁以及报警等功能。 通过相关试验测试,表明本系统已经初步达到了设计所要达到的预期效果,为以后的研究以及同步控制系统的完善和优化提供了有益的经验和参考。

    标签: 单线圈 永磁机构 开关控制器

    上传时间: 2013-07-02

    上传用户:一诺88

  • 三相桥式整流的功率因数校正技术的研究.rar

    随着电力电子技术的发展,交流电源系统的电能质量问题受到越来越多的关注。传统的整流环节广泛采用二极管不控整流和晶闸管相控整流电路,向电网注入了大量的谐波及无功,造成了严重的污染。提高电网侧功率因数以及降低输入电流谐波成为一个研究热点。功率因数校正技术是减小用电设备对电网造成的谐波污染,提高功率因数的一项有力措施。本文所做的主要工作包括以下几部分: 1.分析了单位功率因数三相桥式整流的工作原理,这种整流拓扑从工作原理上可以分成两部分:功率因数补偿网络和常规整流网络。在此基础上,为整流电路建立了精确的数学模型。 2.这种单位功率因数三相桥式整流的输入电感是在额定负载下计算出的,当负载发生变化时,其功率因数会降低。针对这种情况,提出了一种新的控制方法。常规整流网络向电网注入的谐波可以由功率因数补偿网络进行补偿,所以输入功率因数相应提高。负载消耗的有功由电网提供,补偿网络既不消耗有功也不提供任何有功。根据功率平衡理论,可以确定参考补偿电流。双向开关的导通和关断由滞环电流控制确定。在这一方法的控制下,双向开关工作在高频下,因此输入电感值相应降低。仿真和实验结果都表明:新的控制方法下,负载变化时,输入电流仍接近于正弦,功率因数接近1。 3.根据IEEE-519标准对谐波电流畸变率的要求,为单位功率因数三相桥式整流提出了另一种控制方法。该方法综合考虑单次谐波电流畸变率、总谐波畸变率、功率因数、有功消耗等性能指标,并进行优化,推导出最优电流补偿增益和相移。将三相负载电流通过具有最优电流补偿增益和相移的电流补偿滤波器,得到补偿后期望的电网电流,驱动双向开关导通和关断。仿真和实验都收到了满意的效果,使这一整流桥可以工作在较宽的负载范围内。 4.单位功率因数三相桥式整流中直流侧电容电压随负载的波动而波动,为提高其动、静态性能,将简单自适应控制应用到了直流侧电容电压的控制中,并提出利用改进的二次型性能指标修改自适应参数的方法,可以在实现对参考模型跟踪的同时又不使控制增量过大,与常规的PI型简单自适应控制相比在适应律的计算中引入了控制量的增量和状态误差在k及k+1时刻的采样值。利用该方法为直流侧电压设计了控制器,并进行了仿真与实验研究,结果表明与PI型适应律相比,新的控制器能提高系统的动态响应性能,负载变化时系统的鲁棒性更强。

    标签: 三相桥式 整流 功率因数

    上传时间: 2013-06-15

    上传用户:WS Rye

  • 全数字超声诊断系统部分核心算法的FPGA实现.rar

    60年代初,国际上首次将B超诊断仪应用于临床诊断,40多年来B超诊断仪的发展极为迅速。随着数字信号处理及计算机技术的发展,目前国际上先进水平的超声诊断设备几乎每一个环节都包含着数字信号处理的内容,研制全数字化的超声诊断设备已成为发展趋势。 @@ 基于FPGA及嵌入式操作系统的全数字超声诊断系统具有技术含量高、便携的特点,可用数字硬件电路来实现数据量极其庞大的超声信息的实时处理。 @@ 本文从超声诊断原理入手,在对超声诊断系统中的几个关键技术进行分析的基础上,重点研究开发超声诊断系统中数字信号处理部分的两个核心算法。以FPGA芯片为载体,在Quartus Ⅱ平台中采用Verilog HDL语言进行编程并仿真验证,分别实现了数字FIR滤波器及CORDIC坐标变换两个模块的功能。另外,采用Verilog HDL语言对应用于图像显示模块的SPI接口进行了编程设计,编译下载至FPGA中,最终实现了与ARM A8的OMPG3530板之间高速串行数据的传输。 @@ 采用在单片FPGA芯片内实现数字式超声诊断部分核心算法并与高性能ARMA8处理器相配合的数字信号处理解决方案,具有高速度、高精度、高集成度、便携的特点,为全数字化便携超声诊断设备的研制打下了基础。 @@关键词:超声诊断系统;FPGA;数字FIR滤波器;CORDIC算法;SPI总线

    标签: FPGA 全数字 超声诊断系统

    上传时间: 2013-07-07

    上传用户:hxy200501

  • FPGA技术在全数字化超声诊断仪中的应用研究

    数字超声诊断设备在临床诊断中应用十分广泛,研制全数字化的医疗仪器已成为趋势。尽管很多超声成像仪器设计制造中使用了数字化技术,但是我们可以说现代VLSI 和EDA 技术在其中并没有得到充分有效的应用。随着现代电子信息技术的发展,PLD 在很多与B 型超声成像或多普勒超声成像有关的领域都得到了较好的应用,例如数字通信和相控雷达领域。 在研究现代超声成像原理的基础上,我们首先介绍了常见的数字超声成像仪器的基本结构和模块功能,同时也介绍了现代FPGA 和EDA 技术。随后我们详细分析讨论了B 超中,全数字化波束合成器的关键技术和实现手段。我们设计实现了片内高速异步FIFO 以降低采样率,仿真结果表明资源使用合理且访问时间很小。正交检波方法既能给出灰度超声成像所需要的回波的幅值信息,也能给出多普勒超声成像所需要的回波的相移信息。我们设计实现了基于直接数字频率合成原理的数控振荡器,能够给出一对幅值和相位较平衡的正交信号,且在FPGA 片内实现方案简单廉价。数控振荡器输出波形的频率可动态控制且精度较高,对于随着超声在人体组织深度上的穿透衰减,导致回波中心频率下移的声学物理现象,可视作将回波接收机的中心频率同步动态变化进行补偿。 还设计实现了B 型数字超声诊断仪前端发射波束聚焦和扫描控制子系统。在单片FPGA 芯片内部设计实现了聚焦延时、脉宽和重复频率可动态控制的发射驱动脉冲产生器、线扫控制、探头激励控制、功能码存储等功能模块,功能仿真和时序分析结果表明该子系统为设计实现高速度、高精度、高集成度的全数字化超声诊断设备打下了良好的基础,将加快其研发和制造进程,为生物医学电子、医疗设备和超声诊断等方面带来新思路。

    标签: FPGA 全数字 中的应用 超声诊断仪

    上传时间: 2013-06-18

    上传用户:hfmm633

  • 多业务PDH单片FPGA解决方案

    随着通信网的发展和用户需求的提高,光纤通信中的PDH体系逐渐被SDH体系所取代.SDH光纤通信系统以其通信容量大、传输性能好、接口标准、组网灵活方便、管理功能强大等优点获得越来越广泛的应用.但是在某些对传输容量需求不大的场合,SDH的巨大潜力和优越性无法发挥出来,反而还会造成带宽浪费.相反,PDH因其容量适中,配置灵活,成本低廉和功能齐全,可针对客户不同需要设计不同的方案,在某些特定的接入场合具有一定的优势.本课题根据现实的需要,提出并设计了一种基于PDH技术的多业务单片FPGA传输系统.系统可以同时提供12路E1的透明传输和一个线速为100M以太网通道,主要由一块FPGA芯片实现大部分功能,该解决方案在集成度、功耗、成本以及灵活性等方面都具有明显的优势.本文首先介绍数字通信以及数字复接原理和以太网的相关知识,然后详细阐述了本系统的方案设计,对所使用的芯片和控制芯片FPGA做了必要的介绍,最后具体介绍了系统硬件和FPGA编码设计,以及后期的软硬件调试.归纳起来,本文主要具体工作如下:1.实现4路E1信号到1路二次群信号的复分接,主要包括全数字锁相环、HDB3-NRZ编解码、正码速调整、帧头检测和复分接等.2.将以太网MII接口来的25M的MII信号通过码速变换到25.344M,进行映射.3.将三路二次群信号和变换过的以太网MII信号进行5b6b编解码,以利于在光纤上传输.4.高速时提取时钟采用XILINX的CDR方案.并对接收到的信号经过5b6b解码后,分接出各路信号.

    标签: FPGA PDH 多业务 方案

    上传时间: 2013-07-23

    上传用户:lansedeyuntkn

  • 应用于十万门FPGA的全数字锁相环设计

    在过去的十几年间,FPGA取得了惊人的发展:集成度已达到1000万等效门、速度可达到400~500MHz。随着FPGA的集成度不断增大,在高密度FPGA中,芯片上时钟的分布质量就变得越来越重要。时钟延时和时钟相位偏移已成为影响系统性能的重要因素。现在,解决时钟延时问题主要使用时钟延时补偿电路。 为了消除FPGA芯片内的时钟延时,减小时钟偏差,本文设计了内置于FPGA芯片中的延迟锁相环,采用一种全数字的电路结构,将传统DLL中的用模拟方式实现的环路滤波器和压控延迟链改进为数字方式实现的时钟延迟测量电路,和延时补偿调整电路,配合特定的控制逻辑电路,完成时钟延时补偿。在输入时钟频率不变的情况下,只需一次调节过程即可完成输入输出时钟的同步,锁定时间较短,噪声不会积累,抗干扰性好。 在Smic0.18um工艺下,设计出的时钟延时补偿电路工作频率范围从25MHz到300MHz,最大抖动时间为35ps,锁定时间为13个输入时钟周期。另外,完成了时钟相移电路的设计,实现可编程相移,为用户提供与输入时钟同频的相位差为90度,180度,270度的相移时钟;时钟占空比调节电路的设计,实现可编程占空比,可以提供占空比为50/50的时钟信号;时钟分频电路的设计,实现频率分频,提供1.5,2,2.5,3,4,5,8,16分频时钟。

    标签: FPGA 应用于 全数字 锁相环

    上传时间: 2013-07-06

    上传用户:LouieWu