随着软硬件技术的不断发展，嵌入式系统的应用越来越广泛，嵌入式技术也全面渗透到日常生活的每一个角落。掌上汉语学习机系统的开发是为满足对汉语学习有需要的人群。随着经济、技术的不断提高，中国逐渐走向国际化，汉语学习人员的人数也不断增加，开发出一款掌上汉语学习机系统是有充分的市场需求的。 系统的开发环境是基于ARM-Linux开发平台，并应用了嵌入式开发的相关关键技术，包括嵌入式图形用户界面系统MiniGUI和嵌入式数据库SQLite，系统开发的目的是在这些技术的基础上，为需要学习汉语的人员提供一款界面友好、功能丰富的语言学习工具。 本文主要讲述的是掌上汉语学习机系统的软件开发过程以及开发过程中涉及的开发环境及开发技术。随着手持设备的硬件条件的提高，嵌入式系统对轻量级GUI的需求越来越迫切，图形用户界面的支持是实现一个完善的语言学习系统的基础，本文首先从图形用户界面的历史、技术特点、结构模型、发展状况等方面做了介绍，然后介绍了MiniGUI的体系结构和版本，以及移植的方法和过程，还详细阐述了应用程序开发中对MiniGUI函数库的使用和调用方法。同时一个简单实用的数据库的支持会为系统中的数据处理和组织提供方便，本项目中有六个字典和其它学习程序，对数据的处理也相当多，本文介绍了嵌入式数据库的知识和Sqlite数据库在项目中的使用和开发技术。最后，以系统中的单位换算模块为例详细介绍了应用程序的开发过程。本文的内容涉及了嵌入式Linux软件开发的主要技术，在ARM-Linux嵌入式开发领域具有很强的实践意义。
上传时间： 2013-06-15
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近年来，我国通信技术的发展势头十分迅猛。以电路交换和数字程控交换技术为基础的电话网更是在整个通信网中占据着重要的地位。面对信息时代的到来，人们在领略信息社会乐趣的同时，也遇到了新的挑战，学习和掌握程控交换技术己成为有关工程技术人员和广大青年学生迫切的需要。 本论文在研读了大量的文献、参考相关设计的基础上，根据程控交换的基本原理，面向各高校实验室和相关研究单位，设计了基于ARM的程控交换实验系统，本实验系统以ARM+CPLD为控制系统，按照功能不同进行模块化设计，在本实验系统上能够完成程控交换中的大部分基础性实验以及一些和程控交换编程调试相关的实验。 本实验系统由硬件和软件两部分组成，硬件包括CPU控制电路、用户接口电路、交换网络、中继电路、信号音产生电路、双音多频电路、彩铃电路以及LCD显示电路等部分。软件包括基本级程序、周期级程序，在最后还对LCD显示部分的uC/GUI程序进行了介绍，通过硬件和软件结合完成了人工交换、空分交换、时分交换、数字中继接口以及彩铃等各种实验。 本套实验系统目前已经投入使用，与其它程控交换实验系统相比，本实验系统提供了丰富的扩展口，实验者可以自行进行扩展实验，同时，本实验系统人机交互界面友好，操作简单方便。
上传时间： 2013-07-30
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该论文的工作主要分为两部分,第一部分是介绍与数字高清晰度电视(HDTV)码流发生器配套的信源解码板的设计与实现.信源解码板是整个码流发生器的重要组成部分,该论文在介绍相关标准MPEG-2和AC-3以及整个码流发生器功能的基础上提出了用ST公司的芯片组实现HDTV信源解码板的设计方案.论文详细分析了各个功能模块的具体设计方法以及实现时应注意的问题.目前该课题已经成功结题,各项技术指标完全符合合作单位的要求.该论文的第二部分主要是进行基于FPGA的显示器测试信号发生器的研究与开发.在对测试信号发生器所需产生的13种测试图案和所要适应的18种显示格式的介绍之后,该论文提出了以FLEX10K50为核心控制芯片的显示器测试信号发生器的设计方案.该论文详细讨论了FPGA设计中各个功能模块的划分和设计实现方法,并介绍了对FLEX10K50进行配置的方法.
上传时间： 2013-04-24
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作为嵌入式系统核心的微处理器，是SOC不可或缺的“心脏”，微处理器的性能直接影响着整个SOC的性能。 与国际先进技术相比，我国在这一领域的研究和开发工作还相当落后，这直接影响到我国信息产业的发展。本着赶超国外先进技术，填补我国在该领域的空白以摆脱受制于国外的目的，我国很多科研单位和公司进行了自己的努力和尝试。经过几年的探索，已经有多种自主知识产权的处理器芯片完成了设计验证并逐渐进入市场化阶段。我国已结束无“芯”的历史，并向设计出更高性能处理器的目标迈进。 艾科创新微电子公司的VEGA处理器，是公司凭借自己的技术力量和科研水平设计出的一款64位高性能RSIC微处理器。该处理器基于MIPSISA构架，采用五级流水线的设计，并且使用了高性能处理器所广泛采用的虚拟内存管理技术。设计过程中采用自上而下的方法，根据其功能将其划分为取指、译码、算术逻辑运算、内存管理、流水线控制和cache控制等几个功能块，使得我们在设计中能够按照其功能和时序要求进行。 本文的首先介绍了MIPS微处理器的特点，通过对MIPS指令集和其五级流水线结构的介绍使得对VEGA的设计有了一个直观的认识。在此基础上提出了VEGA的结构划分以及主要模块的功能。作为采用虚拟内存管理技术的处理器，文章的主要部分介绍了VEGA的虚拟内存管理技术，将VEGA的内存管理单元(MMU)尤其是内部两个翻译后援缓冲(TLB)的设计作为重点给出了流水线处理器设计的方法。结束总体设计并完成仿真后，并不能代表设计的正确性，它还需要我们在实际的硬件平台上进行验证。作为论文的又一重点内容，介绍了我们在VEGA验证过程中使用到的FPGA的主要配置单元，FPGA的设计流程。VEGA的FPGA平台是一完整的计算机系统，我们利用在线调试软件XilinxChipscope对其进行了在线调试，修正其错误。 经过模块设计到最后的FPGA验证，VEGA完成了其逻辑设计，经过综合和布局布线等后端流程，VEGA采用0.18工艺流片后达到120MHz的工作频率，可在其平台上运行Windows-CE和Linux嵌入式操作系统，达到了预计的设计要求。
上传时间： 2013-07-07
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本论文利用FPGA可编程逻辑器件和硬件描述语言Verilog，采用自顶向下的设计方法，开发了一款基于PCI总线的高速数据采集卡。本数据采集系统中，采用PLX公司生产的PLX9080作为PCI总线接口芯片。用4片每片容量为8MB的SDRAM作为数据采集的前端和PCI总线的数据缓冲。用ALTERA公司生产的Cyclone系列FPGA实现PCI接口芯片PLX9080的时序逻辑、对数据采集通道的前端控制以及对SDRAM的读写控制。 在本论文将重点放在了用硬件描述语言Verilog进行FPGA硬件逻辑编程上。本论文按照自顶向下的设计方法，详细论述了PCI接口转化电路模块、SDRAM存储片子读写控制电路模块、FPGA内部寄存器读写控制电路模块以及用于RF端的自动增益控制电路AGC模块的设计。
上传时间： 2013-04-24
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LM258内部包括有两个独立的、高增益、内部频率补偿的双运算放大器，适合于电源电压范围很宽的单电源使用，也适用于双电源工作模式，在推荐的工作条件下，电源电流与电源电压无关。它的使用范围
上传时间： 2013-07-26
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十种精密全波整流电路 图中精密全波整流电路的名称,纯属本人命的名,只是为了区分;除非特殊说明,增益均按1设计. 图1是最经典的电路,优
上传时间： 2013-07-21
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在工业生产中，二次自动化仪表是构成自动化系统的基本单元之一。我国的单元仪表己基本完成由电动Ⅲ型仪表向基于八位或十六位单片机为基础设计的数字化仪表的转换。由于常规单片机资源的限制，以单片机为基础设计的单元仪表基本上还是在功能上替代电动Ⅲ型仪表，并按电动Ⅲ型功能进行分类。这样造成国内自动化仪表生产厂家生产的二次数字化仪表品种繁杂，标准难以统一，设计随意性大。因此带来如下现实问题： 1．自动化系统设计单位的仪表选型、系统调试、使用中操作、维修和系统的功能优化及备件的准备非常的不方便： 2．仪表生产厂家的批量生产困难，产品质量的提高及成本的节约不利： 3．国内现在自动化仪表厂家数量众多，但都无法形成规模生产，质量不佳，而国外进口的二次仪表往往依附于特定的集散系统，也存在标准不统一，难以灵活替换的问题，且价格昂贵。 自动化系统设计、生产及应用迫切需要一种使用方便、通用性强的智能型二次仪表，以解决上述问题，改变传统设计、生产及应用方式，这将是未来自动化仪表的发展趋势，也就是本课题的努力方向。 本论文正是针对上述问题，以设计出一种可灵活组态的通用智能型二次仪表为研究对象，在深入分析国内主流仪表厂家的仪表操作方式和仪表功能的基础上，合理地进行软硬件设计，为在同一硬件平台下实现多种仪表的功能进行了创新性和探索性研究。主要内容为： 1．各种常规二次仪表功能、标准、接线、操作习惯及结构方式的归类分析； 2．多信号多量程的柔性测量方法研究； 3．系统整机设计以及系统可靠性设计； 4．u-boot的向ARM的移植、uClinux向ARM的移植、uClinux下的通用组态软件设计。 本文设计了一种以三星公司的ARM7TDMI系列处理器S3C44BOX为核心，辅以外围电路，实现同一硬件平台下多种仪表的功能，并成功制作了样品系统。 本文所讨论的基于$3C44BOX和uClinux的智能仪表系统的开发技术同样适用于其它项目的开发，对其它嵌入式的应用系统开发有重要的参考价值。
上传时间： 2013-05-16
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用户对宽带无线接入业务、尤其是对于宽带无线化以及移动化的需求日益增加,使无线宽带接入技术WiMAX(World interoperability for Microwave Access,即全球微波接入互操作性技术)应运而生、迅猛发展,成为这两年业界关注的焦点。除了通常的互联网接入应用外,它还将在提供IPTV和VOIP等宽带业务方面取得成功,它还有可能成为一种先进的4G蜂窝电话技术。WiMAX未来将进入蜂窝电话、笔记本电脑和机顶盒等应用中。 本文在介绍WiMAX传输标准802.16d基础上,详细阐述了WiMAX接收机中信道解调芯片中的自动增益控制(Automatic Gain Control,AGC)部分。首先介绍了自动增益控制系统的基本组成和其主要特性指标,通过对一个步进式AGC的分析,得到AGC模型的输出公式。然后针对WiMAX接收机内AGC系统中的模数转换器以及AGC电路进行介绍和理论分析。本文采用SPW(Signal Processing WorkSystem)模型对AGC电路基本结构的算法分析,并结合仿真结果对AGC电路做了详尽解说并对参数进行了解释说明。 最后给出了基于SPW和FPGA(Field Programmable Gate Array)验证的结果。通过SPW对AGC进行了单独的性能测试,并结合整个系统的性能测试来说明AGC可以和系统的其他模块协同工作。在FPGA测试中,可以证明用Verilog实现后AGC也同样能较好的工作。 本文实现的基于导频的步进式的数字AGC是针对WiMAX系统的自动增益控制电路提出的解决方案。此算法结合WiMAX系统的传输方式,提出的算法具有迅速锁定信号的特点,能够满足WiMAX系统的要求。同时,由于各种关键参数设计为寄存器可配的方式,具有很好的灵活性,也就具有了更高的移植性,可以作为一种通用的数字AGC算法。
上传时间： 2013-04-24
上传用户：zhanditian
低密度校验码（LDPC，Low Density Parity Check Code）是一种性能接近香农极限的信道编码，已被广泛地采用到各种无线通信领域标准中，包括我国的数字电视地面传输标准、欧洲第二代卫星数字视频广播标准（DVB-S2，Digital Video Broadcasting-Satellite 2）、IEEE 802.11n、IEEE 802.16e等。它是3G乃至将来4G通信系统中的核心技术之一。 当今LDPC码构造的主流方向有两个，分别是结合准循环（QC，Quasi Cyclic）移位结构的单次扩展构造和类似重复累积（RA，Repeat Accumulate）码构造。相应地，主要的LDPC码编码算法有基于生成矩阵的算法和基于迭代译码的算法。基于生成矩阵的编码算法吞吐量高，但是需要较多的寄存器和ROM资源；基于迭代译码的编码算法实现简单，但是吞吐量不高，且不容易构造高性能的好码。 本文在研究了上述几种码构造和编码算法之后，结合编译码器综合实现的复杂度考虑，提出了一种切实可行的基于二次扩展（Dex，Duplex Expansion）的QC-LDPC码构造方法，以实现高吞吐量的LDPC码收发端；并且充分利用该类码校验矩阵准循环移位结构的特点，结合RU算法，提出了一种新编码器的设计方案。 基于二次扩展的QC-LDPC码构造方法，是通过对母矩阵先后进行乱序扩展（Pex，Permutation Expansion）和循环移位扩展（CSEx，Cyclic Shift Expansion）实现的。在此基础上，为了实现可变码长、可变码率，一般编译码器需同时支持多个乱序扩展和循环移位扩展的扩展因子。本文所述二次扩展构造方法的特点在于，固定循环移位扩展的扩展因子大小不变，支持多个乱序扩展的扩展因子，使得译码器结构得以精简；构造得到的码字具有近似规则码的结构，便于硬件实现；（伪）随机生成的循环移位系数能够提高码字的误码性能，是对硬件实现和误码性能的一种折中。 新编码器在很大程度上考虑了资源的复用，使得实现复杂度近似与码长成正比。考虑到吞吐量的要求，新编码器结构完全抛弃了RU算法中串行的前向替换（FS，Forward Substitution）模块，同时简化了流水线结构，由原先RU算法的6级降低为4级；为了缩短编码延时，设计时安排每一级流水线计算所需的时钟数大致相同。 这种码字构造和编码联合设计方案具有以下优势：相比RU算法，新方案对可变码长、可变码率的支持更灵活，吞吐量也更大；相比基于生成矩阵的编码算法，新方案节省了50％以上的寄存器和ROM资源，单位资源下的吞吐量更大；相比类似重复累积码结构的基于迭代译码的编码算法，新方案使高性能LDPC码的构造更为方便。以上结果都在Xilinx Virtex II pro 70 FPGA上得到验证。 通过在实验板上实测表明，上述基于二次扩展的QC-LDPC码构造和相应的编码方案能够实现高吞吐量LDPC码收发端，在实际应用中具有很高的价值。 目前，LDPC码正向着非规则、自适应、信源信道及调制联合编码方向发展。跨层联合编码的构造方法，及其对应的编码算法，也必将成为信道编码理论未来的研究重点。
上传时间： 2013-07-26
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